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“立足STCO集成系統(tǒng)設(shè)計(jì)” 芯和半導(dǎo)體在DAC上發(fā)布EDA2025軟件集

“立足STCO集成系統(tǒng)設(shè)計(jì)” 芯和半導(dǎo)體在DAC上發(fā)布EDA2025軟件集

芯和半導(dǎo)體近日在美國(guó)舊金山西莫斯克尼會(huì)議中心舉辦的DAC2025設(shè)計(jì)自動(dòng)化大會(huì)上，正式發(fā)布了其EDA2025軟件集。面對(duì)人工智能技術(shù)對(duì)計(jì)算效能需求的指數(shù)級(jí)攀升，構(gòu)建支撐AI發(fā)展的新型基礎(chǔ)設(shè)施需立足系統(tǒng)性思維，突破單一芯片的物理邊界，構(gòu)建涵蓋計(jì)算架構(gòu)、存儲(chǔ)范式、互連技術(shù)到能效優(yōu)化的多維協(xié)同... （來(lái)源：新聞?lì)l道）

芯和半導(dǎo)體DAC 2025-6-24 11:04

實(shí)際案例說(shuō)明用基于FPGA的原型來(lái)測(cè)試、驗(yàn)證和確認(rèn)IP——如何做到魚(yú)與熊掌兼得？

實(shí)際案例說(shuō)明用基于FPGA的原型來(lái)測(cè)試、驗(yàn)證和確認(rèn)IP——如何做到魚(yú)與熊掌兼得？

作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計(jì)總監(jiān)本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用硅知識(shí)產(chǎn)權(quán)（IP）內(nèi)核來(lái)開(kāi)發(fā)ASIC原型項(xiàng)目時(shí)，必須認(rèn)真考慮的一些問(wèn)題。全文從介紹使用... （來(lái)源：新聞?lì)l道）

FPGA數(shù)字芯片設(shè)計(jì) 2024-10-28 15:45

高速 PCB 布線(xiàn)的信號(hào)完整性原則

本文要點(diǎn)• 高速 PCB 走線(xiàn)中的一些問(wèn)題包括時(shí)間延遲、反射、電磁干擾和串?dāng)_。• 高速走線(xiàn)的設(shè)計(jì)長(zhǎng)度所對(duì)應(yīng)的電路板的臨界上升時(shí)間短于信號(hào)的上升時(shí)間。• 遵循 3W 規(guī)則有助于減輕高速 PCB 中的串?dāng)_和干擾。在大多數(shù)電子電路中，都有一個(gè)控制器來(lái)控制輸出信號(hào)或維持電源電路的正常運(yùn)行。... （來(lái)源：技術(shù)文章頻道）

PCB布線(xiàn) 信號(hào)完整性 Cadence 2024-10-22 10:12

【測(cè)試案例分享】提高信號(hào)完整性的秘密武器：實(shí)時(shí)示波器測(cè)試TDR阻抗的全新方案

【測(cè)試案例分享】提高信號(hào)完整性的秘密武器：實(shí)時(shí)示波器測(cè)試TDR阻抗的全新方案

現(xiàn)代電路設(shè)計(jì)和信號(hào)傳輸無(wú)疑對(duì)工程師提出了越來(lái)越高的要求。隨著傳輸速率不斷攀升，信號(hào)完整性問(wèn)題成為了影響系統(tǒng)性能的關(guān)鍵因素。而要確保信號(hào)完整性，阻抗匹配是不可或缺的一部分。TDR（時(shí)域反射技術(shù)）是一種通過(guò)觀(guān)察傳輸線(xiàn)中反射信號(hào)來(lái)測(cè)量阻抗特性的技術(shù)。這種方法的優(yōu)勢(shì)在于能夠快速、準(zhǔn)確地檢測(cè)出... （來(lái)源：技術(shù)文章頻道）

示波器測(cè)試 TDR 2024-10-8 11:04

米爾RK3576核心板首現(xiàn)瑞芯微展臺(tái)！8核6T高算力賦能工業(yè)AI智能化

米爾RK3576核心板首現(xiàn)瑞芯微展臺(tái)！8核6T高算力賦能工業(yè)AI智能化

以“工業(yè)聚能新質(zhì)領(lǐng)航”為主題的2024年第二十四屆中國(guó)國(guó)際工業(yè)博覽會(huì)（以下簡(jiǎn)稱(chēng)“中國(guó)工博會(huì)”）在上海國(guó)家會(huì)展中心隆重舉行，吸引全球28個(gè)國(guó)家和地區(qū)2600家參展商齊聚。米爾電子作為瑞芯微的生態(tài)合作伙伴，攜新品-米爾基于瑞芯微RK3576核心板及開(kāi)發(fā)板（MYC-LR3576）首現(xiàn)瑞芯微展臺(tái)，賦能工業(yè)AI智能化... （來(lái)源：新品頻道）

米爾 RK3576 核心板 2024-9-27 09:35

首發(fā)新品，米爾STM32MP2核心板上市！高性能+多接口+邊緣算力

首發(fā)新品，米爾STM32MP2核心板上市！高性能+多接口+邊緣算力

米爾發(fā)布基于STM32MP257設(shè)計(jì)的嵌入式處理器模塊MYC-LD25X核心板及開(kāi)發(fā)板。核心板基于STM32MP2系列是意法半導(dǎo)體推出最新一代工業(yè)級(jí)64位微處理器，采用LGA 252 PIN設(shè)計(jì)，存儲(chǔ)配置1GB/2GB LPDDR4、8GB eMMC，具有豐富的通訊接口，適用于高端工業(yè)HMI、邊緣計(jì)算網(wǎng)關(guān)、新能源充電樁、儲(chǔ)能EMS系統(tǒng)、工業(yè)自動(dòng)化... （來(lái)源：新品頻道）

米爾 STM32MP2 核心板 2024-9-23 09:33

數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn)分享系列文章（第四部分）：將ASIC IP核移植到FPGA上——如何測(cè)試IP核的功能和考慮純電路以外的其他因素

數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn)分享系列文章（第四部分）：將ASIC IP核移植到FPGA上——如何測(cè)試IP核的功能和考慮純電路以外的其他因素

作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計(jì)總監(jiān)本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述了在FPGA上使用IP核來(lái)開(kāi)發(fā)ASIC原型項(xiàng)目時(shí)，必須認(rèn)真考慮的一些問(wèn)題。文章從介紹使用預(yù)先定制功能即I... （來(lái)源：技術(shù)文章頻道）

數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn) ASIC IP FPGA 2024-8-30 10:35

將ASIC IP核移植到FPGA上——如何確保性能與時(shí)序以完成充滿(mǎn)挑戰(zhàn)的任務(wù)！

將ASIC IP核移植到FPGA上——如何確保性能與時(shí)序以完成充滿(mǎn)挑戰(zhàn)的任務(wù)！

數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn)分享（第三部分）：將ASIC IP核移植到FPGA上——如何確保性能與時(shí)序以完成充滿(mǎn)挑戰(zhàn)的任務(wù)！作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計(jì)總監(jiān)本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)... （來(lái)源：技術(shù)文章頻道）

數(shù)字芯片設(shè)計(jì) ASIC IP FPGA 2024-8-26 11:52

PCB 設(shè)計(jì)指南如何改善信號(hào)完整性

PCB 設(shè)計(jì)指南是為電路設(shè)計(jì)工程師制定的基準(zhǔn)，旨在幫助他們滿(mǎn)足行業(yè)標(biāo)準(zhǔn)。遵循這些指南將確保更好的可制造性和強(qiáng)大的產(chǎn)品性能。設(shè)計(jì)指南旨在提高產(chǎn)品的可測(cè)試性和可制造性。它們提出了改善 PCB 信號(hào)完整性和電磁兼容性 (EMC) 的建議，從而提高產(chǎn)品的整體性能。本文將概述各種 PCB 設(shè)計(jì)指南，以提高 PCB ... （來(lái)源：技術(shù)文章頻道）

PCB 設(shè)計(jì)信號(hào)完整 2024-8-1 10:42

將ASIC IP核移植到FPGA上——更新概念并推動(dòng)改變以完成充滿(mǎn)挑戰(zhàn)的任務(wù)!

將ASIC IP核移植到FPGA上——更新概念并推動(dòng)改變以完成充滿(mǎn)挑戰(zhàn)的任務(wù)!

數(shù)字芯片設(shè)計(jì)驗(yàn)證經(jīng)驗(yàn)分享：將ASIC IP核移植到FPGA上——更新概念并推動(dòng)改變以完成充滿(mǎn)挑戰(zhàn)的任務(wù)! 作者：Philipp Jacobsohn，SmartDV首席應(yīng)用工程師Sunil Kumar，SmartDV FPGA設(shè)計(jì)總監(jiān)本系列文章從數(shù)字芯片設(shè)計(jì)項(xiàng)目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計(jì)和驗(yàn)證規(guī)劃進(jìn)行結(jié)合，詳細(xì)講述... （來(lái)源：技術(shù)文章頻道）

數(shù)字芯片設(shè)計(jì)ASIC IPFPGA 2024-8-1 10:20

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