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↓在全部中搜索到 72 條關(guān)于“IEEE754”的信息，用時:0.033 sec.

--BBS主題帖: 單精度浮點加法器的FPGA實現(xiàn)

[color=#333333][font=微軟雅黑, Tahoma,]圖像處理通常采用軟件或者數(shù)字信號處理器(DSP)實現(xiàn)。如果利用軟件實現(xiàn)，運行時會耗費較多的PC資源，而且算法越復(fù)雜時耗費的資源就越多，對于需要高速處理的情況不適用；而如果采用DSP實現(xiàn)，提高并行性的同時指令執(zhí)行速度必然會提高，較高的指令速度可能導(dǎo)致系統(tǒng)...
2015-09-24

--BBS主題帖: 基于FPGA的Kalman濾波器的設(shè)計（4）

由于資源的限制，濾波中的運算過程只能以有限的精度進行，但過低的精度容易引起濾波發(fā)散，同時為了兼顧A／D高達24 bit的分辨率精度，在IEEE754單精度浮點數(shù)格式的基礎(chǔ)上按照浮點表示的原則做了改造，將指數(shù)部分減少到6位，尾數(shù)增加到25位，25位尾數(shù)可以完全表示A／D輸出的24位采樣值，并削弱舍入誤差的...
2015-09-18

--BBS主題帖: 基于FPGA的Kalman濾波器的設(shè)計（3）

輸出有3種模式：同步、異步及掉電模式，異步模式與Kalman濾波器數(shù)據(jù)輸入接口連接比較方便。其時序如圖3所示。 [img=367,199]http://img.hc360.com/infoeap/201004/13/09/12711205371417138706169871.jpg[/img] 2．2 FPGA設(shè)計 FPGA的特點在于靈活，通用。如果資源夠用，可以實現(xiàn)各種數(shù)字組合，包括C...
2015-09-18

--BBS主題帖: 近遠場測量控制系統(tǒng)的研制

[font=微軟雅黑, Tahoma,]摘要：控制系統(tǒng)作為近遠場綜合測量系統(tǒng)的基礎(chǔ)，它的可靠性、穩(wěn)定性和準確性對整個微波暗室性能指標的實現(xiàn)起著舉足輕重的作用。本文論述了基于[url=link:PMAC|0]PMAC[/url]的近遠場測量數(shù)控系統(tǒng)的構(gòu)成，并對系統(tǒng)的工作原理、控制方法、軟件設(shè) 計、性能指標等進行了詳細討論。該...
2015-06-25

--BBS主題帖: 32位單精度浮點乘法器的FPGA實現(xiàn)

隨著計算機和信息技術(shù)的快速發(fā)展, 人們對微處理器的性能要求越來越高。乘法器完成一次乘法操作的周期基本上決定了微處理器的主頻, 因此高性能的乘法器是現(xiàn)代微處理器中的重要部件。本文介紹了32 位浮點陣列乘法器的設(shè)計, 采用了改進的Booth 編碼, 和Wallace樹結(jié)構(gòu), 在減少部分積的同時, 使系統(tǒng)具有高速...
2015-05-31

--BBS主題帖: ARM64移動處理器解惑

[b]“64位”[/b] 我們先來談?wù)劇?4位”這個術(shù)語及其含義。大家對于這個術(shù)語一直比較困惑，很大一部分原因在于，它沒有統(tǒng)一的、約定俗成的定義。然而，在大體上卻達成了一些共識，盡管這些共識并未為大眾所知。 “××位”CPU通常是指兩個部分的寬度：整數(shù)寄存器的寬度和指針的寬度。值得慶幸的是，在大...
2015-05-30

--BBS主題帖: 32位單精度浮點乘法器的FPGA實現(xiàn)

[font=微軟雅黑, Tahoma,] 采用[url=link:Verilog HDL|0]Verilog HDL[/url]語言, 在[url=link:FPGA|0]FPGA[/url]上實現(xiàn)了32位單精度浮點乘法器的設(shè)計, 通過采用改進型Booth編碼，和Wallace 樹結(jié)構(gòu), 提高了乘法器的速度。本文使用Altera Quartus II 4.1仿真軟件, 采用的器件是EPF10K100EQ 240 -1, 對...
2015-05-28

Altera FPGA在使用CNN算法的云數(shù)據(jù)中心可實現(xiàn)具有優(yōu)異每瓦性能的加速功能

Altera公司今天宣布，微軟采用Altera Arria® 10 FPGA (現(xiàn)場可編程門陣列)實現(xiàn)基于CNN (卷積神經(jīng)網(wǎng)絡(luò))算法的數(shù)據(jù)中心加速功能，其每瓦性能非常優(yōu)異。這些算法通常用于圖像分類、圖像識別，以及自然語言處理等。微軟研究人員在云技術(shù)上不斷取得進展，采用Arria 10開發(fā)套件和Arria 10 FPGA工程樣片，...
2015-03-02

--BBS主題帖: IEEE Floating Point Standard (IEEE754浮點數(shù)表示法標準)

[font=微軟雅黑,]浮點數(shù)與定點數(shù)表示法是我們在計算機中常用的表示方法所以必須要弄懂原理，特別是在FPGA里面，由于FPGA不能像在MCU一樣直接用乘除法。[/font] [font=微軟雅黑,]定點數(shù) 首先說一下簡單的定點數(shù)，定點數(shù)是克服整數(shù)表示法不能表示實數(shù)的缺陷，那么我們就可以通過將實數(shù)乘上一個分數(shù)來實...
2014-12-18

--BBS主題帖: IEEE754 浮點數(shù)格式

[attach]3591[/attach]
2008-02-28

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