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西門子發布 Tessent RTL Pro 強化可測試性設計能力

西門子數字化工業軟件近日推出 Tessent™ RTL Pro 創新軟件解決方案，旨在幫助集成電路 (IC) 設計團隊簡化和加速下一代設計的關鍵可測試性設計 (DFT) 任務。隨著 IC 設計規模不斷增大、復雜性持續增長，工程師需要在設計早期階段發現并解決可測試性問題，西門子的 Tessent 軟件可以在設計流程...
西門子Tessent RTL Pro 2023-10-19

亮相DAC！芯華章發布新一代高速仿真器GalaxSim Turbo 助力千億門超大規模芯片敏捷驗證

在一年一度的全球電子設計自動化盛會DAC 2023 上，面向來自世界各地的頂級EDA公司和芯片、系統廠商，國內領先的系統級驗證EDA解決方案提供商芯華章，隆重推出新一代高速仿真器GalaxSim Turbo，并以指數級的數字仿真加速優勢、千億門級的超大驗證容量，在DAC上收獲專業用戶的廣泛青睞。基于超大規模...
DAC芯華章高速仿真器GalaxSim Turbo 2023-07-12

合見工軟與華大九天攜手共建國產EDA數模混合信號設計與仿真解決方案

上海合見工業軟件集團有限公司（簡稱“合見工軟”）與北京華大九天科技股份有限公司（簡稱“華大九天”）聯合宣布，將攜手共建數模混合設計與仿真EDA聯合解決方案。基于合見工軟自主知識產權的商用級別高效數字驗證仿真解決方案UniVista Simulator（簡稱UVS），以及華大九天自主知識產權的高速高精度并...
合見工軟華大九天Vedanta 2023-06-26

Agile Analog在歐洲RISC－V峰會上推出首個完整的RISC－V模擬IP子系統

加快RISC-V物聯網應用的上市時間 RISC-V物聯網應用可定制的模擬IP公司Agile Analog在巴塞羅那舉行的歐洲RISC-V峰會（6月5日至9日）上推出了首個用于RISC-V應用的完整模擬IP子系統。最初的子系統包括典型的電池供電物聯網系統所需的所有模擬IP，包括電源管理單元（PMU）、睡眠管理單元（SMU）和數據...
Agile AnalogRISC－V峰會 2023-06-06

本土 EDA 新進展：芯華章正式發布四款擁有自主知識產權的數字驗證 EDA 產品

24日，EDA（集成電路設計工具）智能軟件和系統企業芯華章正式發布四款擁有自主知識產權的數字驗證 EDA 產品，以及統一底層框架的智 V 驗證平臺。芯華章表示，本次發布的平臺及產品，在實現多工具協同、降低 EDA 使用門檻的同時，提高芯片整體驗證效率。它們分別具備以下優勢：智 V 驗證平臺（Fus...
EDA芯華章 2021-11-25

新思科技推出業界首個完整HBM3 IP和驗證解決方案，加速多裸晶芯片設計

· DesignWare HBM3控制器、PHY和驗證IP能夠降低集成風險，極大提高了2.5D多裸晶芯片系統的內存性能 · 具有靈活配置選項的低延遲HBM3控制器可增強內存帶寬 · 在5納米工藝中...
新思科技 2021-10-22

集成電路高速發展，中國新興EDA如何乘風破浪？

從信息通訊、工業交通等傳統領域，到大數據、AI、自動駕駛、5G等熱點應用，芯片無處不在。在摩爾定律推動下，芯片設計愈加復雜，對上游EDA工具的依賴越來越高。美國Andrew.B.Kahng教授統計分析，如果不使用EDA工具，設計一顆28nm SoC大約需要77億美元，而借助EDA工具，這筆費用會下降至4000萬美元。這無...
EDA集成電路 2021-10-14

進一步降低RISC－V芯片的門檻，西部數據核心開源

近來，一個名為SweRVolf 項目亮相，這是一個完全開放的片上系統，也是Western Digital 的 RISC-V SweRV 內核的參考平臺。最近，它宣布了一個重要的新版本，承諾為那些希望進行實驗的人降低進入門檻。“Western Digital于 2018 年發布了第一個 SweRV 內核 EH1，”Qamcom 高級數字設計工程師兼自由和開源...
RISC－V芯片FPGA 2021-09-18

新思科技推出新一代交互式代碼開發平臺Euclide，提升設計和驗證效率

要點：交互式增量分析可及早發現設計錯誤正確構建代碼方式可確保Design Compiler和ZeBu的RTL兼容性實時檢查功能有助于避免驗證平臺錯誤帶來的損失并提高VCS性能與Verdi集成有助于實現無縫調試和代碼開發內置SystemVerilog/UVM兼容性檢查可確保整個驗證團隊...
新思科技 2021-03-23

新思科技推出業界首個CXL 2．0 VIP解決方案，實現SoC性能突破

新思科技（Synopsys, Inc., 納斯達克股票代碼：SNPS）近日宣布推出業界首個支持Compute Express Link™ (CXL™) 2.0的驗證IP （VIP），以實現數據密集型片上系統（SoC）的性能突破。CXL是新一代開放標準的互聯技術，可在CPU、加速器以及內存擴展設備之間建立高速的互聯生態系統，其中加...
新思科技 2020-12-18

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