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↓在全部中搜索到 190 條關于“SystemVerilog”的信息，用時:0.027 sec.

Mentor Graphics宣布推出旨在提升測試平臺效率的EZ-VIP包

俄勒岡州威爾遜維爾，2015 年 6 月 2 日 - Mentor Graphics公司（納斯達克代碼：MENT）今天宣布即時推出 EZ-VIP 效率包。該效率包面向使用 Questa® Verification IP （QVIP）的 ASIC 和 FPGA 驗證團隊，可將創建、實例化、配置和連接 QVIP 測試平臺的時間縮短 5 倍以上，從而顯著提高效率。這就意...
2015-11-06

基于VMM驗證方法學的MCU驗證環境

1 簡介隨著設計的復雜程度不斷增加，要求把更多的資源放到驗證上，不但要求驗證能夠覆蓋所有的功能，還希望能夠給出大量的異常情況來檢查DUT對應異常的處理狀態，這在傳統測試方法下往往是難以實現的。此外，設計不斷地重用，而驗證也希望能夠重用一樣的驗證模塊，這就催生了層次化的驗證方法。Synopsy...
2014-04-26

生產率提高1000倍，Mentor企業驗證平臺融合Questa和Veloce

Mentor Graphics公司近日發布了Mentor 企業驗證平臺(EVP)。該平臺將先進的驗證解決方案Questa、全球硬件仿真資源分配技術Veloce OS3和強大的調試環境Visualizer™融合在一起，形成一個全球范圍內可用的高性能資源數據中心。Mentor EVP的全球資源管理特性可以支持公司世界各地的項目團隊，最大程度...
2014-04-17

--BBS主題帖: Writing Testbenches using SystemVerilog

[attach]3954[/attach][attach]3955[/attach][attach]3956[/attach]
2008-04-07

--BBS主題帖: systemverilog仿真最佳支持軟件？

modelsim6.3 or questasim 6.3
2008-03-09

--BBS主題帖: SystemVerilog可綜合子集論文

[attach]3647[/attach]
2008-03-07

Cadence與Mentor推出開放式驗證方法學技術

Cadence設計系統公司與Mentor Graphics公司宣布"開放式驗證方法學（Open Verification Methodology ,OVM）即日上市，該技術最近剛剛被《電子設計》雜志評為2007年最佳EDA技術大獎。該技術根據標準的開放源代碼Apache 2.0 授權協議發布，其OVM源代碼、文件和使用用例都可以在http://www.ovmworld.o...
SystemVerilog方法學開放式驗證方法學技術 2008-01-15

CADENCE為Incisive Enterprise驗證產品添加全新技術

Cadence設計系統宣布為Cadence Incisive Enterprise驗證產品系列添加全新技術，讓工程師團隊能夠解決多模式手機、游戲機和HD-DVD播放器等產品越來越復雜的芯片設計問題。Incisive技術目前為新開發的開放型驗證方法學（OVM）提供支持，這是一種強大的全新面向方面生成引擎，也是Cadence事務型加速（TBA）...
Incisive Enterprise驗...SystemVerilog 2007-12-10

--BBS主題帖: 這里有沒有交流SystemC，SystemVerilog的？

如題
2006-06-16

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