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RISC－V 助力邊緣深度學(xué)習(xí)加速

RISC－V 助力邊緣深度學(xué)習(xí)加速

核心要點(diǎn)： AI 工作負(fù)載正超越傳統(tǒng)硬件能力，暴露出 CPU 甚至 GPU 在大規(guī)模處理深度學(xué)習(xí)任務(wù)時(shí)的局限性。都柏林大學(xué)學(xué)院的研究人員展示了一款裸機(jī) RISC-V 片上系統(tǒng)（SoC），其集成開源 NVIDIA 深度學(xué)習(xí)加速器（NVDLA），無需完整操作系統(tǒng)。該方案實(shí)現(xiàn)了更高的每瓦效率和更快的推理速度，適用... （來源：技術(shù)文章頻道）

RISCV 2025-9-29 09:42

利用定制DSP指令增強(qiáng)RISC－V RVV，推動(dòng)嵌入式應(yīng)用發(fā)展

利用定制DSP指令增強(qiáng)RISC－V RVV，推動(dòng)嵌入式應(yīng)用發(fā)展

By Revi Ofir, Product Manager, ARC Processor IP, Synopsys 引言人工智能、自動(dòng)駕駛汽車等技術(shù)正迅速發(fā)展，市場對(duì)定制可擴(kuò)展處理器的需求也隨之不斷攀升。RISC-V開放標(biāo)準(zhǔn)指令集架構(gòu)（ISA）以其模塊化設(shè)計(jì)和協(xié)作社區(qū)，引領(lǐng)了處理器設(shè)計(jì)新潮流，助力實(shí)現(xiàn)技術(shù)愿景。相應(yīng)的，機(jī)器組件、URL、... （來源：技術(shù)文章頻道）

DSP嵌入式應(yīng)用新思 2025-2-26 10:20

利用先進(jìn)形式驗(yàn)證工具來高效完成RISC－V處理器驗(yàn)證

利用先進(jìn)形式驗(yàn)證工具來高效完成RISC－V處理器驗(yàn)證

作者：Laurent Arditi, Paul Sargent, Thomas Aird職務(wù)：Codasip高級(jí)驗(yàn)證/形式驗(yàn)證工程師我們?cè)谏弦黄夹g(shù)白皮書《基于形式驗(yàn)證的高效RISC-V處理器驗(yàn)證方法》中，以Codasip L31這款用于微控制器應(yīng)用的32位中端嵌入式RISC-V處理器內(nèi)核為例，介紹了一個(gè)基于形式驗(yàn)證的、易于調(diào)動(dòng)的RISC-V處理器驗(yàn)證程序。... （來源：技術(shù)文章頻道）

先進(jìn)形式驗(yàn)證工具RISC－V處理器 2023-6-15 17:05

基于形式驗(yàn)證的高效 RISC－V 處理器驗(yàn)證方法

基于形式驗(yàn)證的高效 RISC－V 處理器驗(yàn)證方法

作者：Laurent Arditi, Paul Sargent, Thomas Aird職務(wù)：Codasip高級(jí)驗(yàn)證/形式驗(yàn)證工程師RISC-V的開放性允許定制和擴(kuò)展基于 RISC-V 內(nèi)核的架構(gòu)和微架構(gòu)，以滿足特定需求。這種對(duì)設(shè)計(jì)自由的渴望也正在將驗(yàn)證部分的職責(zé)轉(zhuǎn)移到不斷壯大的開發(fā)人員社群。然而，隨著越來越多的企業(yè)和開發(fā)人員轉(zhuǎn)型RISC-V，大家... （來源：技術(shù)文章頻道）

形式驗(yàn)證 RISC－V 處理器 2023-5-31 09:32

基于RISC－V加速器實(shí)現(xiàn)FPGA CNN異構(gòu)的控制方案

基于RISC－V加速器實(shí)現(xiàn)FPGA CNN異構(gòu)的控制方案

作者：吳海龍, 李金東, 陳翔，電子與信息工程學(xué)院，中山大學(xué)，中國摘要：現(xiàn)場可編程門陣列（FPGA）具有低功耗、高性能和靈活性的特點(diǎn)。FPGA神經(jīng)網(wǎng)絡(luò)加速的研究正在興起，但大多數(shù)研究都基于國外的FPGA器件。為了改善國內(nèi)FPGA的現(xiàn)狀，提出了一種新型的卷積神經(jīng)網(wǎng)絡(luò)加速器，用于配備輕量級(jí)RISC-V軟核的國... （來源：技術(shù)文章頻道）

RISC－V加速器 FPGA CNN 2022-11-22 10:12

為越來越多的定制RISC－V處理器簡化設(shè)計(jì)驗(yàn)證

為越來越多的定制RISC－V處理器簡化設(shè)計(jì)驗(yàn)證

作者：Brandon Lewis，Saumitra JagdaleRISC-V 被稱為開放標(biāo)準(zhǔn)指令集架構(gòu) （ISA），其基本指令已被凍結(jié)以最小化復(fù)雜性。但最近它添加了廣泛的自定義擴(kuò)展和增強(qiáng)功能，使其在構(gòu)建特定應(yīng)用系統(tǒng)的 SoC 設(shè)計(jì)人員中越來越受歡迎。這些架構(gòu)中采用的定制功能通常通過硬件/軟件協(xié)同設(shè)計(jì)策略得到增強(qiáng)，該策略優(yōu)化... （來源：技術(shù)文章頻道）

RISC－V處理器 SoC 總設(shè)計(jì) 2022-7-5 09:17

標(biāo)準(zhǔn)化開源處理器架構(gòu)

標(biāo)準(zhǔn)化開源處理器架構(gòu)

圖源：Shutterstock/wanpatsorn 我們是否經(jīng)常因?yàn)樾马?xiàng)目比以前的項(xiàng)目對(duì)功率和速度要求更高，而不得不學(xué)習(xí)新的處理器架構(gòu)和開發(fā)環(huán)境？經(jīng)驗(yàn)告訴我們，在新處理器中使用與我們熟悉的部件相似的部件至少可以減輕痛苦。但如果只學(xué)習(xí)一種新架構(gòu)就可以讓您在未來更快、更輕松地進(jìn)行設(shè)計(jì)，是不是很棒呢？得益于... （來源：技術(shù)文章頻道）

RISC－V 開源處理器 2022-5-19 10:37

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