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Cadence設(shè)計(jì)系統(tǒng)公司和中芯國(guó)際共同宣布，一個(gè)支持射頻設(shè)計(jì)方案的新的0.18微米SMIC CMOS射頻工藝設(shè)計(jì)工具包將正式投入使用。 新的0.18微米SMIC CMOS射頻工藝設(shè)計(jì)工具包(PDK)已成功通過(guò)驗(yàn)證，正式進(jìn)入中國(guó)射頻集成電路設(shè)計(jì)市場(chǎng)。其驗(yàn)證包括代表性設(shè)計(jì)IP的硅交互作用測(cè)試，如PLLs，集中于仿真結(jié)果和快速設(shè)... （來(lái)源：新品頻道）
射頻工藝設(shè)計(jì)工具包 2007-8-10 13:16
Cadence設(shè)計(jì)系統(tǒng)公司和中芯國(guó)際集成電路制造有限公司日前聯(lián)合宣布雙方共同合作發(fā)展了一項(xiàng)模擬混合信號(hào)(AMS)參考流程以滿足設(shè)計(jì)業(yè)者在消費(fèi)、網(wǎng)絡(luò)和無(wú)線通訊集成電路市場(chǎng)的設(shè)計(jì)需求。 模塊級(jí)參考流程基于中芯國(guó)際0.18微米多模、射頻工藝設(shè)計(jì)工具包與Cadence的Virtuoso客戶設(shè)計(jì)平臺(tái)和可制造性設(shè)計(jì)(DFM)技... （來(lái)源：新品頻道）
中芯國(guó)際Cadence混合信號(hào)參考流程 2006-5-7 10:11
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