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↓在全部中搜索到 6594 條關于“Altera”的信息，用時:0.037 sec.

--BBS主題帖: Xilinx與Altera的FPGA基本結構

[font=宋體]從[/font]1985[font=宋體]年[/font]Xilinx[font=宋體]公司推出第一片[/font]FPGA[font=宋體]到現在，[/font]FPGA[font=宋體]的使用已經有近[/font]30[font=宋體]年的歷史了。目前主流市場的[/font]FPGA[font=宋體]主要還是[/font]Xilinx[font=宋體]和[/font]Altera[font=宋體]兩大系列，下面...
2015-08-26

--BBS主題帖: Xilinx和Altera FPGA的基本邏輯單元對比

要比較Xilinx和Altera的FPGA，就要清楚兩個大廠FPGA的結構，由于各自利益，兩家的FPGA結構各不相同，參數也各不相同，但可以統一到[b]LUT(Look-Up-Table)[/b]查找表上。以Altera的CycloneII系列的EP2C35，以及Xilinx的Spartan-3E系列的XC3S500E為例。可以參考Datasheet。 [b]Cyclone II[/b] [b]Sp...
2015-08-14

--BBS主題帖: Altera FPGA的IOE DDR寄存器介紹

[b][size=15pt]概述[/size][/b] [b] [/b] 本文對Altera器件IOE的DDR功能進行簡單介紹，DDR寄存器可以在時鐘的上升沿和下降沿都采集或者發送數據，我們知道利用此特性FPGA可以實現DDR SDRAM、DDR2 SDRAM、RLDRAM II、QDR SRAM以及QDRII SRAM等存儲器控制，這里筆者不是要涉及這些特性，而是特別...
2015-07-29

--BBS主題帖: Altera FPGA自動分配引腳的方法

在Quartus環境下，自動分配引腳有三種方法： 1.使用tcl腳本的方法 (1) 生成tcl文件。project--->Generate Tcl File forproject... [url=http://photo.blog.sina.com.cn/showpic.html#blogid=69d693150100v5hl&url=http://s3.sinaimg.cn/orignal/69d69315xa8439592c4e2][img]http://s3.sinaim...
2015-07-29

--BBS主題帖: Xilinx和Altera FPGA的基本邏輯單元對比

要比較Xilinx和Altera的FPGA，就要清楚兩個大廠FPGA的結構，由于各自利益，兩家的FPGA結構各不相同，參數也各不相同，但可以統一到[b]LUT(Look-Up-Table)[/b]查找表上。以Altera的CycloneII系列的EP2C35，以及Xilinx的Spartan-3E系列的XC3S500E為例。可以參考Datasheet。 [b]Cyclone II[/b] [b]...
2015-07-28

--BBS主題帖: Xilinx Altera FPGA中的邏輯資源（Slices VS LE)比較

前言經常有朋友會問我，“我這個方案是用A家的FPGA還是X家的FPGA呢？他們的容量夠不夠呢？他們的容量怎么比較呢？”當然，在大部分時候，我在給客戶做設計的時候，直接會用到最高容量的產品，因為我們的產品對成本不敏感。不過，在此還是比較一下兩家的產品，簡單寫寫一些自己的想法，供大家參考，如有...
2015-07-28

--BBS主題帖: Altera CPLD器件的配置與下載

一、配置方式　　ALTERA CPLD器件的配置方式主要分為兩大類：主動配置方式和被動方式。主動配置方式由CPLD器件引導配置操作過程，它控制著外部存儲器和初始化過程；而被動配置方式由外部計算機或控制器控制配置過程。根據數據線的多少又可以將CPLD器件配置方式分為并行配置和串行配置兩類。經過不同...
2015-07-21

--BBS主題帖: Altera CPLD器件的配置與下載

一、配置方式　　ALTERA CPLD器件的配置方式主要分為兩大類：主動配置方式和被動方式。主動配置方式由CPLD器件引導配置操作過程，它控制著外部存儲器和初始化過程；而被動配置方式由外部計算機或控制器控制配置過程。根據數據線的多少又可以將CPLD器件配置方式分為并行配置和串行配置兩類。經過不同...
2015-06-30

Altera Quartus II軟件v13.1 編譯時間可縮短70%

Altera公司今天宣布發布Quartus® II軟件13.1版，通過大幅度優化算法以及增強并行處理，與前一版本相比，編譯時間平均縮短了30%，最大達到70%，進一步擴展了在軟件效能方面的業界領先優勢。軟件還包括最新的快速重新編譯特性，適用于客戶對Altera Stratix® V FPGA設計進行少量源代碼改動的情形...
2013-11-06

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