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應(yīng)用開發(fā)

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↓在全部中搜索到 97 條關(guān)于“MRP”的信息，用時(shí):0.041 sec.

--BBS主題帖: FPGA開發(fā)與學(xué)習(xí)連載3：Xilinx ISE所涉及的一些命令以及Command Line的使用

[font=微軟雅黑,]所有的Commandline都可以在ISE的help->User Manuals里查到，在User Manuals中 XST User Guide -------關(guān)于XST的命令單獨(dú)在這個(gè)文檔里； Command line tools user guide ---------ngdbuild、PAR、map、trce、bitgen等其他的都在這里[/font] [font=微軟雅黑,]下面都是轉(zhuǎn)帖：因?yàn)槟壳?..
2014-11-24

--BBS主題帖: 【轉(zhuǎn)載】Spartan6開發(fā)中bufpll mapping error ‘連載――我與FPGA活動(dòng)’

[font=微軟雅黑,]文章出處[url]http://xilinx.eefocus.com/yq000cn/blog/10-09/195572_7cc10.html[/url] 最近閱覽博客時(shí)發(fā)現(xiàn)有一篇可以舉一反三的文章，轉(zhuǎn)來(lái)與大家共分享。[/font] [font=微軟雅黑,]《Spartan6開發(fā)中bufpll mapping error 》最近在做Spartan6上的視頻輸出，輸出的接口是HDMI接口，要...
2014-11-23

--BBS主題帖: 在用Spartan6生成的Clock時(shí)在maping遇到的問(wèn)題

[font=微軟雅黑,]最近在做Spartan6上的視頻輸出，輸出的接口是HDMI接口，要求格式是720P。[/font] [font=微軟雅黑,]系統(tǒng)的時(shí)鐘主要有[/font] [font=微軟雅黑,]1. 750M（TMDS輸出的IO輸出時(shí)鐘，必須接bufpll） 2. 75M（720P的像素時(shí)鐘） 3. 150M 4. 100M （系統(tǒng)時(shí)鐘） 5. 24M （外圍設(shè)備需要的時(shí)鐘...
2014-11-20

--BBS主題帖: ISE中FPGA的實(shí)現(xiàn)流程

[color=#2e2e2e][font=微軟雅黑,]原文鏈接：[/font][/color][url=http://blog.163.com/fpga_ip/blog/static/20444302420124167334668/]http://blog.163.com/fpga_ip/blog/static/20444302420124167334668/[/url][font=微軟雅黑,]一.ISE實(shí)現(xiàn)的步驟[/font][color=#2e2e2e][font=微軟雅黑,] 在綜合...
2014-09-26

--BBS主題帖: Xilinx ISE所涉及的一些命令以及Command Line的使用

[font=微軟雅黑,]1.Command的介紹[/font][color=#2e2e2e][font=微軟雅黑,]要完成一次完整的Xilinx FPGA編譯過(guò)程，涉及到的Command包括了：XST：全稱為Xilinx Synthesis Technology，這是Xilinx ISE里面附帶的一個(gè)免費(fèi)的綜合工具。（呵呵，Synplify Pro的購(gòu)買正在商洽之中）Synthesis完畢后，你可以用任...
2014-09-26

--BBS主題帖: 嵌入式數(shù)控系統(tǒng)通信功能的實(shí)現(xiàn)（3）

2.2　車間級(jí)工業(yè)以太網(wǎng)絡(luò)的通信車間級(jí)工業(yè)以太網(wǎng)絡(luò)的通信的關(guān)鍵技術(shù)是以太網(wǎng)底層協(xié)議的實(shí)現(xiàn)。由于S3C44B0芯片內(nèi)部沒(méi)有集成TCP/IP協(xié)議模塊，因此需要外接網(wǎng)絡(luò)協(xié)議芯片。嵌入式數(shù)控系統(tǒng)的網(wǎng)口部分采用了10M以太網(wǎng)接口芯片RTL8019AS、RJ45網(wǎng)絡(luò)插座和網(wǎng)絡(luò)變壓器，降低了干擾。以太網(wǎng)接口模塊與PC機(jī)中使...
2014-08-29

--BBS主題帖: xilinx文件后綴說(shuō)明

[table=98%][tr][td]*.bit[/td][td]下載配置文件。[/td][/tr][tr][td]*.bld[/td][td]報(bào)告文件。[/td][/tr][tr][td]*.edn[/td][td]綜合后生成的網(wǎng)表文件。[/td][/tr][tr][td]*.dly[/td][td]異步延時(shí)報(bào)告對(duì)于最壞的20個(gè)路徑。[/td][/tr][tr][td]*.fdo[/td][td]自動(dòng)創(chuàng)建的仿真宏文件。[/td][/tr][tr][td]*...
2014-06-16

--BBS主題帖: 利用FPGA 平臺(tái)構(gòu)建汽車駕駛輔助系統(tǒng)算法

汽車駕駛輔助系統(tǒng)這一新興市場(chǎng)需要高性能數(shù)字信號(hào)處理技術(shù)，同時(shí)還要降低器件成本，這樣才能滿足大規(guī)模應(yīng)用的需求。賽靈思 FPGA 器件提供了適當(dāng)?shù)钠脚_(tái)，能夠滿足上述這對(duì)互相矛盾的要求。即便是不熟悉 FPGA 實(shí)施方法的算法設(shè)計(jì)人員也不必?fù)?dān)心從PC 算法模型轉(zhuǎn)向 FPGA 硬件原型設(shè)計(jì)時(shí)的復(fù)雜性。賽靈思推...
2014-03-23

--BBS主題帖: 利用FPGA 平臺(tái)構(gòu)建汽車駕駛輔助系統(tǒng)算法

作者：Daniele Bagni，賽靈思公司 DSP 專家聯(lián)系方式： [email=daniele.bagni@xilinx.com][color=#086782]daniele.bagni@xilinx.com[/color][/email] Roberto Marzotto，Embedded Vision Systems (eVS) S.r.l.設(shè)計(jì)工程師聯(lián)系方式： [email=roberto.marzotto@evsys.net][color=#086782]roberto.marzot...
2014-03-12

MTK串號(hào)修改(IMEI修改)相關(guān)軟件及教程（PC端）(20120115更新)_手機(jī)綜合論壇_太平洋電

本壓縮包內(nèi)包含了一些常見的MTK手機(jī)修改串號(hào)的軟件和驅(qū)動(dòng)程序（有什么用？有機(jī)卡綁定機(jī)卡分離后不能送話費(fèi)的用得上......注意要低調(diào),每個(gè)人、所有人、沒(méi)有人-處事之道-雜文-好心情原創(chuàng)文學(xué)...）。某一軟件并不是支持所有MTK手機(jī)，如果一款不行，就試試另一種。這些軟件是為了修改我自己的一臺(tái)深圳產(chǎn)長(zhǎng)江...
2013-06-28

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