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--BBS主題帖: 基于狀態機和流水線技術的3DES加密算法及其FPGA設計

[color=#333333][font=微軟雅黑, Tahoma,] 隨著網絡的快速發展，信息安全越來越引起人們的關注。加密技術作為信息安全的利器，正發揮著重大的作用。通過在硬件設備（如由器、交換機等）中添加解密功能，可使存儲和傳輸的數據具有較高的安全性。傳統的加密工作是通過在主機上運行加密軟件實現的。這種...
2015-08-19

--BBS主題帖: Linux內核任務延遲

[align=left]內核代碼（尤其是驅動程序）除了使用定時器或下半部機制以外還需要其他方法來推遲執行任務。這種推遲通常發生在等待硬件完成某些工作時，而且等待時間非常短。[/align][align=left] 內核提供了許多延遲方法處理各種延遲要求。不同的方法有不同的處理特點，有些是在延遲任務時掛起處理器，...
2015-08-18

--BBS主題帖: Verilog-FPGA矩陣乘法流水線結構

[align=center] [font=宋體][size=15pt]二維流水線結構矩陣乘法（[/size][/font][size=15pt]Array Multiplication[/size][font=宋體][size=15pt]）[/size][/font][/align] [align=left][align=left] [font=宋體]上一篇文中建立了矩陣乘法運算的數據路徑，從仿真結構中可以看出整個計算方案的可行性...
2015-07-28

--BBS主題帖: AXI總線學習

[align=left][size=3][u][color=#FFFFFF]AXI（Advanced eXtensibleInterface）是一種總協議，該協議是ARM公司提出的AMBA（Advanced Microcontroller BusArchitecture）3.0協議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內總線。它的地址/控制和數據相位是分離的，支持不對齊的數據傳輸，同...
2015-07-28

--BBS主題帖: FPGA總線的研究

如果設計中有多個模塊，每個模塊內部有許多寄存器或者存儲塊需要配置或者提供讀出那么實現方式有多種，主要如下：實現方式一：可以在模塊頂部將所有寄存器引出，提供統一的模塊進行配置和讀出。這種方式簡單是簡單，但是頂層連接工作量較大，并且如果配置個數較多，導致頂層中寄存器的數目也會較多。...
2015-07-28

--BBS主題帖: Linux系統引導過程

X86體系計算機系統的自舉（bootstrapping）過程起始于對CPU的RESET引腳的觸發。這個操作會把CPU的一些寄存器置為默認值，比如代碼段寄存器CS（code segment）被置為0xf000、指令指針寄存器（EIP）被置為0x0000fff0等，其它寄存器的初始值如下表（下表未列的其它寄存器值均為未定義）： [align=center]...
2015-07-27

--BBS主題帖: USB OTG規范的SRP和HNP協議

[size=18px]OTG[/size][size=18px]設備首先應該是符[/size][size=18px]合[/size][size=18px]USB2.0[/size][size=18px]規范的設備，此外它還具有以下特征[/size][size=18px][size=18px][size=18px][1][/size][/size][/size][size=18px]：[/size] 1. 有限的主機性能 2. 像外圍設備一樣能進行全速...
2015-07-21

--BBS主題帖: FPGA的FIR抽取濾波器設計

[font=微軟雅黑, Tahoma,]用FPGA實現抽取濾波器比較復雜，主要是因為在FPGA中缺乏實現乘法運算的有效結構，現在，FPGA中集成了硬件乘法器，使FPGA在數字信號處理方面有了長足的進步。本文介紹了一種采用Xilinx公司的XC2V1000實現FIR抽取濾波器的設計方法。[/font] [font=微軟雅黑, Tahoma,][b]具體實...
2015-07-16

--BBS主題帖: RMII模式以太網PHY芯片DP83848C的應用（2）

[b]2．3 TXD[1：0]——發送數據[/b]　　TXD[1：O]的變換相對于REF_CLK是同步的。TX_EN有效后，PHY以TXD[1：0]作為發送端。　　在10 Mbps模式下，由于REF_CLK的頻率是在10Mbps模式中數據速率的10倍。因此TXD[1：0]上的值必須在10個脈沖期間保持穩定，確保DP83848C能夠每隔10個周期進行采樣。發送時序如...
2015-07-09

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