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↓在全部中搜索到 2835 條關于“Cadence”的信息，用時:0.033 sec.

基于Cadence的高速PCB設計方案

基于Cadence的高速PCB設計方案 1 引言　　人們對于通信的要去總是朝著“快”的方向發展，要求信號的傳輸和處理的速度越來越快，相應的，高速PCB的應用也越來越廣。高速電路有兩個方面的含義：一是頻率高，通常認為數字電路的頻率達到或是超過45MHz至50MHz，而且工作在這個頻率之上的電...
2012-05-28

--BBS主題帖: SMIC推出基于CPF的CADENCE低功耗數字參考流程

SMIC宣布SMIC正推出一種基于通用功率格式（CPF）的90納米低功耗數字參考流程，以及兼容CPF的庫。SMIC還宣布其已經加盟Power Forward Initiative（PFI）。這種新流程使用了由SMIC開發的知識產權，并應用了Cadence設計系統公司 (NASDAQ: CDNS) 的低功耗解決方案，其設計特點是可提高生產力、管理設...
2007-10-24

--BBS主題帖: 求Cadence SPB15.2

求Cadence SPB15.2?哪能下載？
2007-10-17

--BBS主題帖: Cadence原理圖設計簡介

Cadence原理圖設計簡介，想下的趕快！ [align=right][color=#000066][此貼子已經被作者于2007-10-3 13:13:44編輯過][/color][/align]
2007-10-03

--BBS主題帖: 常見網上高手用cadence的skill開發一些東西，怎入門啊？

常見網上高手用cadence的skill開發一些東西，怎入門啊？
2007-09-29

--BBS主題帖: 請問有沒有Cadence Allegro PCB SI的教程

請問有沒有Cadence Allegro PCB SI的教程???
2007-09-04

--BBS主題帖: Cadence新“錦囊”減少了采用功能驗證方法學的風險和時間

Cadence設計系統公司發布了面向無線和消費電子系統級芯片（SoC）設計的業界最全面的商用的驗證錦囊，幫助工程師們采用先進的驗證技術，減少風險和應用難度，以滿足上市時間要求。 Cadence® SoC功能驗證錦囊提供了一種經過驗證的端到端方法學，它從模塊級驗證延伸至芯片和系統級高級驗證，并包含用于...
2007-08-28

--BBS主題帖: CADENCE與MENTOR通過SYSTEMVERILOG驗證方法學實現協作

Cadence設計系統公司與Mentor Graphics宣布他們將會讓一種基于IEEE Std. 1800-2005 SystemVerilog標準的驗證方法學標準化。開放式驗證方法學（Open Verification Methodology, OVM）將會面向設計師和驗證工程師帶來一種不受工具約束的解決方案，促進數據的可移植性和可互用性。它實現了SystemVerilog的...
2007-08-17

--BBS主題帖: 【推薦】allegro(cadence)_EDA工具手冊

[i=s] 本帖最后由 wanghanq 于 2009-9-13 23:49 編輯 [/i] [align=left] [color=blue]論壇界面改版，對原帖內容做了修正[修正后不足：因上傳尺寸受限，附件數量大增][/color][/align] [align=left]內容簡介（PDF檔）：共589頁注冊登陸后就可下載[/align][align=left]（國內大型企業）[/align][alig...
2007-08-14

--BBS主題帖: Cadence與中芯國際推出射頻工藝設計工具包

Cadence設計系統公司和中芯國際共同宣布，一個支持射頻設計方案的新的0.18微米SMIC CMOS射頻工藝設計工具包將正式投入使用。新的0.18微米SMIC CMOS射頻工藝設計工具包(PDK)已成功通過驗證，正式進入中國射頻集成電路設計市場。其驗證包括代表性設計IP的硅交互作用測試，如PLLs，集中于仿真結果和快速設...
2007-08-10

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