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應(yīng)用開發(fā)

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↓在全部中搜索到 963 條關(guān)于“Spartan-6”的信息，用時(shí):0.051 sec.

--BBS主題帖: 如何加快處理器的正弦計(jì)算

有很多種算法可對單精度浮點(diǎn)數(shù)字的正弦值進(jìn)行計(jì)算，但添加硬件加速器是功能最為強(qiáng)大的方法之一。之所以得出這一結(jié)論，是因?yàn)榭蛻舻膽?yīng)用要求使用此類正弦計(jì)算，而我們又針對能夠提供良好、快速且高效的解決方案進(jìn)行了多種方案的探索。為了確定哪種實(shí)現(xiàn)方式最適合您的應(yīng)用，首先需要對代碼進(jìn)行分析，以...
2014-03-01

--BBS主題帖: 賽靈思Spartan6 SP601開發(fā)板初體驗(yàn)

[font=微軟雅黑,]前不久參加創(chuàng)新網(wǎng)舉辦的“安富利杯”賽靈思FPGA設(shè)計(jì)技巧與應(yīng)用創(chuàng)新博文大賽，有幸贏取了SP601開發(fā)套件。最近一直忙于其他事務(wù)，所以沒來得及詳細(xì)敘述一下使用的體驗(yàn)。今天開始補(bǔ)充一下。[/font] [font=微軟雅黑,]首先貼一下此板子最精簡的概況：Spartan-6 FPGA SP601 評估套件是評估 ...
2014-02-27

--BBS主題帖: 如何在賽靈思FPGA設(shè)計(jì)中保留可重復(fù)結(jié)果

滿足設(shè)計(jì)的時(shí)序要求本身已非易事，而要實(shí)現(xiàn)某項(xiàng)設(shè)計(jì)的整體時(shí)序具有完全可重復(fù)性有時(shí)候卻是不可能的任務(wù)。幸運(yùn)的是，設(shè)計(jì)人員可以借助有助于實(shí)現(xiàn)可重復(fù)時(shí)序結(jié)果的設(shè)計(jì)流程概念。影響最大的四個(gè)方面分別是 HDL 設(shè)計(jì)實(shí)踐、綜合優(yōu)化、平面布局和實(shí)施方案。就獲得可重復(fù)結(jié)果而言，資源利用和頻率要求...
2014-02-23

--BBS主題帖: Xilinx FPGA嵌入式開發(fā)（一）—EDK及SDK部分術(shù)語

1.1 EDK及SDK部分術(shù)語EDK：Embedded Processor Development Kit，嵌入式處理器開發(fā)包。 XPS：Xilinx Platform Studio，平臺工作室。用于嵌入式處理器硬件部分的開發(fā)。 SDK：Software Development Kit，軟件開發(fā)套件。基于Eclipse平臺，支持C/C++。 MicroBlaze總線：MB實(shí)質(zhì)上是一個(gè)IP核，這個(gè)IP核對外...
2014-02-22

--BBS主題帖: Xilinx spartan6 ODDR2的用法！

最近要用spartan6這個(gè)器件，聽說比較高端。郁悶的是原來spartan3能放下的程序，spartan6不能放下，邏輯資源不夠。重頭一點(diǎn)一點(diǎn)的堆砌吧，在搞PLL的時(shí)候，又遇到PLL倍頻輸出的時(shí)鐘不能直接連接到普通IO的問題。要命的是，板子上的DSP需要FPGA給出主時(shí)鐘才能運(yùn)行，硬件這樣做好了，DSP要能工作，時(shí)鐘必須...
2014-02-19

--BBS主題帖: 在賽靈思FPGA設(shè)計(jì)中保留可重復(fù)結(jié)果

[b]關(guān)鍵字：[url=http://www.ednchina.com/SEARCH/ART/%C8%FC%C1%E9%CB%BC.HTM]賽靈思[/url] [url=http://www.ednchina.com/SEARCH/ART/FPGA.HTM]FPGA[/url] [url=http://www.ednchina.com/SEARCH/ART/Spartan.HTM]Spartan[/url] [url=http://www.ednchina.com/SEARCH/ART/SmartGuide.HTM]SmartG...
2014-02-18

--BBS主題帖: 統(tǒng)一架構(gòu)的賽靈思7系列28nm產(chǎn)品推動(dòng)FPGA向ASIC/ASSP應(yīng)用市場擴(kuò)展

[align=center]作者：Nicole Chen[/align] FPGA從1984年推出發(fā)展至今，在與ASIC/ASSP器件爭奪市場的競爭中，功耗成為FPGA向 ASIC和ASSP的新應(yīng)用和新市場擴(kuò)展的關(guān)鍵制約因素。目前FPGA的市場規(guī)模約為35億美元，而ASIC/ASSP市場規(guī)模達(dá)到200億美元，為了拓展新的應(yīng)用領(lǐng)域，F(xiàn)PGA需要更低的功耗，更大的容量...
2014-01-26

--BBS主題帖: 賽靈思 Artix-7、Kintex-7 及 Virtex-7 FPGA 系列常見問題解答

[align=center][b]賽靈思基于業(yè)界首款統(tǒng)一可擴(kuò)展架構(gòu)的 7 系列 FPGA [/b][/align][align=center][align=center][b]將功耗銳減 50%，容量高達(dá) 200 萬個(gè)邏輯單元[/b][/align][/align][align=left][font=Arial][size=12pt][/size][/font][/align][u][b][size=3][font=宋體]一般問題[/font][font=Arial][/f...
2014-01-26

--BBS主題帖: 賽靈思 7 系列 FPGA 品牌

[size=3][font=宋體]為了提升用戶的生產(chǎn)率，賽靈思在開發(fā)新一代[/font][font=Arial] FPGA [/font][font=宋體]平臺時(shí)進(jìn)行了一系列創(chuàng)新，其中包括采用[/font][font=Arial] 28nm [/font][font=宋體]高性能、低功耗工藝、創(chuàng)建統(tǒng)一可擴(kuò)展架構(gòu)、并改進(jìn)工具和[/font][font=Arial] IP [/font][font=宋體]等。為...
2014-01-24

--BBS主題帖: Xilinx FPGA的快速啟動(dòng)

[font=微軟雅黑,]作者: Joachim Meyer 博士生卡爾斯魯厄技術(shù)研究所 [email=joachim.meyer@kit.edu]joachim.meyer@kit.edu[/email] Juanjo Noguera 高級研究工程師 Xilinx公司 [email=juanjo.noguera@xilinx.com]juanjo.noguera@xilinx.com[/email] Rodney Stewart 汽車系統(tǒng)架構(gòu)師 Xilinx公司 [email...
2014-01-23

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