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↓在全部中搜索到 1588 條關于“DCM??”的信息，用時:0.033 sec.

--BBS主題帖: FPGA開發全攻略連載之九：FPGA主要供應商與產品(3)

[font=微軟雅黑,]2.Virtex系列FPGA[/font] [font=微軟雅黑,]Virtex系列是賽靈思的高端產品，也是業界的頂級FPGA產品，賽靈思公司正是憑借Virtex系列產品贏得市場，從而獲得FPGA供應商領頭羊的地位。可以說賽靈思以其Virtex-5、Virtex-4、Virtex-2 Pro和Virtex-2系列FPGA產品引領現場可編程門陣列行業。...
2015-03-28

--BBS主題帖: FPGA開發全攻略連載之九：FPGA主要供應商與產品(2)

[font=微軟雅黑,](4)Spartan-3A/3ADSP/3AN系列[/font] [font=微軟雅黑,]Spartan-3A在Spartan-3和Spartan-3E平臺的基礎上，整合了各種創新特性幫助客戶極大地削減了系統總成本。利用獨特的器件DNA ID技術，實現業內首款FPGA電子序列號；提供了經濟、功能強大的機制來防止發生竄改、克隆和過度設計的現象...
2015-03-28

--BBS主題帖: FPGA開發全攻略連載之九：FPGA主要供應商與產品(1)

[font=微軟雅黑,]1984年，賽靈思發明了現場可編程門陣列(FPGA)，同時它成為全球首家無晶圓半導體公司的鼻祖，賽靈思通過不斷應用尖端技術來長久保持它的行業領袖地位：賽靈思是首家采用180nm、150nm、130nm、90nm和65nm工藝技術的企業，目前提供約占世界 90% 的高端 65nm FPGA產品。據 iSuppli 的統計...
2015-03-28

--BBS主題帖: FPGA開發全攻略連載之七：底層內嵌功能單元與軟核、硬核以及固核

[font=微軟雅黑,]6、底層內嵌功能單元內嵌功能模塊主要指DLL(Delay Locked Loop)、PLL(Phase Locked Loop)、DSP 等軟處理核(Soft Core)。現在越來越豐富的內嵌功能單元，使得單片FPGA 成為了系統級的設計工具，使其具備了軟硬件聯合設計的能力，逐步向SOC 平臺過渡。[/font] [font=微軟雅黑,]DLL 和...
2015-03-28

--BBS主題帖: FPGA開發全攻略連載之六：數字時鐘管理模塊與嵌入式塊RAM

[font=微軟雅黑,]3．數字時鐘管理模塊(DCM) 業內大多數FPGA 均提供數字時鐘管理( 賽靈思公司的全部FPGA 均具有這種特性)。賽靈思公司推出最先進的FPGA 提供數字時鐘管理和相位環路鎖定。相位環路鎖定能夠提供精確的時鐘綜合，且能夠降低抖動，并實現過濾功能。[/font] [font=微軟雅黑,]4．嵌入式塊RA...
2015-03-28

--BBS主題帖: Xilinx FPGA編程技巧之常用時序約束詳解

[font=微軟雅黑,]1. 基本的約束方法為了保證成功的設計，所有路徑的時序要求必須能夠讓執行工具獲取。最普遍的三種路徑為： . 輸入路徑（Input Path），使用輸入約束 . 寄存器到寄存器路徑（Register-to-Register Path），使用周期約束 . 輸出路徑（Output Path），使用輸出約束 . 具體的異常路徑...
2015-03-28

--BBS主題帖: FPGA編程技巧系列之輸入輸出偏移約束詳解

[font=微軟雅黑,]1. 偏移約束的作用　　偏移約束（Offset Constraint）用來定義一個外部時鐘引腳（Pad）和數據輸入輸出引腳之間的時序關系，這種時序關系也被稱為器件上的Pad-to-Setup或Clock-to-Out路徑。這些約束對與外部元器件相連的接口十分重要，在這里，需要解釋兩個術語：[/font] [font=微軟...
2015-03-28

--BBS主題帖: Spartan6系列之芯片時鐘資源深入詳解

[font=微軟雅黑,][img]http://xilinx.eetrend.com/files-eetrend-xilinx/blog/201409/7726-14229-_mg_1666.jpg[/img] 1. 時鐘資源概述　　時鐘設施提供了一系列的低電容、低抖動的互聯線，這些互聯線非常適合于傳輸高頻信號、最大量減小時鐘抖動。這些連線資源可以和DCM、PLL等實現連接。每一種Sp...
2015-03-28

--BBS主題帖: FPGA開發之引腳和區域約束語法

[font=微軟雅黑,]引腳和區域約束也就是LOC約束（location）。定義了模塊端口和FPGA上的引腳的對應關系。[/font] [font=微軟雅黑,]那么我們應該怎么寫呢？[/font] [font=微軟雅黑,]LOC有固定語法： INST “instance_name” LOC = location; #location可以是多個合法位置，用逗號隔開。這種多位置約束...
2015-03-28

--BBS主題帖: FPGA開發之時鐘管理模塊

[font=微軟雅黑,][img=600,338]http://xilinx.eetrend.com/files-eetrend-xilinx/imagecache/image600/blog/201501/8234-16196-t1vpvtxlxaxxxzhpz._110903.jpg[/img] Xilinx的FPGA中有兩個底層單元DCM和PLL構成了時鐘管理模塊（CMT）。 DCM（Digit Clock Manager）基于DLL，但是它消除了零時鐘偏...
2015-03-28

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