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--BBS主題帖: FPGA復位電路的實現及其時序分析

[b][font=宋體][size=15pt]概述[/size][/font][/b][b] [/b] [font=宋體][size=14px]大部分的[/size][/font][size=14px]FPGA[/size][font=宋體][size=14px]和[/size][/font][size=14px]ASIC[/size][font=宋體][size=14px]設計都是基于大量[/size][/font][size=14px]flip-flop[/size][font=宋體][s...
2015-08-30

--BBS主題帖: 超高頻RFID定位的相位式測距方法研究

[font=微軟雅黑, Tahoma,]射頻識別(Radio Frequcncy Identification，RFID)是一項非接觸式自動識別技術，具有能耗低、適應性強、操作快捷等許多優點。近年來，研究的重點轉向了超高頻段 (UHF，860～960 MHz)，已經有科研人員將提取射頻信號到達入射角或相位差作為RFID定位研究的新方向。低信噪比實測環...
2015-08-24

--BBS主題帖: FPGA實戰演練邏輯篇61：CMOS攝像頭接口時序設計1理想時序

[color=#7e7e7e][font=Arial,]2015年08月12日 12:08 [url=http://www.eechina.com/space-uid-97115.html]rousong1989[/url][/font][/color] [font=Arial,][table=98%][tr][td][align=left][url=http://www.eechina.com/keyword/CMOS]CMOS[/url]攝像頭接口時序設計1理想時序（特權同學版權所有）[/a...
2015-08-13

--BBS主題帖: FPGA靜態時序分析模型——寄存器到寄存器

1. 適用范圍　　本文檔理論適用于Actel FPGA并且采用Libero軟件進行靜態時序分析（寄存器到寄存器）。 2. 應用背景　　靜態時序分析簡稱STA，它是一種窮盡的分析方法，它按照同步電路設計的要求，根據電路網表的拓撲結構，計算并檢查電路中每一個DFF（觸發器）的建立和保持時間以及其他基于路徑的時延...
2015-07-29

--BBS主題帖: 讀SRAM時序約束分析（2）

[b]　建立時間：[/b]　　Data Arrival Time = Launch Edge + Clock Network Delay + Input Maximum Delay of Pin + Pin-to-Register Delay = 0+3.681ns+17.765ns+ Pin-to-Register Delay = 21.446ns + Pin-to-Register Delay 　　Data Required Time = Latch Edge + Clock Network Delay to Destinati...
2015-06-30

--BBS主題帖: FPGA編程技巧系列之輸入輸出偏移約束詳解

[font=微軟雅黑,]1. 偏移約束的作用　　偏移約束（Offset Constraint）用來定義一個外部時鐘引腳（Pad）和數據輸入輸出引腳之間的時序關系，這種時序關系也被稱為器件上的Pad-to-Setup或Clock-to-Out路徑。這些約束對與外部元器件相連的接口十分重要，在這里，需要解釋兩個術語：[/font] [font=微軟...
2015-03-28

--BBS主題帖: FPGA設計技巧之如何保證RTL設計與綜合后網表的一致性？

[font=微軟雅黑,]在超大規模數字集成電路的設計中，我們使用邏輯綜合工具來完成從RTL設計到門級網表的轉化。我們希望它綜合出的門級網表與我們的RTL設計在邏輯和時序上完全一致。但是某些書寫風格和設計思路卻會造成兩者不一致的情況，降低我們的工作效率。本文列舉了三種RTL設計與綜合后網表不一致的情...
2015-03-27

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