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應(yīng)用開發(fā)

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↓在全部中搜索到 1588 條關(guān)于“DCM??”的信息，用時(shí):0.040 sec.

--BBS主題帖: 井下照明電源的一種單級(jí)三相高頻隔離AC/DC變換器設(shè)計(jì)

[b]1 概述[/b] [font=Arial, Helvetica, sans-serif, 宋體][size=14.285715103149414px]自20世紀(jì)以來，我國煤礦井下開始大量使用127V照明電源及其綜合保護(hù)裝置。到目前為止，我國煤礦井下選擇的照明器材仍以傳統(tǒng)電源為主，都是將工頻變壓器、組合開關(guān)及綜合保護(hù)裝置組合在一起，裝在一個(gè)隔爆外殼中，為...
2014-12-02

--BBS主題帖: 原邊控制帶TRIAC調(diào)光的LED驅(qū)動(dòng)電源設(shè)計(jì)

[color=#333333][font=Arial, Helvetica, sans-serif, 宋體][size=14.285715103149414px]LED 由于其高亮度、節(jié)能和長壽命成為第四代照明光源。節(jié)能型LED 調(diào)光是目前應(yīng)用和研究的熱點(diǎn)之一。目前,LED 照明主要的調(diào)光方式有:模擬調(diào)光、脈寬調(diào)制(PWM)調(diào)光、[/size][/font][/color][url=http://www.ednchina...
2014-12-02

--BBS主題帖: 高速FPGA設(shè)計(jì)在時(shí)序約束方面的總結(jié)

[font=微軟雅黑,]高速FPGA設(shè)計(jì)在時(shí)序約束方面的總結(jié)[/font] [font=微軟雅黑,]FPGA中高頻率運(yùn)行的單元,如Serdes,這些單元的時(shí)序約束要經(jīng)過仔細(xì)設(shè)計(jì)。最近閱讀了Xilinx 應(yīng)用筆記：xapp485和xapp485，受到不少啟發(fā)。之前在做時(shí)序約束的時(shí)候有幾個(gè)因素都是沒有考慮到的。[/font] [font=微軟雅黑,]Tim...
2014-11-29

--BBS主題帖: 如何在設(shè)計(jì)階段考慮降低XILINX的功耗

[font=微軟雅黑,]如何在設(shè)計(jì)階段考慮降低XILINX的功耗最近Xilinx發(fā)布了不少關(guān)于使用serdes,ISERDES/OSERDES等基元設(shè)計(jì)一些很具創(chuàng)意性的接口。如XAPP1071 - Connecting Virtex-6 FPGAs to ADCs with Serial LVDS Interfaces and DACs with Parallel LVDS Interfaces。 XAPP486 - 7:1 Serialization...
2014-11-29

--BBS主題帖: FPGA設(shè)計(jì)中全局時(shí)鐘的運(yùn)用

[font=微軟雅黑,]FPGA的全局時(shí)鐘應(yīng)該是從晶振分出來的，最原始的頻率。其他需要的各種頻率都是在這個(gè)基礎(chǔ)上利用PLL或者其他分頻手段得到的；因?yàn)槿謺r(shí)鐘需要驅(qū)動(dòng)很多模塊，所以全局時(shí)鐘引腳需要有很大的驅(qū)動(dòng)能力，F(xiàn)PGA一般都有一些專門的引腳用于作為全局時(shí)鐘用，他們的驅(qū)動(dòng)能力比較強(qiáng)。但是如果這些引...
2014-11-29

--BBS主題帖: 帶有PFC的初級(jí)端調(diào)節(jié)反激式LED驅(qū)動(dòng)

[font=宋體, arial]消費(fèi)電子市場(chǎng)（特別是LED驅(qū)動(dòng)市場(chǎng)）最近幾年發(fā)展迅速。這些市場(chǎng)需要功耗低、尺寸小且成本超低的電源/驅(qū)動(dòng)。另外，由于對(duì)電能質(zhì)量要求不斷提高，在這些設(shè)備上使用功率因數(shù)校正（PFC）電路幾乎是必須的。今天，在多種不同電路中，反激因?yàn)楹唵味蔀閷?duì)這些應(yīng)用最具吸引力的拓?fù)洹Ｋ褂?..
2014-11-28

--BBS主題帖: 安森美半導(dǎo)體中高功率照明LED驅(qū)動(dòng)器方案

[font=宋體, arial]LED的諸多優(yōu)點(diǎn)已經(jīng)使其逐步取代白熾燈、熒光燈等傳統(tǒng)光源，在小功率應(yīng)用上越來越多地出現(xiàn)在我們?nèi)粘９ぷ魃钪校谖覀儌鹘y(tǒng)定義的20至400瓦的中高功率照明范圍內(nèi)，熒光燈、高強(qiáng)度氣體放電燈還是主流。但隨著大功率LED產(chǎn)品的不斷推陳出新，模塊化的LED燈條、大陣列LED等產(chǎn)品的出現(xiàn)，...
2014-11-28

--BBS主題帖: FPGA Editor的作用

[color=#2e2e2e][font=微軟雅黑,]、檢查布局布線結(jié)果——檢查DCM，BRAM，Slice，IOB等等的配置方式；查看布線方式，是不是走了全局布線通道等。[/font][/color] [color=#2e2e2e][font=微軟雅黑,]2、修改DCM, BRAM, Slice, IOB等的配置方式，比如修改DCM倍頻系數(shù)，Pin的輸出電壓標(biāo)準(zhǔn)等[/font][/color] ...
2014-11-28

--BBS主題帖: FPGA/CPLD設(shè)計(jì)小技巧之Verilog篇

[font=微軟雅黑,]這是一個(gè)在設(shè)計(jì)中常犯的錯(cuò)誤列表這些錯(cuò)誤常使得你的設(shè)計(jì)不可靠或速度較慢為了提高你的設(shè)計(jì)性能和提高速度的可靠性你必須確定你的設(shè)計(jì)通過所有的這些檢查。[/font] [font=微軟雅黑,]可靠性 **為時(shí)鐘信號(hào)選用全局時(shí)鐘緩沖器BUFG • 不選用全局時(shí)鐘緩沖器的時(shí)鐘將會(huì)引入偏差。[...
2014-11-24

--BBS主題帖: 賽靈思FPGA中LVDS差分高速傳輸?shù)膶?shí)現(xiàn)－－ZT

[font=微軟雅黑,]低壓差分傳送技術(shù)是基于低壓差分信號(hào)(Low Volt-agc Differential signaling)的傳送技術(shù)，從一個(gè)電路板系統(tǒng)內(nèi)的高速信號(hào)傳送到不同電路系統(tǒng)之間的快速數(shù)據(jù)傳送都可以應(yīng)用低壓差分傳送技術(shù)來實(shí)現(xiàn)，其應(yīng)用正變得越來越重要。低壓差分信號(hào)相對(duì)于單端的傳送具有較高的噪聲抑制功能，其較低的...
2014-11-23

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