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↓在全部中搜索到 1039 條關于“Zynq”的信息，用時:0.031 sec.

--BBS主題帖: Vivado高效設計案例分享大賽---8. PS與PL結合的硬件調試

[color=#2e2e2e][font=微軟雅黑,]前面我們提到了可以用例化ILA的IP核的辦法來調用ILA進行在線的邏輯分析，這個方法還是有點稍顯繁瑣。在PS與PL相結合的設計中，Vivado IP Integrator是它們溝通的核心，需要更加有效地利用集成化的設計環境進行硬件在線調試，所以我們再完整地體驗一下這個高效的設計過程...
2014-08-21

--BBS主題帖: Vivado高效設計案例分享大賽---9. 輕松創建自己的IP

[color=#2e2e2e][font=微軟雅黑,]在使用以前的設計工具進行開發時，如果我們想完全創建一個屬于自己的IP，是十分困難的。在Vivado以IP為中心的設計思想中，這些困難已經徹底不復存在了。今天我們就看一下如何創建一個屬于自己的IP。首先打開Vivado，選擇管理IP，如圖1所示；這一步其實也是創建了...
2014-08-21

--BBS主題帖: Vivado高效設計案例分享大賽---12. 說一說Vivado和ISE的關系

[font=微軟雅黑,]Vivado開發套件橫空出世已經兩年時間了，但是還有一些網友搞不太清楚Vivado和ISE的區別與聯系，所以我們今天簡要總結一下它們直接的關系。[/font] [font=微軟雅黑,]1. 已經有了強大的ISE套件，為什么還要Vivado? 因為28nm和之后更高級工藝的FPGA/AP SOC越來越復雜了，包括3D互...
2014-08-21

--BBS主題帖: Vivado高效設計案例分享大賽---13. 運行多個綜合策略

[color=#2e2e2e][font=微軟雅黑,]在使用以往版本的軟件例如ISE中的XST進行FPGA開發的時候，如果我們想改變綜合策略，哪怕是微調一個綜合工具中的參數，如果想獲取綜合結果，也要重新運行一下綜合，此時原來的結果就被覆蓋掉了，想比較一下也不方便。在Vivado開發環境中，引入了Design Runs這樣一個設計...
2014-08-21

--BBS主題帖: Vivado高效設計案例分享大賽---19 暨 MicroZed測評15-使用XADC

[color=#2e2e2e][font=微軟雅黑,]ZYNQ器件中帶的XADC在系統級別上進行了模擬和數字的混合集成，這樣就極大地簡化了我們的設計，因為模擬和數字的接口處理不好將成為系統性能的一個短板。MicroZed雖小，功能卻一一俱全，所以我們來用個簡單的例子，結合高效的Vivado軟件，在SOC中實現ADC信號的讀取。 ...
2014-08-20

--BBS主題帖: ZC702與ZedBoard開發板的比較（原創）

[color=#2e2e2e][font=微軟雅黑,]ZC702與ZedBoard開發板基本上是同期推出的XILINX ZYNQ開發板，前者官方售價為895美元，后者官方售價為395美元，雖然二者價格差別比較大，但在資源上卻有很多的相似性，下面就兩者做個簡單比較，以期讀者對這兩塊開發板有個清楚的認識，如有遺漏和不當之處還請大家補充指...
2014-08-20

--BBS主題帖: Vivado高效設計案例分享大賽---20..對比一段運算密集的算法

[color=#2e2e2e][font=微軟雅黑,] 為了測試一下Vivado的高效，今天用一段中壓變頻器里很復雜的消除諧波PWM算法進行測試，整個程序全部加起來不算回車和注釋大概有1800行Verilog HDL，主要的操作是大量的一次到三次的插值和一部分判斷語句，為了保證實現的實時性，必須以很高的計算頻率來實現，在DSP里實...
2014-08-20

--BBS主題帖: Xilinx FPGA普通IO作PLL時鐘輸入

[font=微軟雅黑,]在xilinx ZC7020的片子上做的實驗;[/font] [font=微軟雅黑,][結論][/font] [font=微軟雅黑,]普通IO不能直接作PLL的時鐘輸入,專用時鐘管腳可以;[/font] [font=微軟雅黑,]普通IO可以通過BUFG再連到PLL的時鐘輸入上,但要修改PLL的設置 input clk的選項中要選擇"No Buffer";[/font] [f...
2014-08-20

--BBS主題帖: ZED-Board從入門到精通（五）：軟硬件協同設計

[font=微軟雅黑,]Zynq最大的優勢在于，同時具備軟件、硬件、IO可編程，即All Programmable。在設計Zynq過程中，同樣要建立一種意識，就是從原來單純的軟件思維（或單純的硬件思維）中解脫，轉向軟硬件協同設計的開發方法。[/font] [font=微軟雅黑,]軟件設計，即基于ARM的軟件開發，我們第三節里面已經...
2014-08-20

--BBS主題帖: ZED-Board從入門到精通系列（六）——Vivado+OpenRISC

[font=微軟雅黑,]書接上文。由于更新了開發工具，所以本篇博客有必要重復前面的內容，今天首先演示如何利用Vivado開發純邏輯工程，即只在PL上進行開發。恰好最近在看雷思磊的《步步驚芯——軟核處理器內部設計分析》，于是將一部分實驗搬到了ZED-Board上進行驗證。對OpenRISC感興趣的童鞋可以關注Ril...
2014-08-20

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