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↓在全部中搜索到 1588 條關于“DCM??”的信息，用時:0.037 sec.

--BBS主題帖: FPGA全局時鐘的使用

[color=#333333][font=Arial, Helvetica, sans-serif, 宋體]在 Xilinx 系列 FPGA 產品中，全局時鐘網絡是一種全局布線資源，它可以保證時鐘信號到達各個目標邏輯單元的時延基本相同。其時鐘分配樹結構如圖1所示。[/font][/color] [font=Arial, Helvetica, sans-serif, 宋體]針對不同類型的器件，Xilin...
2014-10-30

--BBS主題帖: 10G以太網光接口的FPGA實現

[b]1 概述[/b] [font=Arial, Helvetica, sans-serif, 宋體]隨著人們對通信信息的充裕性、及時性和便捷性的要求越來越高，能夠隨時隨地、方便而及時地獲取所需信息，變得越來越重要。2002年，IEEE通過了10 Gb/s速率的[b]以太網[/b]標準——IEEE 802.3ae。10G以太網作為傳統以太網技術的一次較大的升級，...
2014-10-30

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載2：目錄

[color=#2e2e2e][font=微軟雅黑,]《Xilinx可編程邏輯器件設計與開發（基礎篇）》介紹了Xilinx主流FPGA的結構與特點、Xilinx FPGA的開發流程及其常用相關開發工具(包括IP核生成器、FPGA Editor、RTL/Architecture原理圖查看器、ChipScope、PlanAhead等工具)的應用，還介紹了業界使用最廣泛的仿真工具Mod...
2014-10-29

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載3：第2章Spartan-6系列FPGA

[color=#2e2e2e][font=微軟雅黑,]Spartan-6是第六代Spartan系列產品，專門針對成本和功率敏感的市場（如汽車娛樂、平板顯示以及視頻監控）。Spartan-6基于45nm技術、9層金屬布線、雙柵極氧化層工藝技術生產，在前幾代Spartan系列的結構基礎上，利用了成熟可靠的Virtex高端系列架構。它提供的資源包括：...
2014-10-29

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載7：Spartan-6的時鐘資源

[font=微軟雅黑,]2.1.2 時鐘資源[/font] [font=微軟雅黑,]時鐘布線資源具有高速、低SKEW的特點，它對系統設計非常重要，即使系統速率不高，也應該關注時鐘設計，以消除潛在的時鐘危險。Spartan-6器件包含16個全局時鐘資源和40個I/O區域時鐘資源。全局時鐘用于系統時鐘，而I/O區域時鐘專用于I/O串行/解...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載9：Spartan-6的I/O時鐘緩沖器

[font=微軟雅黑,]三、 I/O 時鐘緩沖器[/font] [font=微軟雅黑,]除了全局時鐘緩沖器外，Spartan-6還包含驅動高速I/O時鐘區域的時鐘緩沖器。 I/O 時鐘緩沖器的原語如表2-9所示。[/font] [img]http://xilinx.eetrend.com/files-eetrend-xilinx/blog/201106/1935-3473-tu_pian__1.png[/img] 表2-9 ...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載10：Spartan-6的時鐘網絡

[font=微軟雅黑,]四、時鐘網絡[/font] [font=微軟雅黑,]Spartan-6的時鐘布線網絡包括由BUFGMUX驅動的全局時鐘網絡和由I/O時鐘緩沖器（BUFIO2）、PLL時鐘緩沖器（BUFPLL）驅動的I/O區域時鐘網絡。[/font] [font=微軟雅黑,](1) 全局時鐘網絡。[/font] [font=微軟雅黑,]Spartan-6的全局時鐘網絡由16個...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載11：Spartan-6的時鐘管理器（CMT）

[font=微軟雅黑,]2.1.3 時鐘管理器（CMT）[/font] [font=微軟雅黑,]Spartan-6 CMT是一個靈活、高性能的時鐘管理模塊。它位于芯片中央、垂直的全局時鐘網絡旁。如圖2-17所示，它包含一個PLL和兩個DCM。[/font] [img]http://xilinx.eetrend.com/files-eetrend-xilinx/blog/201106/1941-3485-tu_pian_...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載12：Spartan-6的PLL

[font=微軟雅黑,]二、 PLL[/font] [font=微軟雅黑,]Spartan-6 器件最多包含6 個CMT，12 個PLL。PLL 的主要用途是作為頻率合成器，產生更寬范圍的頻率輸出，在與CMT 中的DCM 連接時，具有良好的濾波功能。[/font] [font=微軟雅黑,]圖2-20 所示為PLL 的功能框圖。[/font] [img]http://xilinx.eetren...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載22：混合模式時鐘管理器（MMCM）

[font=微軟雅黑,]5.1.3 混合模式時鐘管理器（MMCM）[/font] [font=微軟雅黑,]除了豐富的時鐘網絡以外，Xilinx還提供了強大的時鐘管理功能，提供更多更靈活的時鐘。Xilinx在時鐘管理上不斷改進，從Virtex-4的純數字管理單元DCM，發展到Virtex-5CMT（包含PLL），再到Virtex-6基于PLL的新型混合模式時鐘管...
2014-10-28

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