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↓在全部中搜索到 1648 條關于“PLD”的信息，用時:0.034 sec.

--BBS主題帖: 賽靈思PicoBlaze軟核介紹

PicoBlaze是由Xilinx公司的Ken Chapman設計并維護的一款8bit的微控制器軟核，可以嵌入到Cool Runner II、 Virtex-E，Virtex-II(Pro) 和 Spartan3(E)的CPLD以及FPGA中。首先說一下PicoBlaze這個名字。我們知道：Xilinx主推的32-bit RISC嵌入式軟核叫MicroBlaze，非官方有時也可寫成uBlaze，用來表示該軟...
2014-03-12

--BBS主題帖: 改進電路設計規程提高可測試性

[color=#333333][font=Tahoma, SimSun, Verdana, Arial]　隨著微型化程度不斷提高，元件和布線技術也取得巨大發展，例如BGA外殼封裝的高集成度的微型IC，以及導體之間的絕緣間距縮小到0.5mm，這些僅是其中的兩個例子。電子元件的布線設計方式，對以后制作流程中的測試能否很好進行，影響越來越大。下面...
2014-03-11

--BBS主題帖: Cypress CY8CKIT-001 PSoC3系列開發方案

[font=Arial,][size=12px]關鍵詞： [url=http://www.eechina.com/tag-CY8CKIT-001.html]CY8CKIT-001[/url] , [url=http://www.eechina.com/tag-Cypress.html]Cypress[/url] , [url=http://www.eechina.com/tag-PSoC3.html]PSoC3[/url][/size][/font] [font=Arial,][table=98%][tr][td][url=http://www...
2014-03-11

--BBS主題帖: FPGA基礎知識問答500問連載（二）-－"我與FPGA連載活動"

[b]Q16：FPGA設計中對時鐘的使用？（例如分頻等）[/b] FPGA芯片有固定的時鐘路由，這些路由能有減少時鐘抖動和偏差。需要對時鐘進行相位移動或變頻的時候，一般不允許對時鐘進行邏輯操作，這樣不僅會增加時鐘的偏差和抖動，還會使時鐘帶上毛刺。一般的處理方法是采用FPGA芯片自帶的時鐘管理器如PLL,DL...
2014-03-10

--BBS主題帖: 2012硬件工程師面試題（華為中興英飛凌等）

[font=Arial,]關鍵詞： [url=http://www.eechina.com/tag-%B9%A4%B3%CC%CA%A6%C3%E6%CA%D4%CC%E2.html]工程師面試題[/url] , [url=http://www.eechina.com/tag-%BB%AA%CE%AA.html]華為[/url] , [url=http://www.eechina.com/tag-%D3%A2%B7%C9%C1%E8.html]英飛凌[/url] , [url=http://www.eechina.com/t...
2014-03-09

--BBS主題帖: Cypress CY8C38 PSoC處理器開發方案

[table=98%][tr][td][url=http://www.eechina.com/keyword/Cypress]Cypress[/url]公司的P[url=http://www.eechina.com/keyword/SoC]SoC[/url] CY8C38系列提供了一種新型的信號采集,信號處理和控制方法,并具有高精度,高帶寬和高靈活性等特點,具有高性能的單周期 8051 微處理器內核,是一個高性能的可配置...
2014-03-08

--BBS主題帖: 組合邏輯設計中的毛刺現象

和所有的數字電路一樣，毛刺也是FPGA電路中的棘手問題，它的出現會影響電路工作的穩定性，可靠性，嚴重時會導致整個數字系統的誤動作和邏輯紊亂。信號在FPGA器件中通過邏輯單元連線時，一定存在延時。延時的大小不僅和連線的長短和邏輯單元的數目有關，而且也和器件的制造工藝、工作電壓、溫度等有關...
2014-03-08

--BBS主題帖: FPGA的時鐘

[align=left][font=Arial, Helvetica, sans-serif][size=14px]無淪是用離散邏輯、可編程邏輯，還是用全定制硅器件實現的任何數字設計，為了成功地操作，可靠的時鐘是非常關鍵的。設計不良的時鐘在極限的溫度、電壓或制造工藝的偏差情況下將導致錯誤的行為，并且調試困難、花銷很大。在設計PLD/FPGA時通...
2014-03-07

--BBS主題帖: FPGA設計原則與常用思想

[align=left][font=Arial, Helvetica, sans-serif][size=14px]FPGA/CPLD 的設計思想與技巧是一個非常大的話題，由于篇幅所限，本文僅介紹一些常用的設計思想與技巧，包括乒乓球操作、串并轉換、流水線操作和數據接口的同步方法。希望本文能引起工程師們的注意，如果能有意識地利用這些原則指導日后的設...
2014-03-07

--BBS主題帖: FPGA的基本知識

[align=left][font=Arial, Helvetica, sans-serif][size=14px][b]建立時間和保持時間[/b]　[/size][/font][/align] [align=left][font=Arial, Helvetica, sans-serif][size=14px][img]http://www.fpga.com.cn/advance/glitch/giltch1.jpg[/img][/size][/font][/align] [align=left][font=Arial, Helv...
2014-03-07

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