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↓在全部中搜索到 3789 條關(guān)于“FPGA+CPU”的信息，用時:0.049 sec.

--BBS主題帖: 基于FPGA的NAND Flash控制接口電路設(shè)計

[b]1 引言 [/b]隨著存儲技術(shù)的不斷進步，F(xiàn)lash Memory的存儲容量越來越大，讀寫數(shù)度越來越快。性能價格比越來越高。但是，NAND Flash本身存在缺點，歸納起來有兩點：讀寫控制時序復(fù)雜和位交換(o、1反轉(zhuǎn))問題。NAND Flash器件能夠復(fù)用指令、地址和數(shù)據(jù)總線，從而節(jié)省了引腳數(shù)量，但引腳不僅承擔著數(shù)據(jù)總...
2014-05-19

--BBS主題帖: 基于Xilinx FPGA的無線通信MAC層硬件平臺開發(fā)

本文中的 MAC 層硬件平臺應(yīng)用于國家863 計劃課題“Gbps 無線傳輸關(guān)鍵技術(shù)與試驗系統(tǒng)研究開發(fā)”。平臺的具體設(shè)計是基于該試驗系統(tǒng)的ATCA(Advanced Telecom Computing Architecture)信號匯聚板。 ATCA 信號匯聚板提供系統(tǒng)與業(yè)務(wù)源之間的網(wǎng)絡(luò)接口，并根據(jù)開發(fā)人員設(shè)計的MAC層協(xié)議對業(yè)務(wù)數(shù)據(jù)進行特定處理...
2014-05-19

--BBS主題帖: 基于Xilinx FPGA IP CORE的可調(diào)正弦信號發(fā)生器設(shè)計

直接數(shù)字式頻率合成( Direct Digit al Frequency Synt hesis, 簡稱DDS) 相對于直接頻率合成( DS) 和鎖相頻率合成(PLL) 等頻率合成方式具有頻率轉(zhuǎn)換時間短, 頻率,相位和幅度均可程序控制以及頻率分辨率高和穩(wěn)定度好、實現(xiàn)方便靈活等優(yōu)點。因此利用DDS 芯片或FPGA 進行設(shè)計, 可以簡化設(shè)計流程、提高設(shè)計效...
2014-05-19

--BBS主題帖: 基于雙FPGA的刀閘接口控制箱的設(shè)計

數(shù)字化變電站的核心思想是設(shè)備智能化、信息互動化、控制網(wǎng)絡(luò)化、功能一體化、狀態(tài)可視化，最終實現(xiàn)高可靠的堅強智能電網(wǎng)。數(shù)字化變電站與傳統(tǒng)變電站相比在間隔層和一次設(shè)備之間增加了一個強大的過程層業(yè)務(wù)單元，可以把現(xiàn)有一次設(shè)備接入數(shù)字化變電站。過程層主要設(shè)備為智能接口單元：包含斷路器操作箱和...
2014-05-19

--BBS主題帖: 基于FPGA的RFID無線通信系統(tǒng)的實現(xiàn)

隨著計算機技術(shù)的迅速發(fā)展，電子信息技術(shù)越來越快地普及到各行各業(yè)的應(yīng)用中去。傳統(tǒng)的物流信息采集工作方式是通過工作人員將票物進行核對，然后將票上的數(shù)據(jù)輸入到計算機中。這一過程費時費力，并且可能由于各種人為過失造成各種各樣錯誤數(shù)據(jù)的存在，影響所采集信息的可靠性。而自動識別技術(shù)利用計算機...
2014-05-19

--BBS主題帖: 基于Spartan-3 FPGA的視頻采集系統(tǒng)設(shè)計

視頻采集的主流實現(xiàn)方案有兩種：一是基于ASIC，該方案一般采用意法、AMD等公司的專用視頻處理芯片；二是基于DSP，主要采用TI、ADI等公司的DSP信號處理器。它們作為輔處理器，可在主CPU控制下進行視頻信號的采集壓縮。隨著FPGA的發(fā)展，通過SOPC技術(shù)實現(xiàn)視頻采集已成為一種易于開發(fā)、設(shè)計靈活的方案。而這...
2014-05-14

--BBS主題帖: 基于網(wǎng)口傳輸?shù)腖ED同步屏控制系統(tǒng)及其FPGA實現(xiàn)

LED全彩同步控制系統(tǒng)具有高性能實時顯示、節(jié)能、環(huán)保等優(yōu)點，成為現(xiàn)代信息發(fā)布的重要媒體。本設(shè)計改變傳統(tǒng)設(shè)計中采集顯卡VESA信號接口、使用并行多根總線傳送數(shù)據(jù)的方式，改用采集DVI接口、通過網(wǎng)口傳輸數(shù)據(jù)，既節(jié)省成本也提高了傳輸效率和傳輸質(zhì)量。另外，該設(shè)計還采用一系列新技術(shù)，例如使用高集成度...
2014-05-14

--BBS主題帖: 基于FPGA的μC/OS-II任務(wù)管理硬件設(shè)計

實時操作系統(tǒng)RTOS(Real Time Operating System)由于具有調(diào)度的實時性、響應(yīng)時間的可確定性、系統(tǒng)高度的可靠性等特點，被越來越多地應(yīng)用在嵌入式系統(tǒng)中，如：航空航天、工業(yè)控制、汽車電子和核電站建設(shè)等眾多領(lǐng)域。　　傳統(tǒng)上，RTOS內(nèi)核是加在應(yīng)用程序中的軟件，它不僅增加了ROM（代碼空間）和RAM（數(shù)據(jù)...
2014-05-14

--BBS主題帖: 基于FPGA實現(xiàn)的可復(fù)用通信接口設(shè)計

[b]1 引言[/b] 長期以來，外圍設(shè)備與主機CPU速度之間的不匹配始終困擾著人們，影響了計算機系統(tǒng)更迅速的發(fā)展，成為系統(tǒng)基本I/O的瓶頸問題。隨著計算機處理能力及存儲規(guī)模的迅速增長，這個問題表現(xiàn)得更加突出。為此人們采取了各種軟、硬件的方法，不斷地改善著CPU與I/O設(shè)備之間的接口性能。目前，嵌入...
2014-05-14

--BBS主題帖: 基于FPGA的NAND Flash控制接口電路設(shè)計

[b]1 引言 [/b]隨著存儲技術(shù)的不斷進步，F(xiàn)lash Memory的存儲容量越來越大，讀寫數(shù)度越來越快。性能價格比越來越高。但是，NAND Flash本身存在缺點，歸納起來有兩點：讀寫控制時序復(fù)雜和位交換(o、1反轉(zhuǎn))問題。NAND Flash器件能夠復(fù)用指令、地址和數(shù)據(jù)總線，從而節(jié)省了引腳數(shù)量，但引腳不僅承擔著數(shù)據(jù)總...
2014-05-14

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