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應(yīng)用開發(fā)

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↓在全部中搜索到 963 條關(guān)于“Spartan-6”的信息，用時(shí):0.051 sec.

--BBS主題帖: Xilinx FPGA配置電路

FPGA配置電路模式有主模式、從模式和JTAG模式。 [b]【1】主模式[/b] 在主模式下，F(xiàn)PGA上電后，自動(dòng)將配置數(shù)據(jù)從相應(yīng)的外存儲(chǔ)器讀入到SRAM中，實(shí)現(xiàn)內(nèi)部結(jié)構(gòu)映射。主模式根據(jù)比特流的位寬又可以分為：串行模式( 單比特流) 和并行模式( 字節(jié)寬度比特流) 兩大類。如：主串行模式、主SPI Flash 串行模式、...
2014-03-11

--BBS主題帖: 基于FPGA的以太網(wǎng)MAC子層協(xié)議設(shè)計(jì)實(shí)現(xiàn)

[font=Arial, Helvetica, sans-serif][size=14px]作者：徐洪波俞承芳來(lái)源:電子設(shè)計(jì)信息網(wǎng)[/size][/font] [font=Arial, Helvetica, sans-serif][size=14px]摘要: 本文介紹了基于[/size][/font][url=http://www.eaw.com.cn/news/listbylabel/label/%E7%8E%B0%E5%9C%BA%E5%8F%AF%E7%BC%96%E7%A8%...
2014-03-07

--BBS主題帖: FPGA開發(fā)全攻略連載之十三：FPGA實(shí)戰(zhàn)開發(fā)技巧（11）

[font=微軟雅黑,]5.5.4 從串配置模式[/font] [font=微軟雅黑,]在串行模式下，需要微處理器或微控制器等外部主機(jī)通過(guò)同步串行接口將配置數(shù)據(jù)串行寫入FPGA芯片，其模式選擇信號(hào)M[2:0]=3’b111。典型的Spartan 3E系列FPGA單片配置電路如圖5.5.11所示。DIN輸入管腳的串行配置數(shù)據(jù)需要在外部時(shí)鐘CCLK 信號(hào)前...
2014-03-04

--BBS主題帖: FPGA開發(fā)全攻略連載之九：FPGA主要供應(yīng)商與產(chǎn)品(1)

[font=微軟雅黑,]1984年，賽靈思發(fā)明了現(xiàn)場(chǎng)可編程門陣列(FPGA)，同時(shí)它成為全球首家無(wú)晶圓半導(dǎo)體公司的鼻祖，賽靈思通過(guò)不斷應(yīng)用尖端技術(shù)來(lái)長(zhǎng)久保持它的行業(yè)領(lǐng)袖地位：賽靈思是首家采用180nm、150nm、130nm、90nm和65nm工藝技術(shù)的企業(yè)，目前提供約占世界 90% 的高端 65nm FPGA產(chǎn)品。據(jù) iSuppli 的統(tǒng)計(jì)...
2014-03-04

--BBS主題帖: FPGA開發(fā)全攻略連載之八：從可編程器件發(fā)展看FPGA未來(lái)趨勢(shì)

[font=微軟雅黑,]2.1.4 從可編程器件發(fā)展看FPGA未來(lái)趨勢(shì)[/font] [font=微軟雅黑,]可編程邏輯器件的發(fā)展歷史可編程邏輯器件的發(fā)展可以劃分為4個(gè)階段，即從20世紀(jì)70年代初到70年代中為第1段，20世紀(jì)70年代中到80年代中為第2階段，20世紀(jì)80年代到90年代末為第3階段，20世紀(jì)90年代末到目前為第4階段。[/fo...
2014-03-04

--BBS主題帖: FPGA開發(fā)全攻略連載之四：FPGA基本知識(shí)與發(fā)展趨勢(shì)（part2）

[font=微軟雅黑,]由于基于LUT 的FPGA 具有很高的集成度，其器件密度從數(shù)萬(wàn)門到數(shù)千萬(wàn)門不等，可以完成極其復(fù)雜的時(shí)序與邏輯組合邏輯電路功能，所以適用于高速、高密度的高端數(shù)字邏輯電路設(shè)計(jì)領(lǐng)域。其組成部分主要有可編程輸入/ 輸出單元、基本可編程邏輯單元、內(nèi)嵌SRAM、豐富的布線資源、底層嵌入功能單...
2014-03-04

--BBS主題帖: 基于FPGA和LVDS技術(shù)的光纜傳輸技術(shù)

[b]1 引言[/b]　　某飛行器發(fā)射前，需測(cè)試飛行器各項(xiàng)參數(shù)，參數(shù)測(cè)試是通過(guò)數(shù)據(jù)記錄器記錄飛行器數(shù)據(jù)并傳至地面測(cè)試臺(tái)。測(cè)試過(guò)程中，為了保證測(cè)試人員人身安全，飛行器和地面測(cè)試臺(tái)間距需有300 m，兩者間采用長(zhǎng)線數(shù)據(jù)傳輸。現(xiàn)有的技術(shù)有：RS一485總線，在幾百米時(shí)，傳輸速度較低；CAN總線雖具有較高的可...
2014-03-01

--BBS主題帖: 用插值查找表實(shí)現(xiàn)FPGA的DSP功能

我們是否能夠提供一款其功能可滿足客戶所有獨(dú)特設(shè)計(jì)要求的DSP內(nèi)核。有時(shí)候內(nèi)核會(huì)太大，太小或者不夠快。有時(shí)，我們會(huì)開發(fā)一款能確切滿足客戶需求的內(nèi)核，并迅速以CORE GeneratorTM商標(biāo)推出。不過(guò)即便在這種情況下，客戶仍然想要一套特定的DSP功能，而且刻不容緩。在這些情況下，我常常建議他們使用我們...
2014-03-01

--BBS主題帖: 基于Xilinx FPGA的片上系統(tǒng)無(wú)線保密通信終端

[b]0 引言 [/b]　　利用軟件實(shí)施加密算法已經(jīng)成為實(shí)時(shí)安全通信系統(tǒng)的重要瓶頸。標(biāo)準(zhǔn)的商品化CPU和DSP無(wú)法跟上數(shù)據(jù)加密算法的計(jì)算速度要求。此外，CPU和DSP需要完成太多的其他任務(wù)。基于FPGA高度優(yōu)化的可編程的硬件安全性解決方案提供了并行處理能力，并且可以達(dá)到所要求的加密處理性能基準(zhǔn)[1].然而如...
2014-03-01

--BBS主題帖: 基于FPGA的VGA顯示控制器的設(shè)計(jì)

隨著CCD(電荷耦合器件)和CMOS(互補(bǔ)金屬氧化物半導(dǎo)體)圖像傳感器制造工藝的發(fā)展，圖像傳感器的分辨率越來(lái)越高，如果要實(shí)時(shí)顯示圖像傳感器采集到的圖像，則要求圖像處理芯片有較高的運(yùn)行速度，但由于需要處理的數(shù)據(jù)量太大，一般的數(shù)字信號(hào)處理器很難直接輸出分辨率為1024×768，幀頻為60 Hz的標(biāo)準(zhǔn)XGA信號(hào)。...
2014-03-01

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