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↓在全部中搜索到 2880 條關于“LVDS”的信息，用時:0.039 sec.

--BBS主題帖: 一款用于RF系統的堅固型10MHz基準時鐘輸入保護電路和分配器

[b]引言[/b] [font=Arial, Helvetica, sans-serif, 宋體]要為RF系統設計基準輸入電路證明是棘手的事情。難題之一是在滿足時鐘的保護、緩沖及分配要求的同時也要保持輸入時鐘的相位噪聲性能。本文將說明怎樣設計一款10MHz基準輸入電路并優化其性能。[/font] [font=Arial, Helvetica, sans-serif, 宋...
2014-09-04

--BBS主題帖: 使用JESD204B同步多個ADC

[color=#333333][font=Arial, Helvetica, sans-serif, 宋體]許多通信、儀器儀表和信號采集系統需要通過多個模數轉換器（ADC）對多個模擬輸入信號進行同時采樣。隨后，經過采樣得到的數據需被處理以實現各個通道的同步，然而他們各自有不同的時延。這一直以來都成為使用LVDS和并行輸出ADC的系統工程師所...
2014-09-04

--BBS主題帖: MicroZed測評1-初識MicroZed

[color=#2e2e2e][font=微軟雅黑,]Zynq™-7000 系列器件將處理器的軟件可編程能力與FPGA 的硬件可編程能力實現完美結合，以低功耗和低成本等系統優勢實現無以倫比的系統性能、靈活性、可擴展性，同時可以加速產品上市進程。為了方便大家的學習，安富利推出了199美元的Zynq-7000 AP SoC MicroZed 開...
2014-09-04

--BBS主題帖: 射頻采樣ADC的FPGA接口成功經驗

[color=#2e2e2e][font=微軟雅黑,]射頻采樣ADC的FPGA接口經歷做了一個3.2G采樣率ADC的FPGA接口。ADC通過FMC接到母板上的K7 410T芯片，LVDS電平標準。做了這個項目后，有些感觸。從FPGA角度來看，FPGA需要設計一個DDR模式、數據率為400M的接口，且由于信號線比較多，已經跨BANK(換句話說，信號比較多，...
2014-09-04

--BBS主題帖: 高密度可編程FIFO存儲器在視頻圖像中的應用

[font=宋體, arial]在這篇文章中，我們將首先介紹幾個視頻應用，了解其數據路徑及需要處理的數據性質。下一步，我們將盡力估計在[url=http://www.elecfans.com/video/shipinjishu/20110323191340.html][color=#000]視頻處理[/color][/url]通道中操作數據的復雜性。然后會介紹可編程高密度FIFO和其能力，...
2014-09-03

--BBS主題帖: RIoTboard Demo安裝和設置二

[font=Tahoma,]如果你按照我上一篇文章（[/font][url=http://bbs.eeworld.com.cn/bbs.eeworld.com.cn/thread-443082-1-1.html]bbs.eeworld.com.cn/thread-443082-1-1.html[/url][font=Tahoma,] ）的內容進行了安裝和設置，那你的RIoTboard上就已經有了一個安卓系統平臺，現在可以用這個平臺來做一些事情...
2014-08-29

--BBS主題帖: PCB設計常見問題解答（二）

31、請推薦一種適合于高速信號處理和傳輸的EDA軟件。常規的電路設計，INNOVEDA 的 PADS 就非常不錯，且有配合用的仿真軟件，而這類設計往往占據了70%的應用場合。在做高速電路設計，模擬和數字混合電路，采用Cadence的解決方案應該屬于性能價格比較好的軟件，當然Mentor的性能還是非常不錯的，特別是...
2014-08-29

便攜式數據采集系統中ADC的選用指南

關鍵字：模數轉換器 SPI ASIC ADC 真實世界的應用需要真實世界的物理連接，一般來說，這意味著模擬信號要在系統內的某處被數字化處理，以便于微處理器、ASIC或FPGA采集數據并做出決策。基本選用標準當選擇一款模擬數字轉換器(ADC)時，大多數設計師似乎只關注幾個主要標準。...
2013-07-22

嵌入式設計人員必須掌握的存儲技術

關鍵字：存儲技術層次結構 DRAM 嵌入式微控制器的存儲架構可能很簡單(圖1)。但是，隨著應用開始朝便攜化、虛擬化和個性化方向發展，它們現在變得相當復雜。多核(multicore)、許多核(many core)和集群架構，它們同樣在一個設備中融合了各種存儲技術。高端微處理器將多個緩...
2013-07-21

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