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應(yīng)用開發(fā)

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↓在全部中搜索到 1588 條關(guān)于“DCM??”的信息，用時:0.035 sec.

--BBS主題帖: FPGA開發(fā)全攻略連載之七：底層內(nèi)嵌功能單元與軟核、硬核以及固核

[font=微軟雅黑,]6、底層內(nèi)嵌功能單元內(nèi)嵌功能模塊主要指DLL(Delay Locked Loop)、PLL(Phase Locked Loop)、DSP 等軟處理核(Soft Core)。現(xiàn)在越來越豐富的內(nèi)嵌功能單元，使得單片F(xiàn)PGA 成為了系統(tǒng)級的設(shè)計工具，使其具備了軟硬件聯(lián)合設(shè)計的能力，逐步向SOC 平臺過渡。[/font] [font=微軟雅黑,]DLL 和...
2014-03-04

--BBS主題帖: FPGA開發(fā)全攻略連載之六：數(shù)字時鐘管理模塊與嵌入式塊RAM

[font=微軟雅黑,]3．數(shù)字時鐘管理模塊(DCM) 業(yè)內(nèi)大多數(shù)FPGA 均提供數(shù)字時鐘管理( 賽靈思公司的全部FPGA 均具有這種特性)。賽靈思公司推出最先進的FPGA 提供數(shù)字時鐘管理和相位環(huán)路鎖定。相位環(huán)路鎖定能夠提供精確的時鐘綜合，且能夠降低抖動，并實現(xiàn)過濾功能。[/font] [font=微軟雅黑,]4．嵌入式塊RA...
2014-03-04

--BBS主題帖: 基于FPGA的嵌入式Linux軟硬件設(shè)計

本設(shè)計，除了在 EDK中搭建了操作系統(tǒng)必須的各種模塊后，還需要在ISE中編寫各個時序電路程序，因此把 EDK中編寫好的工程作為一個模塊，加入到ISE中，然后統(tǒng)一編譯，這樣生成了我們需要的完整功能的程序。特別指出的是，PPC405數(shù)據(jù)地址采用的是大端模式，接入到ISE中時，需要把數(shù)據(jù)顛倒位置，如DATA[0：3...
2014-03-01

--BBS主題帖: 賽靈思Verilog(FPGA/CPLD)設(shè)計小技巧

[color=#333333] 以下是一個在設(shè)計中常犯的錯誤列表這些錯誤常使得你的設(shè)計不可靠或速度較慢為了提高你的設(shè)計性能和提高速度的可靠性你必須確定你的設(shè)計通過所有的這些檢查。[/color] [color=#333333]　　可靠性[/color] [color=#333333]　　**為時鐘信號選用全局時鐘緩沖器BUFG[/color] [color=#33...
2014-03-01

--BBS主題帖: FPGA實現(xiàn)時分多址的一種改進型方法(1)

摘要：利用FPGA實現(xiàn)時分多址的方法有很多種，但大多數(shù)方法都對FPGA芯片資源的占用非常巨大。針對這一問題，提出一種改進型方法來實現(xiàn)時分多址。通過使用FPGA芯片內(nèi)部的雙口隨機訪問存儲器(雙口RAM)，利用同一塊RAM采用兩套時鐘線，地址線和數(shù)據(jù)線，例化雙口RAM的IP核后，在占用較少FPGA芯片資源的前提下...
2014-03-01

--BBS主題帖: FPGA開發(fā)總結(jié)--“安富利杯”賽靈思FPGA設(shè)計技巧與應(yīng)用創(chuàng)新博文大賽參賽作品

[font=微軟雅黑,]FPGA開發(fā)總結(jié)(1)[/font] [font=微軟雅黑,]1. ISE 開發(fā)套件中XPower Analyzer軟件分析出FPGA的功耗可信度很高。[/font] [font=微軟雅黑,]開發(fā)中，通過對比和驗證，單板電源提供的功率值與XPower Analyzer軟件分析出FPGA的功耗很接近。因此，我們在設(shè)計中一定要好好地利用它。這樣對...
2014-02-28

--BBS主題帖: 開關(guān)電源設(shè)計Step by Step（含調(diào)試過程）

[font=Tahoma,][color=#000][font=calibri, SimSun, Arial, Helvetica, sans-serif]開關(guān)[url=http://bbs.elecfans.com/zhuti_power_1.html]電源[/url]設(shè)計是一件令很多人都頭痛的事，這次淘到這么一個好貼分享下，作者不容易啊 [/font][/color][/font] [font=Tahoma,][color=#000][font=calibri, Sim...
2014-02-28

--BBS主題帖: 在FPGA開發(fā)中盡量避免全局復(fù)位的使用？（2）

[color=#2e2e2e][font=微軟雅黑,] 在Xilinx 的FPGA器件中，全局的復(fù)位/置位信號（Global Set/Reset (GSR)）（可以通過全局復(fù)位管腳引入）是幾乎絕對可靠的，因為它是芯片內(nèi)部的信號。如果所有的觸發(fā)器都使用這一全局復(fù)位信號，則GSR信號將形成一個高扇出的網(wǎng)絡(luò)（有興趣的朋友可以在綜合工具中查看）。雖...
2014-02-27

--BBS主題帖: 數(shù)字中頻式頻譜儀的分辨率帶寬設(shè)計

[font=Tahoma, SimSun, Verdana, Arial]頻譜分析儀按實現(xiàn)方式可分為模擬式和數(shù)字式兩種，前者以模擬濾波器為基礎(chǔ)，后者則以數(shù)字濾波器和FFT分析為基礎(chǔ)。相比之下，模擬式頻譜分析儀不能獲得實時頻譜，且由于模擬濾波器會受到非線性、溫漂、老化等影響，測量精度不高；而數(shù)字式頻譜分析儀由于其基于數(shù)字...
2014-02-27

--BBS主題帖: 基于FPGA與DDR2 SDRAM的大容量異步FIFO緩存設(shè)計

[align=left][size=24px]異步FIFO作為數(shù)據(jù)緩存被廣泛應(yīng)用于高速實時數(shù)據(jù)采集、不同時鐘域之間的高性能數(shù)據(jù)傳輸以及多機處理等系統(tǒng)中[1]。如在視頻系統(tǒng)中用于視頻信號轉(zhuǎn)換、視頻分割和畫中畫電視[2]。在高速傳感信號實時檢測處理系統(tǒng)中用于數(shù)據(jù)緩存等。隨著微電子技術(shù)的發(fā)展，F(xiàn)IFO芯片也在向著高速、大容...
2014-02-27

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