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↓在全部中搜索到 813 條關于“TCO”的信息，用時:0.043 sec.

太陽能電池

科技名詞定義中文名稱：太陽能電池英文名稱：solar cell 定義1：將太陽輻射直接轉換成電能的器件。應用學科：電力（一級學科）；可再生能源（二級學科）定義2：以吸收太陽輻射能并轉化為電能的裝置。應用學科：資源科技（一級學科）；能源資源學（二級學科）百科名片 &...
2011-10-21

非晶硅薄膜太陽能電池

非晶硅薄膜太陽能電池（即非晶硅太陽能電池，amorphous silicon solar cell ）是用沉積在導電玻璃或不銹鋼襯底上的非晶硅薄膜制成的太陽能電池，又被稱為a-Si太陽能電池、無定型硅太陽能電池。非晶硅又稱無定形硅或玻璃硅(a一Si)。非晶硅中的硅原子是一種近程有序、遠程無序的排列，其間存在著大量的懸...
2011-09-08

ASP和IDC

ASP是英文Application service provider的縮寫,中文譯名是“應用服務提供商”；IDC是英文Internet Data Center的縮寫,中文譯名是“因特網數據中心”。 ASP是指通過在互聯網絡上配置、租賃和管理商務應用服務解決方案，為商業和個人客戶提供應用系統服務的公司。用戶可以把自己所需要的因特網應用服務交...
2010-11-26

Altera QuartusII警告信息解讀[轉]

在QuartusII下進行編譯和仿真的時候,會出現一堆warning,有的可以忽略,有的卻需要注意,雖然按F1可以了解關于該警告的幫助,但有時候幫助解釋的仍然不清楚,大家群策群力,把自己知道和了解的一些關于警告的問題都說出來討論一下,免得后來的人走彎路. 下面是我收集整理的一些,有些是自己的...
2009-10-09

FPGA/CPLD數字電路設計經驗分享(轉載)

摘要：在數字電路的設計中，時序設計是一個系統性能的主要標志，在高層次設計方法中，對時序控制的抽象度也相應提高，因此在設計中較難把握，但在理解RTL電路時序模型的基礎上，采用合理的設計方法在設計復雜數字系統是行之有效的，通過許多設計實例證明采用這種方式可以使電路的后仿真通過率大大提高，...
2009-09-27

FPGA設計的四種常用思想與技巧

本文討論的四種常用FPGA/CPLD設計思想與技巧：乒乓操作、串并轉換、流水線操作、數據接口同步化，都是FPGA/CPLD邏輯設計的內在規律的體現，合理地采用這些設計思想能在FPGA/CPLD設計工作種取得事半功倍的效果。 FPGA/CPLD的設計思想與技巧是一個非常大的話題，由于篇幅所限，本文...
2009-09-26

數字電路筆試題[ 2007-3-27 14:46:00 | By: caopengly ]

數字電路 1、同步電路和異步電路的區別是什么？（仕蘭微電子） 2、什么是同步邏輯和異步邏輯？（漢王筆試）同步邏輯是時鐘之間有固定的因果關系。異步邏輯是各時鐘之間沒有固定的因果關系。電路設計可分類為同步電路和非同步電路設計。同步電路利用時鐘脈衝使其子系統同步運作，而非同步...
2009-09-24

關于建立時間、保持時間的討論[ 2007-4-6 10:19:00 | By: caopengly ]

關于建立時間、保持時間的討論 netrat：時鐘周期為T,觸發器D1的時鐘沿到來到觸發器Q變化的時間Tco（CLK--Q）最大為T1max,最小為T1min,邏輯組合電路的延遲時間最大為T2max，最小為T2min，問觸發器D2的建立時間和保持時間。（如下圖所示）最終答案：T3setup<T-T1max-T2max，T3hol...
2009-09-24

Cyclone器件中的PLL (駿龍)

本文將介紹如何設計和使用Cyclone PLL功能。PLL常用于同步內部器件時鐘和外部時鐘，使內部工作的時鐘頻率比外部時鐘更高，時鐘延遲和時鐘偏移最小，減小或調整時鐘到輸出（TCO）和建立（TSU）時間。
2007-12-21

Cyclone器件中的PLL (駿龍)

本文將介紹如何設計和使用Cyclone PLL功能。PLL常用于同步內部器件時鐘和外部時鐘，使內部工作的時鐘頻率比外部時鐘更高，時鐘延遲和時鐘偏移最小，減小或調整時鐘到輸出（TCO）和建立（TSU）時間。
2007-12-21

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