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↓在 論壇帖子 中搜索到 1930 條關于“CASE”的信息，用時:0.004 sec.

--BBS主題帖: linux 2.6下編譯usb驅動和arm板進行數據通信(3)

[color=#000][color=#00ff]static[/color] [color=#00ff]int[/color] lcd_ioctl[color=#00cc]([/color][color=#00ff]struct[/color] inode [color=#00cc]*[/color]inode[color=#00cc],[/color] [color=#00ff]struct[/color] [color=#ff00]file[/color] [color=#00cc]*[/color][color=#ff00]file[/color...
2015-06-30

--BBS主題帖: 用單片機和CPLD實現步進電機的控制

[float=left] [img]http://gg.eefocus.com/www/delivery/lg.php?bannerid=7313&campaignid=1719&zoneid=212&loc=http%3A%2F%2Fwww.eefocus.com%2Ffpga%2F221094&referer=http%3A%2F%2Fwww.eefocus.com%2Ffpga%2Flist-design%2Fp63&cb=eee8c81bf3[/img] [/float] 步進電機是一種將脈沖信號轉...
2015-06-29

--BBS主題帖: 簡易通用型PCI接口的VHDL-CPLD設計

摘要：從PCI時序分析入手，重點闡述了PCI通用的狀態機設計，說明了用VHDL語言來實現本PIC通信狀態機的軟件設計以及進行MaxPlusII驗證的程序和方法。用該方法所設計的接口既可支持PCI常規傳輸，又可支持PCI猝發傳輸。關鍵詞： PCI時序 CPLD器件狀態圖 VHDL語言 PCI猝發傳輸用CPLD設計所構成的...
2015-06-29

--BBS主題帖: AC-Link數字音頻VHDL編/解碼的FPGA設計

引言數字音頻處理是指為真實再現聲音的逼真效果而對音頻進行的編解碼處理技術,它是寬帶網絡多媒體、移動多媒體通信的關鍵技術.Audio Codec′97(音頻數字信號編/解碼器)是其中一種用于聲音錄放的技術標準,簡稱AC′97. AC′97采用雙集成結構,即Digital Controller(數字信號控制器)和Audio Codec(音頻...
2015-06-29

--BBS主題帖: AC-Link數字音頻VHDL編/解碼的FPGA設計

引言數字音頻處理是指為真實再現聲音的逼真效果而對音頻進行的編解碼處理技術,它是寬帶網絡多媒體、移動多媒體通信的關鍵技術.Audio Codec′97(音頻數字信號編/解碼器)是其中一種用于聲音錄放的技術標準,簡稱AC′97. AC′97采用雙集成結構,即Digital Controller(數字信號控制器)和Audio Codec(音頻...
2015-06-29

--BBS主題帖: FPGA設計的驗證技術及應用原則

隨著FPGA器件體積和復雜性的不斷增加，設計工程師越來越需要有效的驗證方。時序仿真可以是一種能發現最多問題的驗證方法，但對許多設計來說，它常常是最困難和費時的方法之一。過去，采用標準臺式計算機的時序仿真是以小時或分鐘計算的，但現在對某些項目來說，在要求采用高性能64位服務器的情況下，其...
2015-06-28

--BBS主題帖: 基于SOPC技術的事故現場處理平臺設計與實現

[color=#333333][font=微軟雅黑, Tahoma,]摘要：本文介紹了利用SOPC設計方法，以Altera公司的Nios軟核處理器為核心完成的事故現場處理平臺的設計。就其中最重要的兩部分——SCCB總線控制模塊和SRAM讀寫控制模塊的具體實現做了詳細介紹，并給出了SRAM寫控制器的實際仿真結果。最后，總結了SOPC的設計方...
2015-06-28

--BBS主題帖: FPGA設計中的電源管理

[font=微軟雅黑, Tahoma,]過去，[url=http://www.ed-china.com/SEARCH/ART/FPGA.HTM][color=#810081]FPGA[/color][/url]設計者主要關心時序和面積使用率問題。但隨著FPGA不斷取代[url=http://www.ed-china.com/SEARCH/ART/ASSP.HTM]ASSP[/url]和[url=http://www.ed-china.com/SEARCH/ART/ASIC.HTM]ASIC...
2015-06-28

--BBS主題帖: 基于現場可編程門陣列的數控延時器的設計

l 引言　　利用硬件描述語言結合可編程邏輯器件(PLD)可以極大地方便數字集成電路的設計，本文介紹一種利用VHDL硬件描述語言結合現場可編程門陣列(FPGA)設計的數控延時器，延時器在時鐘clk的作用下，從8位數據線輸入延時量，到LATCH高電平時鎖存數據，可以實現對觸發脈沖TRIG的任意量的延時。由于延時范...
2015-06-28

--BBS主題帖: 簡易通用型PCI接口的VHDL-CPLD設計

用CPLD設計所構成的CPI接口系統具有簡潔、可靠等優點，是一種行之有效的設計途徑。很多技術雜志和網站上，都有不少用CPLD設計PCI常規傳輸系統的文章。但用這些方法在MzxPlusII、Fundition等環境下進行模擬仿真時，其產生的時序往往與PCI規范有很大出入。雖然 Altera 等公司推出PCI核可以直接使用，但這...
2015-06-28

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