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--BBS主題帖: 基于CPLD的數(shù)據(jù)采集與顯示接口電路仿真設(shè)計(jì)

[font=宋體, arial][size=14.285714149475098px]1 引言[/size][/font] [font=宋體, arial][size=14.285714149475098px]　　CPLD稱為復(fù)雜可編程邏輯設(shè)計(jì)芯片，它是大規(guī)模可編程器件，具有高集成度、高可靠性、高速度的特點(diǎn)。CPLD是利用EDA技術(shù)進(jìn)行電子系統(tǒng)設(shè)計(jì)的載體。硬件描述語言是EDA技術(shù)進(jìn)行電子系...
2015-03-31

--BBS主題帖: FPGA設(shè)計(jì)的驗(yàn)證技術(shù)及應(yīng)用原則

[font=微軟雅黑,]隨著FPGA器件體積和復(fù)雜性的不斷增加，設(shè)計(jì)工程師越來越需要有效的驗(yàn)證方。時(shí)序仿真可以是一種能發(fā)現(xiàn)最多問題的驗(yàn)證方法，但對許多設(shè)計(jì)來說，它常常是最困難和費(fèi)時(shí)的方法之一。過去，采用標(biāo)準(zhǔn)臺式計(jì)算機(jī)的時(shí)序仿真是以小時(shí)或分鐘計(jì)算的，但現(xiàn)在對某些項(xiàng)目來說，在要求采用高性能64位服...
2015-03-31

--BBS主題帖: XILINX FFT IP仿真心得（一） ---轉(zhuǎn)貼山一程水一程的博客

[color=#2e2e2e][font=微軟雅黑,]第一次使用Xilinx 的FFT的IP core。沒有太多的資料和實(shí)例可以學(xué)習(xí)，只有一個(gè)軟件自帶的文檔xfft_ds260，而且是英文的，看了很長時(shí)間受益不大。然后決定一邊用一邊再學(xué)習(xí)，就自己建立了一個(gè)工程實(shí)驗(yàn)。這個(gè)IP核可以選擇多種結(jié)構(gòu)的，什么基４的，基２，基lite,pipelined.s...
2015-03-29

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