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↓在 論壇帖子 中搜索到 727 條關(guān)于“TCL”的信息，用時:0.003 sec.

--BBS主題帖: 7系列FPGA中有關(guān)IOSTANDARD警告和錯誤的處理方法

[color=#2e2e2e][font=微軟雅黑,]因為新版本的ISE和Vivado軟件中對管腳約束進(jìn)行了增強(qiáng)限制，所以有關(guān)IOSTANDARD的警告和錯誤是為了避免把一個電壓水平的管腳誤放到另一種電平上，導(dǎo)致意外損壞芯片。這個檢查很有用，但是對于習(xí)慣使用默認(rèn)設(shè)置的人會造成一些困惑，例如在ISE中布局布線時會提示警告：PAD...
2014-08-22

--BBS主題帖: 7系列FPGA中有關(guān)IOSTANDARD警告和錯誤的處理方法

[color=#2e2e2e][font=微軟雅黑,]因為新版本的ISE和Vivado軟件中對管腳約束進(jìn)行了增強(qiáng)限制，所以有關(guān)IOSTANDARD的警告和錯誤是為了避免把一個電壓水平的管腳誤放到另一種電平上，導(dǎo)致意外損壞芯片。這個檢查很有用，但是對于習(xí)慣使用默認(rèn)設(shè)置的人會造成一些困惑，例如在ISE中布局布線時會提示警告：PAD...
2014-08-21

--BBS主題帖: Vivado之嵌入式系統(tǒng)設(shè)計一---Vivado高效設(shè)計案例分享

[font=微軟雅黑,]據(jù)說，ISE之后會停止更新（事實(shí)還是謠言無從考證）。但是，掌握Vivado開發(fā)工具勢在必行。緣由一，此處省略一萬字…… Vivado提供了直觀的具有強(qiáng)大功能的圖形用戶接口。所有的工具和工具選項欄使用原生的工具命令語言格式編寫，這使得既能使用Vivado集成開發(fā)環(huán)境又能使用Tcl shell。相...
2014-08-21

--BBS主題帖: Vivado高效設(shè)計案例分享大賽---2使用Vivado 自帶的高效仿真器

[color=#2e2e2e][font=微軟雅黑,] 在FPGA的設(shè)計中，仿真環(huán)節(jié)特別是功能仿真是極其重要的，可以提前發(fā)現(xiàn)bug，減少很多的調(diào)試時間。一般情況下，一個完整的仿真流程包括：1. RTL設(shè)計，最簡單的情況就是使用HDL編寫了一段代碼。2.行為仿真：僅僅驗證編寫的代碼在理論上可以實(shí)現(xiàn)我們的意圖。3.綜合，把...
2014-08-21

--BBS主題帖: 使用VIVADO遇到問題的幾種解決方法

[color=#2e2e2e][font=微軟雅黑,]這一段時間遇到、聽到、看到使用vivado的困惑。這些困惑，會讓初次接觸者，產(chǎn)生畏難的情緒。現(xiàn)共享出來，以共勉。 1.vivado安裝在32位計算機(jī)上，很遇到不少莫名其妙的現(xiàn)象。通過交流以及自己開發(fā)遇到的情況，經(jīng)常會發(fā)現(xiàn)VIVADO在使用期間出現(xiàn)很多莫名其妙的現(xiàn)象。通過...
2014-08-20

--BBS主題帖: 布局布線時間減少近70%---Vivado在復(fù)雜FPGA設(shè)計中大顯身手

[font=微軟雅黑,]在產(chǎn)品的系統(tǒng)架構(gòu)設(shè)計中，對FPGA設(shè)計的功能和質(zhì)量都提出了更高的要求。單片F(xiàn)PGA設(shè)計需要支持更高的數(shù)據(jù)帶寬，支持更多的產(chǎn)品feature。同時，由于項目進(jìn)度的要求，又需要縮短開發(fā)周期，確保產(chǎn)品質(zhì)量。Xilinx的Vivado開發(fā)工具很好的滿足了我們的設(shè)計需求，使得我們的產(chǎn)品得以在保證項目進(jìn)...
2014-08-20

--BBS主題帖: 提升設(shè)計效率超乎你的想象！---技術(shù)專家設(shè)計實(shí)評Vivado

[font=微軟雅黑,]Vivado高效設(shè)計案例分享參賽作品[/font][color=#2e2e2e][font=微軟雅黑,]我在2012年因項目需要選用了7系列的器件，也因此有幸較早地成為Vivado的用戶。在用過了幾乎所有的正式發(fā)行過版本的過程中，學(xué)習(xí)并積累了一些經(jīng)驗，也見證了它的強(qiáng)大和逐漸完善。一般說來Vivado區(qū)別于ISE以及其他...
2014-08-20

--BBS主題帖: Vivado高效設(shè)計案例分享大賽---21...Vivado使用的一些小技巧1-4

[color=#2e2e2e][font=微軟雅黑,]軟件是我們的工具，使用越多就越熟練。使用一些小技巧可以讓我們的開發(fā)更加快捷，所以我們在此總結(jié)一些小技巧（后面有新的會再補(bǔ)充）：1. 更改默認(rèn)的工程文件夾如果我們打開一些Vivado自動的工程，或者把以前老版本的工程/ISE建立的工程導(dǎo)入Vivado的時候，它會有一個默...
2014-08-20

--BBS主題帖: 關(guān)于使用Vivado的經(jīng)驗以及小技巧

[color=#2e2e2e][font=微軟雅黑,]本人使用Vivado已經(jīng)有1年左右了，從ISE到planAhead再到Vivado歷經(jīng)了多少的滄桑，從最開始的好奇到厭惡，最后慢慢的喜歡上他的高效簡潔的風(fēng)格！在這里說說使用Vivado的一些小技巧，給入門的小伙伴們指引一個方向。1、初次學(xué)習(xí)Vivado，不要在網(wǎng)上盲目的搜索學(xué)習(xí)資料，認(rèn)真...
2014-08-20

--BBS主題帖: Vivado高效設(shè)計案例分享大賽----使用VIVADO對7系列FPGA的高效設(shè)計心得

[color=#2e2e2e][font=微軟雅黑,] 隨著xilinx公司進(jìn)入20nm工藝，以堆疊的方式在可編程領(lǐng)域一路高歌猛進(jìn)，與其配套的EDA工具——新一代高端FPGA設(shè)計軟件VIVADO也備受關(guān)注和飽受爭議。我從2012年開始使用VIVADO，像所有剛推出的軟件一樣，在剛推出的時候都會存在一些bug，特別是VIVADO2013.2\2013.3。...
2014-08-20

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