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↓在 論壇帖子 中搜索到 1973 條關于“Cadence”的信息，用時:0.006 sec.

--BBS主題帖: CADENCE改進型驗證型設計流程提高邏輯設計師效率

Cadence宣布其Cadence Logic Design Team Solution的“驗證型設計”組件已經過改良，為邏輯設計師大幅提高了工作效率。這些新功能能夠明顯克服主要的驗證瓶頸，這些瓶頸已經對開發(fā)過程初期對基于斷言的驗證方法的有效應用造成了阻礙。
2007-06-12

--BBS主題帖: 新手，求助CADENCE 15.7安裝軟件

求助CADENCE 15.7安裝軟件
2007-05-17

--BBS主題帖: Cadence發(fā)布全新Allegro系統(tǒng)互連設計平臺

Cadence設計系統(tǒng)公司發(fā)布了Cadence Allegro 系統(tǒng)互連設計平臺針對印刷電路板（PCB）設計進行的全新產品和技術增強.改進后的平臺為約束驅動設計提供了重要的新功能，向IC、封裝和板級設計領域的設計團隊提供新技術和增強以提升易用性、生產率和協(xié)作能力，從而為PCB設計工程師樹立了全新典范。
2007-05-16

--BBS主題帖: Cadence推出完整的定制IC仿真和驗證方案Virtuoso

Cadence設計系統(tǒng)公司發(fā)布了Cadence Virtuoso Multi-Mode Simulation (MMSIM 6.2版)。這是電子設計工業(yè)內首個端到端的定制IC模擬與驗證解決方案，使用通用、全集成的網表和模型數據庫來仿真射頻、模擬、存儲器和混合信號設計及設計模塊。這款突破性產品能夠讓設計者在仿真引擎間自由切換，而不會產生任何...
2007-05-16

--BBS主題帖: Cadence低功耗設計方法學錦囊加速消費電子設計

Cadence設計系統(tǒng)公司發(fā)布了首個低功耗設計“錦囊”，使處于不同經驗水平的工程師，均可以最小的風險、成本和開發(fā)時間來采用低功耗技術。做為Cadence低功耗設計解決方案的補充，Cadence 低功耗設計方法學錦囊(Cadence Low-Power Methodology Kit) 提供了一個覆蓋邏輯設計、功能驗證和物理實現的端到端方...
2007-05-16

--BBS主題帖: Cadence Encounter數字IC設計平臺與SiP設計技術

Cadence設計系統(tǒng)有限公司宣布Cadence Encounter數字IC設計平臺與系統(tǒng)級封裝（SiP）設計技術協(xié)助意法半導體成功完成業(yè)內首款65納米高性能、雙高清（HD）解碼器STi7200，可應用于機頂盒、高清DVD（藍光與HD-DVD雙標準）和數字電視等數字消費產品中。該產品的成功研發(fā)鞏固了Cadence作為高端65納米系統(tǒng)級芯...
2007-05-08

--BBS主題帖: Cadence聯(lián)合IBM、三星和特許半導體推出65納米參考流程

Cadence 設計系統(tǒng)公司宣布基于65納米通用功率格式（CPF）面向Common Platform 技術的參考流程即日上市。該參考流程是Cadence與Common Platform聯(lián)盟之間長期合作的最新成果，該聯(lián)盟的成員企業(yè)包括IBM、特許半導體制造和三星。
2007-04-29

--BBS主題帖: CADENCE Encounter 數字IC設計平臺推出最新軟件版本

Cadence設計系統(tǒng)公司發(fā)布了Cadence Encounter 數字IC設計平臺的最新軟件版本，增加了業(yè)內領先的功能特性，包括全芯片優(yōu)化、面向65納米及以下工藝的超大規(guī)模混合信號設計支持，具有對角布線能力的Encounter X Interconnect Option，以及之前已經公布支持的基于Si2通用功率格式（CPF）1.0版本的低功耗設計...
2007-04-28

--BBS主題帖: 誰有CADENCE 17.5 的license

誰有CADENCE 17.5 的license,謝謝！
2007-04-13

--BBS主題帖: cadence下的原理圖怎么下載到FPGA里

請問Cadence 里的原理圖怎么用XILINX 做FPGA驗證,是要先把原理圖轉換成VHDL或者Verilog文件嗎,還是其他方法.請各位賜教,謝謝
2007-04-12

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