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↓在 論壇帖子 中搜索到 8054 條關于“Xilinx”的信息，用時:0.007 sec.

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載6：Spartan-6的存儲元件

[font=微軟雅黑,]二、存儲元件[/font] [font=微軟雅黑,]Spartan-6的每個SLICE 有8個存儲元件，可以實現存儲功能。其中4個與O6相連的存儲單元可以配置成寄存器或鎖存器，而與O5相連的存儲單元僅可以配置成寄存器，如圖2-4 所示。這是與Spartan-3系列器件不同之處。[/font] [img]http://xilinx.eetr...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載7：Spartan-6的時鐘資源

[font=微軟雅黑,]2.1.2 時鐘資源[/font] [font=微軟雅黑,]時鐘布線資源具有高速、低SKEW的特點，它對系統設計非常重要，即使系統速率不高，也應該關注時鐘設計，以消除潛在的時鐘危險。Spartan-6器件包含16個全局時鐘資源和40個I/O區域時鐘資源。全局時鐘用于系統時鐘，而I/O區域時鐘專用于I/O串行/解...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載8：全局時鐘緩沖器/多路復用器

[font=微軟雅黑,]二、全局時鐘緩沖器/多路復用器[/font] [font=微軟雅黑,]Spartan-6的時鐘緩沖器/多路復用器（BUFG或BUFPLL）可以直接驅動時鐘輸入信號到時鐘線上，或者通過多路復用器在兩個不相關的信號甚至異步時鐘信號中切換。[/font] [font=微軟雅黑,]全局時鐘緩沖器的原語如表2-7所示。[/font]...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載9：Spartan-6的I/O時鐘緩沖器

[font=微軟雅黑,]三、 I/O 時鐘緩沖器[/font] [font=微軟雅黑,]除了全局時鐘緩沖器外，Spartan-6還包含驅動高速I/O時鐘區域的時鐘緩沖器。 I/O 時鐘緩沖器的原語如表2-9所示。[/font] [img]http://xilinx.eetrend.com/files-eetrend-xilinx/blog/201106/1935-3473-tu_pian__1.png[/img] 表2-9 ...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載10：Spartan-6的時鐘網絡

[font=微軟雅黑,]四、時鐘網絡[/font] [font=微軟雅黑,]Spartan-6的時鐘布線網絡包括由BUFGMUX驅動的全局時鐘網絡和由I/O時鐘緩沖器（BUFIO2）、PLL時鐘緩沖器（BUFPLL）驅動的I/O區域時鐘網絡。[/font] [font=微軟雅黑,](1) 全局時鐘網絡。[/font] [font=微軟雅黑,]Spartan-6的全局時鐘網絡由16個...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載11：Spartan-6的時鐘管理器（CMT）

[font=微軟雅黑,]2.1.3 時鐘管理器（CMT）[/font] [font=微軟雅黑,]Spartan-6 CMT是一個靈活、高性能的時鐘管理模塊。它位于芯片中央、垂直的全局時鐘網絡旁。如圖2-17所示，它包含一個PLL和兩個DCM。[/font] [img]http://xilinx.eetrend.com/files-eetrend-xilinx/blog/201106/1941-3485-tu_pian_...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載12：Spartan-6的PLL

[font=微軟雅黑,]二、 PLL[/font] [font=微軟雅黑,]Spartan-6 器件最多包含6 個CMT，12 個PLL。PLL 的主要用途是作為頻率合成器，產生更寬范圍的頻率輸出，在與CMT 中的DCM 連接時，具有良好的濾波功能。[/font] [font=微軟雅黑,]圖2-20 所示為PLL 的功能框圖。[/font] [img]http://xilinx.eetren...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載13：BRAM（Block RAM）模塊

[font=微軟雅黑,]2.1.4 BRAM（Block RAM）模塊[/font] [font=微軟雅黑,]Spartan-6中的BRAM存儲18Kbit數據，能配置成兩個獨立的9Kbit BRAM或者一個18Kbit BRAM。每個RAM可以通過兩個端口尋址，也可以配置成單口RAM。BRAM包含輸出寄存器以增加流水線性能。BRAM 在器件中按列排列，其數量取決于Spartan-6...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載13：BRAM（Block RAM）模塊

[font=微軟雅黑,]2.1.4 BRAM（Block RAM）模塊[/font] [font=微軟雅黑,]Spartan-6中的BRAM存儲18Kbit數據，能配置成兩個獨立的9Kbit BRAM或者一個18Kbit BRAM。每個RAM可以通過兩個端口尋址，也可以配置成單口RAM。BRAM包含輸出寄存器以增加流水線性能。BRAM 在器件中按列排列，其數量取決于Spartan-6...
2014-10-28

--BBS主題帖: 《Xilinx可編程邏輯器件設計與開發（基礎篇）》連載14：Spartan-6的DSP 模塊XtremeDSP

[font=微軟雅黑,]2.1.5 DSP 模塊XtremeDSP[/font] [font=微軟雅黑,]為了適應越來越復雜的DSP運算，Spartan-6在Spartan 3A DSP模塊DSP48A 基礎上，不斷進行功能擴展，推出了功能更強大的DSP48A1 SLICE。[/font] [font=微軟雅黑,]圖2-31所示為DSP48A1功能框圖，算術部分包含18位預加器、2個48位數據輸入...
2014-10-28

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