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應(yīng)用開發(fā)

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↓在 論壇帖子 中搜索到 8054 條關(guān)于“Xilinx”的信息，用時(shí):0.006 sec.

--BBS主題帖: 《Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）》連載42：PlanAhead進(jìn)行I/O規(guī)劃

[font=微軟雅黑,]九、分配高速收發(fā)器和時(shí)鐘邏輯可以將綜合后網(wǎng)表文件導(dǎo)入PlanAhead，然后在PlanAhead 中完成關(guān)鍵時(shí)鐘，以及相關(guān)聯(lián)的I/O 端口的分配。例如: PlanAhead 可以對某些邏輯進(jìn)行分組，像高速收發(fā)器（Gigbit Transceiver，簡稱GT），以及相關(guān)聯(lián)的I/O 對，再對這些分組進(jìn)行邏輯位置的規(guī)劃、端...
2014-10-23

--BBS主題帖: 《Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）》連載43：PlanAhead與時(shí)序分析

[font=微軟雅黑,]10.5 PlanAhead 與時(shí)序分析在ISE 中可以進(jìn)行時(shí)序分析，在PlanAhead 中同樣也可以進(jìn)行時(shí)序分析。下面介紹用PlanAhead 進(jìn)行時(shí)序分析的步驟。一、運(yùn)行時(shí)序分析 1. 在PlanAhead 中運(yùn)行【File 】→ 【Open Project 】，打開如下項(xiàng)目，PlanAhead_Tutorial/Projects/project_cpu_netli...
2014-10-23

--BBS主題帖: 《Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）》連載44：PlanAhead進(jìn)行布局規(guī)劃

[font=微軟雅黑,]10.6 應(yīng)用PlanAhead 進(jìn)行布局規(guī)劃 FloorPlanning 工具是PlanAhead 的一個(gè)組成部分，用它可以對FPGA 設(shè)計(jì)進(jìn)行分析，首先找到設(shè)計(jì)中的時(shí)序問題或者擁塞的問題，然后再通過使用PloorPlanning 約束，以指導(dǎo)實(shí)現(xiàn)工具產(chǎn)生更優(yōu)的結(jié)果。例如，使用LOC 約束可以將Pblock（Phisical Block Regio...
2014-10-23

--BBS主題帖: 《Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）》連載45：PlanAhead與ChipScope

[font=微軟雅黑,]本節(jié)將簡單介紹在PlanAhead工具中如何應(yīng)用ChipScope核和分析工具進(jìn)行邏輯調(diào)試與驗(yàn)證。先通過一個(gè)向?qū)hipScope核插入設(shè)計(jì)中，選擇待測試的網(wǎng)線，并進(jìn)行例化、連接和綜合，最后，導(dǎo)入布局和時(shí)序報(bào)告，產(chǎn)生位流文件，用ChipScope分析器進(jìn)行驗(yàn)證。[/font] [font=微軟雅黑,]1. 打開項(xiàng)目...
2014-10-23

--BBS主題帖: 賽靈思（Xilinx） FPGA用戶約束文件的分類和語法說明--轉(zhuǎn)自xilinx ISE 開發(fā)指南

[font=微軟雅黑,]FPGA設(shè)計(jì)中的約束文件有3類：用戶設(shè)計(jì)文件（.UCF文件）、網(wǎng)表約束文件（.NCF文件）以及物理約束文件（.PCF文件），可以完成時(shí)序約束、管腳約束以及區(qū)域約束。3類約束文件的關(guān)系為：用戶在設(shè)計(jì)輸入階段編寫UCF文件，然后UCF文件和設(shè)計(jì)綜合后生成NCF文件，最后再經(jīng)過實(shí)現(xiàn)后生成PCF 文件。...
2014-10-23

--BBS主題帖: 賽靈思（Xilinx） FPGA用戶約束文件的分類和語法說明--轉(zhuǎn)自xilinx ISE 開發(fā)指南

[font=微軟雅黑,]FPGA設(shè)計(jì)中的約束文件有3類：用戶設(shè)計(jì)文件（.UCF文件）、網(wǎng)表約束文件（.NCF文件）以及物理約束文件（.PCF文件），可以完成時(shí)序約束、管腳約束以及區(qū)域約束。3類約束文件的關(guān)系為：用戶在設(shè)計(jì)輸入階段編寫UCF文件，然后UCF文件和設(shè)計(jì)綜合后生成NCF文件，最后再經(jīng)過實(shí)現(xiàn)后生成PCF 文件。...
2014-10-23

--BBS主題帖: 《Xilinx可編程邏輯器件設(shè)計(jì)與開發(fā)（基礎(chǔ)篇）》連載45：PicoBlaze 8 位微控制器

[font=微軟雅黑,]第12章 PicoBlaze 8 位微控制器[/font] [font=微軟雅黑,]PicoBlaze 是一個(gè)8 位的微控制器，非常適合于Spartan 系列及Virtex 系列FPGA。還可以用于CPLD，但是需要外部加SRAM 存儲器以運(yùn)行程序。它又被稱為常數(shù)化的可編程狀態(tài)機(jī)KCPSM（(K)constant Coded Programmable State Machine），...
2014-10-23

--BBS主題帖: Xilinx Spartan-6 LX9開發(fā)板測試

[font=微軟雅黑,]首先，感謝電子創(chuàng)新網(wǎng)給我提供了Xilinx Spartan-6 LX9開發(fā)板測試機(jī)會(huì)。拿到開發(fā)板可以發(fā)現(xiàn)雖然尺寸很小，但是上面的硬件資源豐富，主要包含以下擴(kuò)展電路： [/font] [list] [*]以Xilinx Spartan-6 XC6SLX9-2CSG324C型FPGA為核心； [*]采用外部USB供電，并提供USB接口為FPGA開發(fā)板實(shí)...
2014-10-23

--BBS主題帖: Xilinx FPGA 嵌入式系統(tǒng)程序引導(dǎo)和啟動(dòng)的流程---參加年度達(dá)人

[font=微軟雅黑,]這篇blog想弄清楚FPGA上電配置后程序引導(dǎo)和啟動(dòng)的整個(gè)流程是怎么樣的，不是談?wù)撊绾尉帉慴ootloader。主題的引出本人創(chuàng)建了一個(gè)基于MicroBlaze的嵌入式系統(tǒng)（類似于如圖1所示，當(dāng)然沒有圖1那么復(fù)雜）。片上BRAM僅僅是64KB，而本人生成的程序鏡像有2MB多，所以這樣的話，程序鏡像不能...
2014-10-23

--BBS主題帖: Xilinx可編程邏輯器件的高級應(yīng)用與設(shè)計(jì)技巧電子檔來了！！！---參加達(dá)人活動(dòng)

[color=#2e2e2e][font=微軟雅黑,]本書以淺入深出、圖文并茂的方式，全面介紹了全球最大可編程器件生產(chǎn)商Xilinx的CoolRunner-Ⅱ、Spartan-3、Virtex-Ⅱ和Virtex-Ⅱ Pro等一系列最新器件的結(jié)構(gòu)和特性；同時(shí)還用較大篇幅介紹了最新設(shè)計(jì)開發(fā)環(huán)境ISE 6及其輔助設(shè)計(jì)工具，可編程邏輯器件的高級應(yīng)用和設(shè)計(jì)技巧...
2014-10-23

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