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應(yīng)用開(kāi)發(fā)

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--BBS主題帖: ZED-Board從入門(mén)到精通（三）：從傳統(tǒng)ARM開(kāi)發(fā)到PS開(kāi)發(fā)的轉(zhuǎn)變

ARM已經(jīng)在國(guó)內(nèi)流行得一塌糊涂，各類(lèi)教程、開(kāi)發(fā)板（S3C2440,6410）層出不窮，歸結(jié)下來(lái)，傳統(tǒng)ARM開(kāi)發(fā)包括以下幾個(gè)步驟：（1）硬件電路板設(shè)計(jì)（對(duì)于Zedboard，相當(dāng)于設(shè)計(jì)邏輯電路，PL工程師負(fù)責(zé)）；（2）基本模塊裸機(jī)代碼測(cè)試（UART，DDR2，其他外設(shè)）；（3）移植操作系統(tǒng)（如Linux，uCLinux，uCOS等...
2014-02-22

--BBS主題帖: Linux2.4.26內(nèi)核在Virtex II Pro開(kāi)發(fā)板上的移植----生成ACE文件（五）ZZ

[size=14px]編輯genace.opt文件[/size] [list=1][*]內(nèi)容如下： -jprog -board user -target ppc_hw -hw download.bit -elf zImage.initrd.elf -configdevice devicenr 1 idcode 0x1127e093 irlength 14 partname xc2vp30 -debugdevice devicenr 1 cpunr 1 -ace system.ace[*]將download.bit，z...
2014-02-22

--BBS主題帖: Vivado 高層次綜合

[font=宋體]對(duì)[/font]Vivado HLS[font=宋體]也就是[/font]XILINX’s [font=宋體]高層次綜合解決方案有興趣，[b]這個(gè)解決方案綜合[/b][/font][b]c[/b][b][font=宋體]，[/font][/b][b]c++[/b][b][font=宋體]和系統(tǒng)[/font][/b][b]c[/b][b][font=宋體]代碼成[/font][/b][b]Verilog[/b][b][font=宋體]和[/fo...
2014-02-21

--BBS主題帖: 未擴(kuò)展時(shí)鐘揭秘

[color=#333333]隨著越來(lái)越多的賽靈思用戶(hù)開(kāi)始使用 Vivado®設(shè)計(jì)套件，部分用戶(hù)對(duì)未擴(kuò)展時(shí)鐘表示困惑。那么什么是未擴(kuò)展時(shí)鐘呢？他們是如何進(jìn)行關(guān)聯(lián)和計(jì)時(shí)的？應(yīng)對(duì)未擴(kuò)展時(shí)鐘的標(biāo)準(zhǔn)方法又是什么呢？下面讓我們來(lái)詳細(xì)探討一下這個(gè)問(wèn)題，重點(diǎn)是探討確保設(shè)計(jì)人員使用正確的同步技術(shù)安全地穿越未擴(kuò)展時(shí)...
2014-02-21

--BBS主題帖: 學(xué)習(xí)嵌入式開(kāi)發(fā)真的有前途嗎？

[color=#000][font=sans-serif]目前國(guó)內(nèi)嵌入式人才極度匱乏，權(quán)威部門(mén)統(tǒng)計(jì)，我國(guó)目前嵌入式軟件人才缺口每年為40萬(wàn)人左右。INTEL、TI、SONY、三星、TCL、聯(lián)想、康佳等大型企業(yè)對(duì)嵌入式人才都有大量的需求。供不應(yīng)求使得嵌入式人才身價(jià)上漲，而且，越有專(zhuān)業(yè)經(jīng)驗(yàn)，就業(yè)競(jìng)爭(zhēng)力就越大。因此，通過(guò)參加相關(guān)的...
2014-02-21

--BBS主題帖: Linux內(nèi)核驅(qū)動(dòng)程序的配置1

[font=瀹?huà)浣揮 Linux 2.6 內(nèi)核的配置系統(tǒng)由以下 3 個(gè)部分組成：[/font] [font=瀹?huà)浣揮> Makefile：分布在 Linux 內(nèi)核源代碼中的 Makefile，定義 Linux 內(nèi)核的編譯規(guī)則[/font] [font=瀹?huà)浣揮> 配置文件 Kconfig：給用戶(hù)提供配置選擇的功能[/font] [font=瀹?huà)浣揮> 配置工具：包括配置命令解釋器(對(duì)配置...
2014-02-21

--BBS主題帖: MAX1032結(jié)合CPLD的應(yīng)用

[b]關(guān)鍵字：[url=http://www.ednchina.com/SEARCH/ART/MAX1032.HTM]MAX1032[/url] [url=http://www.ednchina.com/SEARCH/ART/CPLD.HTM]CPLD[/url] [url=http://www.ednchina.com/SEARCH/ART/Moddsim%B7%C2%D5%E6.HTM]Moddsim仿真[/url] [url=http://www.ednchina.com/SEARCH/ART/ADC.HTM]ADC[/ur...
2014-02-20

--BBS主題帖: Xilinx FPGA 嵌入式系統(tǒng)程序引導(dǎo)和啟動(dòng)的流程---參加年度達(dá)人

這篇blog想弄清楚FPGA上電配置后程序引導(dǎo)和啟動(dòng)的整個(gè)流程是怎么樣的，不是談?wù)撊绾尉帉?xiě)bootloader。 [b]主題的引出[/b] 本人創(chuàng)建了一個(gè)基于MicroBlaze的嵌入式系統(tǒng)（類(lèi)似于如圖1所示，當(dāng)然沒(méi)有圖1那么復(fù)雜）。片上BRAM僅僅是64KB，而本人生成的程序鏡像有2MB多，所以這樣的話(huà)，程序鏡像不能跟用于配...
2014-02-19

--BBS主題帖: Modelsim的功能仿真和時(shí)序仿真

FPGA 設(shè)計(jì)流程包括設(shè)計(jì)輸入，仿真，綜合，生成，板級(jí)驗(yàn)證等很多階段。在整個(gè)設(shè)計(jì)流程中，完成設(shè)計(jì)輸入并成功進(jìn)行編譯僅能說(shuō)明設(shè)計(jì)符合一定的語(yǔ)法規(guī)范，并不能說(shuō)明設(shè)計(jì)功能的正確性，這時(shí)就需要通過(guò)仿真對(duì)設(shè)計(jì)進(jìn)行驗(yàn)證。在FPGA 設(shè)計(jì)中，仿真一般分為功能仿真（前仿真）和時(shí)序仿真（后仿真）。功能仿真又...
2014-02-19

--BBS主題帖: 布局布線(xiàn)時(shí)間減少近70%---Vivado在復(fù)雜FPGA設(shè)計(jì)中大顯身手

[font=微軟雅黑,]在產(chǎn)品的系統(tǒng)架構(gòu)設(shè)計(jì)中，對(duì)FPGA設(shè)計(jì)的功能和質(zhì)量都提出了更高的要求。單片F(xiàn)PGA設(shè)計(jì)需要支持更高的數(shù)據(jù)帶寬，支持更多的產(chǎn)品feature。同時(shí)，由于項(xiàng)目進(jìn)度的要求，又需要縮短開(kāi)發(fā)周期，確保產(chǎn)品質(zhì)量。Xilinx的Vivado開(kāi)發(fā)工具很好的滿(mǎn)足了我們的設(shè)計(jì)需求，使得我們的產(chǎn)品得以在保證項(xiàng)目進(jìn)...
2014-01-26

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