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應(yīng)用開發(fā)

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↓在 論壇帖子 中搜索到 3034 條關(guān)于“ASIC”的信息，用時(shí):0.005 sec.

--BBS主題帖: 基礎(chǔ)知識(shí)：ASIC 和FPGA 深度比較

[font=微軟雅黑,]ASIC 和 FPGA 具有不同的價(jià)值主張，選擇其中之一之前，一定要對(duì)其進(jìn)行仔細(xì)評(píng)估。2種技術(shù)的比較信息非常豐富。這里介紹了ASIC和FPGA的優(yōu)勢(shì)與劣勢(shì)。[/font] [table=98%][tr=none][td=2,1]FPGA 和 ASIC 的設(shè)計(jì)優(yōu)勢(shì)比較[/td][/tr][tr=none][td=1,1,50%]FPGA 的設(shè)計(jì)優(yōu)勢(shì)[/td][td=1,1,50%]A...
2015-01-17

--BBS主題帖: 利用FPGA開發(fā)板進(jìn)行ASIC原型開發(fā)的技巧

[font=微軟雅黑,]ASIC設(shè)計(jì)在尺寸和復(fù)雜性上不斷增加，現(xiàn)代FPGA的容量和性能的新進(jìn)展意味著這些設(shè)計(jì)中的2/3能夠使用單個(gè)FPGA進(jìn)行建模。然而，這些設(shè)計(jì)中仍然保留有1/3(那就是說，所有ASIC設(shè)計(jì)中的1/9)要求一個(gè)基于多個(gè)FPGA的原型開發(fā)板。[/font] [font=微軟雅黑,]　　在不太遙遠(yuǎn)的過去，對(duì)ASIC設(shè)計(jì)團(tuán)隊(duì)...
2015-01-17

--BBS主題帖: S2C推出基于賽靈思Virtex-7 2000T 3D FPGA的新IP、算法和ASIC快速原型平臺(tái)

[font=微軟雅黑,][img]http://xilinx.eetrend.com/files-eetrend-xilinx/news/201412/8061-15429-singleev7logicmodule.jpg[/img] [color=#FF8000]作者：Steve Leibson, 賽靈思戰(zhàn)略營(yíng)銷與業(yè)務(wù)規(guī)劃總監(jiān)[/color] FPGA是開發(fā)新IP、算法和整個(gè)ASIC原型的很好的目標(biāo)平臺(tái)。S2C剛剛發(fā)布最新的原型平臺(tái)，基于...
2014-12-20

--BBS主題帖: 談?wù)勅绾卫肍PGA開發(fā)板進(jìn)行ASIC原型開發(fā)

[size=14px]ASIC設(shè)計(jì)在尺寸和復(fù)雜性上不斷增加，現(xiàn)代FPGA的容量和性能的新進(jìn)展意味著這些設(shè)計(jì)中的2/3能夠使用單個(gè)FPGA進(jìn)行建模。然而，這些設(shè)計(jì)中仍然保留有1/3(那就是說，所有ASIC設(shè)計(jì)中的1/9)要求一個(gè)基于多個(gè)FPGA的原型開發(fā)板。[/size] [size=14px]　　在不太遙遠(yuǎn)的過去，對(duì)ASIC設(shè)計(jì)團(tuán)隊(duì)而言，在這...
2014-12-07

--BBS主題帖: ASIC設(shè)計(jì)轉(zhuǎn)FPGA時(shí)需要注意的幾點(diǎn)

[font=微軟雅黑,]FPGA原型驗(yàn)證和其他驗(yàn)證方法是不同的,任何一種其他驗(yàn)證方法都是ASIC驗(yàn)證中的一個(gè)環(huán)節(jié),而FPGA驗(yàn)證卻是一個(gè)過程。由于FPGA與ASIC在結(jié)構(gòu)、性能上各不相同,ASIC是基于標(biāo)準(zhǔn)單元庫,FPGA用的是廠商提供的宏單元模塊,因此首先要進(jìn)行寄存器傳輸級(jí)(RTL)代碼的修改。然后進(jìn)行FPGA器件映射,映射工具...
2014-11-24

--BBS主題帖: Xilinx UltraScale架構(gòu) — 業(yè)界首款A(yù)SIC級(jí)All Programmable架構(gòu)

[color=#000][font=Arial,]現(xiàn)在，人們需要采用一種創(chuàng)新型架構(gòu)來管理數(shù)百Gbps的系統(tǒng)性能，以實(shí)現(xiàn)全線速下的智能處理能力，并擴(kuò)展至Tb級(jí)性能和每秒10億次浮點(diǎn)運(yùn)算水平。實(shí)現(xiàn)上述要求的必要條件并非僅僅是改善每個(gè)晶體管或系統(tǒng)模塊的性能，或者增加系統(tǒng)模塊數(shù)量這么簡(jiǎn)單，而是要從根本上提高通信、時(shí)鐘、關(guān)...
2014-11-16

--BBS主題帖: ASIC和SoC設(shè)計(jì)中嵌入式存儲(chǔ)器的優(yōu)化

[color=#000][font=Arial,]作者: Farzad Zarrinfar [/font][/color] [color=#000][font=Arial,]在傳統(tǒng)的大規(guī)模ASIC和[/font][/color][url=http://www.eechina.com/keyword/SoC]SoC[/url][color=#000][font=Arial,]設(shè)計(jì)中，芯片的物理空間大致可分為用于新的定制邏輯、用于可復(fù)用邏輯(第三方IP或傳統(tǒng)...
2014-11-11

--BBS主題帖: 實(shí)現(xiàn)最優(yōu)的傳感器：ASIC與MEMS協(xié)同設(shè)計(jì)方法

[font=微軟雅黑, Tahoma,]傳感器性能對(duì)MEMS和ASIC參數(shù)的高度依賴性表明，閉環(huán)傳感器的系統(tǒng)級(jí)設(shè)計(jì)需要做大量的折衷考慮，其中的ASIC噪聲預(yù)算、激勵(lì)電壓、功耗和技術(shù)都高度依賴于MEMS參數(shù)。因此為了實(shí)現(xiàn)最優(yōu)的傳感器，強(qiáng)烈推薦基于傳感器總體目標(biāo)規(guī)格的ASIC與MEMS協(xié)同設(shè)計(jì)方法，而不是針對(duì)已經(jīng)設(shè)計(jì)好的ME...
2014-10-15

--BBS主題帖: 多核DSP兼具ASIC和FPGA特性概述

[font=宋體, arial]由于[url=http://www.so.com/s?q=ASIC&ie=utf-8&src=se_lighten]ASIC[/url]解決方案NRE成本高，產(chǎn)品開發(fā)周期較長(zhǎng)，在支持各種不同無線標(biāo)準(zhǔn)升級(jí)上靈活性不足。而FPGA的功耗對(duì)于高速、復(fù)雜運(yùn)算而言要比ASIC和DSP加速器更高，同時(shí)在快速開發(fā)和調(diào)試上也難達(dá)到理想狀態(tài)。基于此，TI近日針...
2014-09-26

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