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--BBS主題帖: 影響FPGA設計中時鐘因素的探討

時鐘是整個電路最重要、最特殊的信號，系統內大部分器件的動作都是在時鐘的跳變沿上進行, 這就要求時鐘信號時延差要非常小, 否則就可能造成時序邏輯狀態出錯；因而明確FPGA設計中決定系統時鐘的因素，盡量較小時鐘的延時對保證設計的穩定性有非常重要的意義。　　[font=微軟雅黑, Tahoma, Helveti...
2015-06-30

--BBS主題帖: ARM上的linux如何實現無線網卡的冷插拔和熱插拔

1. 冷插拔如果在系統上電之前就將[font=Times New Roman]RT2070/RT3070[/font][font=宋體]芯片的無線網卡（以下簡稱[/font][font=Times New Roman]wlan[/font][font=宋體]）插上，即冷插拔。我們通過分析系統啟動流程過程中的運行的腳本，將啟動[/font][font=Times New Roman]wlan[/font][font=宋體]的...
2015-06-30

--BBS主題帖: Verilog語言要素

[color=#333333][font=微軟雅黑, Tahoma,]Verilog HDL 中的標識符 (identifier) 可以是任意一組字母、數字、 $ 符號和 _( 下劃線 ) 符號的組合，但標識符的第一個字符必須是字母或者下劃線。另外，標識符是區分大小寫的。以下是標識符的幾個例子： [/font][/color] [color=#333333][font=微軟雅黑, ...
2015-06-29

--BBS主題帖: 分析TCP/IP協議棧代碼之TCP（STM32平臺） .

[color=#000][font=微軟雅黑][b]1. TCP介紹[/b][/font][/color] [color=#000][font=微軟雅黑]TCP與UDP都屬于傳輸層，但是與UDP不同的是，TCP是面向連接的，可靠的傳輸協議。[/font][/color] [color=#000][font=微軟雅黑]ps：需要找幾篇文章來看看兩者的不同和各自的用武之地了，雖然對下面的代碼分析...
2015-06-29

--BBS主題帖: 基于單片機的復雜可編程邏輯器件快速配置方法

[color=#333333][font=微軟雅黑, Tahoma,]基于SRAM（靜態隨機存儲器）的可重配置PLD（可編程邏輯器件）的出現，為系統設計者動態改變運行電路中PLD的邏輯功能創造了條件。PLD使用SRAM單元來保存配置數據。這些配置數據決定了PLD內部的互連關系和邏輯功能，改變這些數據，也就改變了器件的邏輯功能。由于...
2015-06-28

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