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應(yīng)用開發(fā)

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↓在 論壇帖子 中搜索到 3896 條關(guān)于“CPLD”的信息，用時:0.009 sec.

--BBS主題帖: 基于CPLD的容錯存儲器的設(shè)計實現(xiàn)

[font=Arial, Helvetica, sans-serif, 宋體][b]關(guān)鍵字：[url=http://www.ednchina.com/SEARCH/ART/%B4%E6%B4%A2%C6%F7.HTM]存儲器[/url] [url=http://www.ednchina.com/SEARCH/ART/%C8%DD%B4%ED.HTM]容錯[/url] [url=http://www.ednchina.com/SEARCH/ART/%BE%C0%D2%BB%BC%EC%B6%FE.HTM]糾一檢二[/u...
2014-04-18

--BBS主題帖: 關(guān)于單片機脈沖信號源的CPLD實現(xiàn)方法

[font=Arial,][size=12px]關(guān)鍵詞： [url=http://www.eechina.com/tag-CPLD.html]CPLD[/url] , [url=http://www.eechina.com/tag-%B5%A5%C6%AC%BB%FA.html]單片機[/url] , [url=http://www.eechina.com/tag-%C2%F6%B3%E5%D0%C5%BA%C5%D4%B4.html]脈沖信號源[/url][/size][/font] [font=Arial,][table=9...
2014-04-06

--BBS主題帖: 脈沖信號源的CPLD實現(xiàn)方法

[font=Tahoma, SimSun, Verdana, Arial]單片機產(chǎn)生的脈沖信號源由于是靠軟件實現(xiàn)的，所以輸出頻率及步進受單片機時鐘頻率、指令數(shù)和指令執(zhí)行周期的限制。文中介紹了一種以CPLD為核心的脈沖信號源，脈沖信號源的參數(shù)(頻率、占空比)由工控機通過I／O板卡設(shè)置，設(shè)定的參數(shù)由數(shù)碼管顯示，這種脈沖信號源與其...
2014-04-04

--BBS主題帖: CPLD 在線纜快速測試技術(shù)中的應(yīng)用

[font=Tahoma, SimSun, Verdana, Arial][b]1.引言[/b][/font] [font=Tahoma, SimSun, Verdana, Arial]　　隨著電子技術(shù)的發(fā)展，復(fù)雜可編程邏輯器件CPLD（Complex Programmable Logic Device）以其高速、高可靠以及開發(fā)便捷、規(guī)范、能完成任何數(shù)字器件功能的優(yōu)點[1]，越來越廣泛地應(yīng)用于電子儀器中。 ...
2014-04-03

--BBS主題帖: FPGA/CPLD狀態(tài)機穩(wěn)定性研究

在FPGA/CPLD設(shè)計中頻繁使用的狀態(tài)機,常出現(xiàn)一些穩(wěn)定性問題,本文提出了一些解決方法,實驗表明該方法有效地提高了綜合效率. 隨著大規(guī)模和超大規(guī)模FPGA/CPLD器件的誕生和發(fā)展,以HDL(硬件描述語言)為工具、FPGA/CPLD器件為載體的EDA技術(shù)的應(yīng)用越來越廣泛.從小型電子系統(tǒng)到大規(guī)模SOC(Systemonachip)設(shè)計,已...
2014-04-01

--BBS主題帖: 一種基于CPLD的DSP人機接口模塊設(shè)計 (1)

CPLD(Complex programmable Logic Device，復(fù)雜可編程邏輯器件)是在傳統(tǒng)的PAL、GAL基礎(chǔ)上發(fā)展而來的，具有多種工作方式和高集成、高速、高可靠性等明顯的特點。在超高速領(lǐng)域和實時測控方面有非常廣泛的應(yīng)用，日前的CPLD普遍基于E2PROM和Flash電可擦除技術(shù)，可實現(xiàn)100次以上擦寫循環(huán)。 [b]CPLD選擇及...
2014-03-24

--BBS主題帖: 一種基于CPLD的DSP人機接口模塊設(shè)計

一種基于CPLD的DSP人機接口模塊設(shè)計 (1)CPLD(Complex programmable Logic Device，復(fù)雜可編程邏輯器件)是在傳統(tǒng)的PAL、GAL基礎(chǔ)上發(fā)展而來的，具有多種工作方式和高集成、高速、高可靠性等明顯的特點。在超高速領(lǐng)域和實時測控方面有非常廣泛的應(yīng)用，日前的CPLD普遍基于E2PROM和Flash電可擦除技術(shù)，可實...
2014-03-18

--BBS主題帖: 談?wù)凢PGA與CPLD的區(qū)別

[font=微軟雅黑,]盡管FPGA和CPLD都是可編程ASIC器件,有很多共同特點,但由于CPLD和FPGA結(jié)構(gòu)上的差異,具有各自的特點: ①CPLD更適合完成各種算法和組合邏輯,FP GA更適合于完成時序邏輯。換句話說,FPGA更適合于觸發(fā)器豐富的結(jié)構(gòu),而CPLD更適合于觸發(fā)器有限而乘積項豐富的結(jié)構(gòu)。 ②CPLD的連續(xù)式布線結(jié)構(gòu)決...
2014-02-25

--BBS主題帖: FPGA與CPLD的辨別和分類

[color=#000][font=sans-serif]FPGA與CPLD的辨別和分類主要是根據(jù)其結(jié)構(gòu)特點和工作原理。通常的分類方法是：[/font][/color] [color=#000][font=sans-serif]將以乘積項結(jié)構(gòu)方式構(gòu)成邏輯行為的器件稱為CPLD，如Lattice的ispLSI系列、Xilinx的XC9500系列、Altera的MAX7000S系列和Lattice(原Vantis)的Mac...
2014-02-22

--BBS主題帖: FPGA與CPLD的辨別和分類

[b]關(guān)鍵字：[url=http://www.ednchina.com/SEARCH/ART/FPGA.HTM]FPGA[/url] [url=http://www.ednchina.com/SEARCH/ART/CPLD.HTM]CPLD[/url] [url=http://www.ednchina.com/SEARCH/ART/%BF%C9%B1%E0%B3%CC.HTM]可編程[/url] [url=http://www.ednchina.com/SEARCH/ART/ASIC.HTM]ASIC[/url] [/b] ...
2014-02-21

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