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↓在 論壇帖子 中搜索到 1930 條關于“CASE”的信息，用時:0.004 sec.

--BBS主題帖: 基于FPGA的串行通信控制系統的設計

[font=微軟雅黑, Tahoma,] 基于現場可編程門陣列FPGA的系統開發可以廣泛應用于各行各業，ASIC設計、通信、控制、電力電子等。其主要優點有：設計周期短、功耗低，可實現更高集成度的數字系統和嵌入式系統等。用戶可對FPGA內部的邏輯模塊和I/O模塊重新進行配置，以實現數字邏輯電路以及基于FPGA的SRAM、...
2015-01-19

--BBS主題帖: 消除狀態機毛刺策略探討

[font=微軟雅黑,]隨著EDA技術的高速發展, 以大規模和超大規模器件FPGA/CPLD為載體、以VHDL(硬件描述語言)為工具的電子系統設計越來越廣泛。有限狀態機(簡稱狀態機)作為數字系統控制單元的重要設計方案之一，無論與基于VHDL語言的其他設計方案相比，還是與可完成相似功能的CPU設計方案相比，在運行速度的...
2015-01-19

--BBS主題帖: 詳解FPGA和單片機的串行通信接口設計技巧

[font=微軟雅黑,]現場可編程邏輯器件（FPGA）在高速采集系統中的應用越來越廣，由于FPGA對采集到的數據的處理能力比較差，故需要將其采集到的數據送到其他CPU系統來實現數據的處理功能，這就使FPGA系統與其他CPU系統之間的數據通信提到日程上，得到人們的急切關注。本文介紹利用VHDL語言實現FPGA與單片...
2015-01-19

--BBS主題帖: FPGA設計的基本原則、技巧與時序電路設計

[font=微軟雅黑,]FPGA設計的基本原則[/font] [font=微軟雅黑,]面積與速度折衷原則[/font] [font=微軟雅黑,]面積和速度是ASIC芯片設計中一對相互制約、影響成本和性能的指標，貫穿FPGA設計的始終。在FPGA設計中，面積是指一個設計消耗的FPGA內部邏輯資源的數量，可以用消耗的觸發器和查找表的個數或者...
2015-01-19

--BBS主題帖: 零基礎學FPGA（四）Verilog語法基基礎基礎(中)

作者：小墨同學我們接著上篇文章繼續學習，上次提到了兩種賦值語句，讓我們接著往下學。 1、塊語句塊語句包括兩種，一個是順序塊，一個是并行塊。 (1)順序快順序快就好比[url=http://www.eechina.com/keyword/C語言][color=#0000ff]C語言[/color][/url]里的大括號“{ ...
2015-01-19

--BBS主題帖: 零基礎學FPGA（八）淺談狀態機

作者：小墨同學關于狀態機呢，想必大家應該都接觸過，通俗的講就是數電里我們學的狀態轉換圖。狀態機分為兩中類型，一種叫Mealy型，一種叫Moore型。前者就是說時序邏輯的輸出不僅取決于當前的狀態，還取決于輸入，而后者就是時序邏輯的輸出僅僅取決于當前的狀態。下面兩個圖分別表示兩種不同的狀態...
2015-01-19

--BBS主題帖: verilog學習五點經驗分享

[font=微軟雅黑,]1.規范很重要工作過的朋友肯定知道，公司里是很強調規范的，特別是對于大的設計（無論軟件還是硬件），不按照規范走幾乎是不可實現的。邏輯設計也是這樣：如果不按規范做的話，過一個月后調試時發現有錯，回頭再看自己寫的代碼，估計很多信號功能都忘了，更不要說檢錯了；如果一個項...
2015-01-17

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