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應(yīng)用開發(fā)

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↓在 論壇帖子 中搜索到 3896 條關(guān)于“CPLD”的信息，用時:0.006 sec.

--BBS主題帖: 關(guān)于DSP的CPLD是怎么個回事，求解釋

在做LED實驗，資料說是led是通過CPLD的I/O輸出，但是又沒有相應(yīng)的電路和關(guān)于CPLD的資料，百度了下說DSP以寄存器的方式來控制CPLD的IO口：IO口的對應(yīng)DSP里面的寄存器，有自己的地址。DSP通過對這個地址的寄存器操作來控制IO口。這是什么意思？是不是只要對這個寄存器進(jìn)行設(shè)置就可以控制I/O口的輸出，在...
2014-01-02

--BBS主題帖: 硬件設(shè)計 - 基于單片機(jī)和CPLD的PLC背板總線協(xié)議接口芯片設(shè)計（下）

[font=宋體, arial][b]3.2 基于Verilog HDL 語言的硬件程序設(shè)計[/b][/font] [font=宋體, arial]　　本設(shè)計采用Verilog HDL 語言進(jìn)行協(xié)議芯片的程序設(shè)計，Verilog HDL 語言是一種硬件描述語言，設(shè)計數(shù)字芯片時可以按照層次描述，并可以進(jìn)行時序建模。本設(shè)計采用混合設(shè)計模式，主要設(shè)計的模塊有狀態(tài)機(jī)、...
2014-01-01

--BBS主題帖: 基于單片機(jī)和CPLD的PLC背板總線協(xié)議接口芯片設(shè)計

[font=宋體, arial]　[b]摘要：[/b]設(shè)計了一組基于CPLD的PLC背板總線協(xié)議接口芯片，協(xié)議芯片可以區(qū)分PLC的背板總線的周期性數(shù)據(jù)和非周期性數(shù)據(jù)。詳細(xì)介紹了通過Verilog HDL語言設(shè)計狀態(tài)機(jī)、協(xié)議幀控制器、FIFO控制器的過程，25MHz下背板總線工作穩(wěn)定的試驗結(jié)果驗證了協(xié)議芯片設(shè)計的可行性。[/font] [f...
2014-01-01

--BBS主題帖: 單片機(jī)驅(qū)動CPLD的PWM正弦信號發(fā)生器設(shè)計

[font=宋體, Georgia, verdana, serif]前面幾期給讀者介紹了單片機(jī)+CPLD 系統(tǒng)設(shè)計，本篇繼續(xù)挖掘CPLD 潛力，給出一種單片機(jī)驅(qū)動CPLD的PWM 正弦信號發(fā)生器設(shè)計，充分體現(xiàn)了CPLD 的靈活多變，配合單片機(jī)控制，其妙無窮，以下方案均在Mini51 板上實現(xiàn)。[/font] [font=宋體, Georgia, verdana, serif]脈寬...
2013-12-20

--BBS主題帖: 單片機(jī)驅(qū)動CPLD的PWM正弦信號發(fā)生器設(shè)計

[font=Arial, Helvetica, sans-serif, 宋體][b]關(guān)鍵字：單片機(jī) CPLD PWM 信號發(fā)生器 [/b][/font] [font=Arial, Helvetica, sans-serif, 宋體]本文將挖掘CPLD潛力，給出一種[b][color=#FF3399][u]單片機(jī)[/u][/color][/b]驅(qū)動CPLD的PWM正弦信號發(fā)生器設(shè)計，充分體現(xiàn)了CPLD的靈活多變，配合單片機(jī)...
2013-11-27

--BBS主題帖: DSP與CPLD的智能變電站電網(wǎng)IED設(shè)計

　隨著新技術(shù)的不斷發(fā)展，數(shù)字化變電站正在興起。在智能電網(wǎng)規(guī)劃的推動下，未來數(shù)字化變電站將成為新建變電站的主流。眾所周知，電網(wǎng)信號量極多且相關(guān)性很強(qiáng)，這給采集計算和實時監(jiān)測帶來了很大的麻煩。為了解決這一問題。本文的設(shè)計師基于DSP和CPLD搭建的智能IED（Intelligent Electronic Device，智能...
2013-07-21

--BBS主題帖: 基于CPLD的服務(wù)機(jī)器人的視覺系統(tǒng)設(shè)計 (1)

隨著計算機(jī)科學(xué)和自動控制技術(shù)的發(fā)展，越來越多的不同種類的智能機(jī)器人出現(xiàn)在工廠、生活當(dāng)中，機(jī)器人視覺系統(tǒng)作為智能機(jī)器人系統(tǒng)中一個重要的子系統(tǒng)，也越來越受到人們的重視。它涉及了圖像處理、模式識別和視覺跟蹤等領(lǐng)域。不同種類的機(jī)器人由于工作的重點不一樣，它的視覺系統(tǒng)在軟件或硬件上都有著細(xì)...
2013-06-15

--BBS主題帖: CPLD在信號濾波和抗干擾中的應(yīng)用 (1)

1 濾波和抗干擾概述單片機(jī)應(yīng)用系統(tǒng)的輸入信號常含有種種噪聲和干擾，它們來自被測信號源、傳感器、外界干擾源等。為了提高測量和控制精度，必須消除信號中的噪聲和干擾。噪聲有兩大類：一類為周期性的;另一類為不規(guī)則的。前者的典型代表為50Hz的工頻干擾，一般采用硬件濾波，使用積分時間等于20ms的整...
2013-06-15

--BBS主題帖: 基于CPLD的水輪發(fā)電機(jī)組轉(zhuǎn)速監(jiān)控系統(tǒng)的設(shè)計 (1)

[b]摘　要：[/b]給出了采用[url=http://www.eeworld.com.cn/FPGA/search.php?keywords=CPLD&search=1][color=#0000ff]CPLD[/color][/url]的水輪發(fā)電機(jī)組轉(zhuǎn)速[url=http://www.eeworld.com.cn/FPGA/search.php?keywords=監(jiān)控系統(tǒng)&search=1][color=#0000ff]監(jiān)控系統(tǒng)[/color][/url]的設(shè)計原理和VHDL的語言描...
2013-06-15

--BBS主題帖: 基于CPLD的串并轉(zhuǎn)換和高速USB通信設(shè)計 (1)

濾波和抗干擾是任何智能儀器系統(tǒng)都必須考慮的問題。在傳統(tǒng)的應(yīng)用系統(tǒng)中，濾波部分往往要占用較多的軟件資源和硬件資源。復(fù)雜可編程邏輯器件(CPLD)的出現(xiàn)，為解決這一問題開辟了新的途徑，采用[url=http://www.eeworld.com.cn/FPGA/search.php?keywords=CPLD&search=1][color=#0000ff]CPLD[/color][/url...
2013-06-15

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