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應(yīng)用開(kāi)發(fā)

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--BBS主題帖: DVB-S射頻調(diào)制的FPGA實(shí)現(xiàn)

[font=微軟雅黑,]摘要：一種采用AD9789與FPGA相結(jié)合，在FPGA上實(shí)現(xiàn)全數(shù)字QPSK射頻調(diào)制的方案。介紹了AD9789的接口設(shè)計(jì)及配置流程，并給出了設(shè)計(jì)實(shí)例。 DVB-S標(biāo)準(zhǔn)只是規(guī)定了信道編碼及調(diào)制方式，沒(méi)有提供具體的射頻調(diào)制方案，DVB-S標(biāo)準(zhǔn)要求載波的頻率范圍為950 MHz-2150 MHz，由于受到FPGA內(nèi)部資源運(yùn)算...
2015-01-19

--BBS主題帖: 如何發(fā)現(xiàn)并解決FPGA設(shè)計(jì)中的時(shí)序問(wèn)題

[font=微軟雅黑,]耗費(fèi)數(shù)月精力做出的設(shè)計(jì)卻無(wú)法滿(mǎn)足時(shí)序要求，這確實(shí)非常令人傷心。然而，試圖正確地對(duì)設(shè)計(jì)進(jìn)行約束以保證滿(mǎn)足時(shí)序要求的過(guò)程幾乎同樣令人費(fèi)神。找到并確定時(shí)序約束本身通常也是非常令人頭痛的問(wèn)題。[/font] [font=微軟雅黑,]時(shí)序問(wèn)題的惱人之處在于沒(méi)有哪種方法能夠解決所有類(lèi)型的問(wèn)題...
2015-01-19

--BBS主題帖: 基于Xilinx FPGA的千兆以太網(wǎng)及E1信號(hào)的光纖傳輸

[font=微軟雅黑,]目前，隨著多媒體應(yīng)用的普及，千兆位以太網(wǎng)已經(jīng)發(fā)展成為主流網(wǎng)絡(luò)技術(shù)。大到成千上萬(wàn)人的大型企業(yè)，小到幾十人的中小型企業(yè)，在建設(shè)企業(yè)局域網(wǎng)時(shí)都會(huì)把千兆位以太網(wǎng)技術(shù)作為首選的高速網(wǎng)絡(luò)技術(shù)。千兆位以太網(wǎng)技術(shù)甚至正在取代ATM技術(shù)，成為城域網(wǎng)建設(shè)的主力軍。[/font] [font=微軟雅黑...
2015-01-17

--BBS主題帖: 基于FPGA平臺(tái)的抗DPA攻擊電路級(jí)防護(hù)技術(shù)研究

[font=微軟雅黑,]來(lái)源：現(xiàn)代電子技術(shù) 作者：王創(chuàng)偉原亮丁國(guó)良尹文龍常小龍引言[/font] [font=微軟雅黑,]近年來(lái)，現(xiàn)場(chǎng)可編程門(mén)陣列(Field Programmable Gate Array，F(xiàn)PGA)由于其高性能、低價(jià)格、高開(kāi)發(fā)速度、方便的編程方式等特點(diǎn)得到了廣泛的應(yīng)用。但對(duì)FPGA進(jìn)行DPA(Differential Power Analysi...
2015-01-17

--BBS主題帖: 基于賽靈思FPGA的航空總線協(xié)議接口設(shè)計(jì)

[font=微軟雅黑,][img=600,400]http://xilinx.eetrend.com/files-eetrend-xilinx/imagecache/image600/article/201003/566-787-boeing787.jpg[/img] 數(shù)據(jù)總線是飛機(jī)航電系統(tǒng)中首先運(yùn)用的數(shù)字電子設(shè)備之一，其典型代表是飛機(jī)內(nèi)部時(shí)分制指令／響應(yīng)式多路傳輸數(shù)據(jù)總線MIL-STD-1553B(簡(jiǎn)稱(chēng)1553B)。它利...
2015-01-17

--BBS主題帖: 基于賽靈思Virtex-5的音視頻監(jiān)視系統(tǒng)設(shè)計(jì)

[font=微軟雅黑,]本文探討在Virtex-5 FPGA中實(shí)現(xiàn)設(shè)計(jì)的一些難題，然后用一個(gè)項(xiàng)目作為示范來(lái)詳解充分利用其功能集的技法。設(shè)計(jì)過(guò)程包括幾個(gè)步驟，從針對(duì)應(yīng)用選擇適合的Virtex-5開(kāi)始。為便于本文敘述，我們假定IP模塊已經(jīng)過(guò)匯編，并且已經(jīng)就緒備用或已經(jīng)用CORE Generator生成。[/font] [font=微軟雅黑,]...
2015-01-17

--BBS主題帖: 淺析FPGA Editor如何提升設(shè)計(jì)效率

[font=微軟雅黑,][color=#FD8900]賽靈思資深現(xiàn)場(chǎng)應(yīng)用工程師Clayton Cameron與您分享ISE工具套件中他最喜歡的工具FPGA Editor的使用技巧[/color] Clayton Cameron 賽靈思公司（Xilinx, Inc.）資深現(xiàn)場(chǎng)應(yīng)用工程師 [email=clayton.cameron@xilinx.com]clayton.cameron@xilinx.com[/email][/font] [font=...
2015-01-17

--BBS主題帖: 利用賽靈思ISE功耗估算工具XPower實(shí)現(xiàn)低功耗FPGA電子系統(tǒng)優(yōu)化技巧與方法

[font=微軟雅黑,]作者：萬(wàn) 娟，武杰，孔陽(yáng)，謝明璞來(lái)源：電子技術(shù)應(yīng)用本文首先與實(shí)測(cè)系統(tǒng)功耗進(jìn)行對(duì)比，驗(yàn)證了Xilinx公司ISE軟件包中FPGA功耗估算工具XPower的準(zhǔn)確性。然后對(duì)FPGA設(shè)計(jì)中影響系統(tǒng)功耗的幾個(gè)相互關(guān)聯(lián)的參數(shù)進(jìn)行取樣，通過(guò)軟件估算不同樣點(diǎn)下的系統(tǒng)功耗，找到功耗最低的取樣點(diǎn)，得到...
2015-01-17

--BBS主題帖: 技巧分享：Xilinx FPGA全局時(shí)鐘和第二全局時(shí)鐘資源的使用方法

[font=微軟雅黑,]目前，大型設(shè)計(jì)一般推薦使用同步時(shí)序電路。同步時(shí)序電路基于時(shí)鐘觸發(fā)沿設(shè)計(jì)，對(duì)時(shí)鐘的周期、占空比、延時(shí)和抖動(dòng)提出了更高的要求。為了滿(mǎn)足同步時(shí)序設(shè)計(jì)的要求，一般在FPGA設(shè)計(jì)中采用全局時(shí)鐘資源驅(qū)動(dòng)設(shè)計(jì)的主時(shí)鐘，以達(dá)到最低的時(shí)鐘抖動(dòng)和延遲。 FPGA全局時(shí)鐘資源一般使用全銅層工藝實(shí)...
2015-01-17

--BBS主題帖: 基于FPGA的動(dòng)態(tài)可重構(gòu)系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

[font=微軟雅黑,]引言[/font] [font=微軟雅黑,]由于數(shù)字邏輯系統(tǒng)功能復(fù)雜化的需求，單片系統(tǒng)的芯片正朝著超大規(guī)模、高密度的方向發(fā)展。對(duì)于一個(gè)大規(guī)模的數(shù)字系統(tǒng)而言，系統(tǒng)規(guī)模是基于各種邏輯功能模塊的組合。但是，無(wú)論是時(shí)序邏輯系統(tǒng)，還是組合邏輯系統(tǒng)，或者組合／時(shí)序混合系統(tǒng)，從時(shí)間軸上來(lái)看，...
2015-01-17

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