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應(yīng)用開發(fā)

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--BBS主題帖: 構(gòu)建以軟件為中心的下一代自動(dòng)化測(cè)試系統(tǒng)

[font=微軟雅黑, Tahoma,]1.緒論：自動(dòng)化測(cè)試系統(tǒng)的設(shè)計(jì)挑戰(zhàn) 測(cè)試管理人員和工程師們?yōu)榱吮ＷC交付到客戶手中的產(chǎn)品質(zhì)量和可靠性，在各種應(yīng)用領(lǐng)域（從設(shè)計(jì)驗(yàn)證，經(jīng)終端產(chǎn)品測(cè)試，到設(shè)備維修診斷）都采用自動(dòng)化測(cè)試系統(tǒng)。他們使用自動(dòng)測(cè)試系統(tǒng)執(zhí)行簡(jiǎn)單的“通過(guò)”或“失敗”測(cè)試，或者通過(guò)它執(zhí)行一整套...
2014-12-14

--BBS主題帖: 基于儀器集成的幅頻特性測(cè)量?jī)x設(shè)計(jì)方案

[font=微軟雅黑, Tahoma,]本文以DDS函數(shù)信號(hào)源、數(shù)字示波器和普通計(jì)算機(jī)作為硬件平臺(tái)，在計(jì)算機(jī)上配置LabVIEW 8.6程序，控制函數(shù)信號(hào)源產(chǎn)生測(cè)試所需掃頻信號(hào)，由數(shù)字示波器采集掃頻信號(hào)和測(cè)試網(wǎng)絡(luò)的響應(yīng)信號(hào)，最后經(jīng)計(jì)算機(jī)分析計(jì)算和顯示，較好地實(shí)現(xiàn)了幅頻特性測(cè)量。 0引言頻率特性是電路網(wǎng)絡(luò)的...
2014-12-14

--BBS主題帖: 如何驗(yàn)證和分析復(fù)雜的串行總線鏈路模型

[font=微軟雅黑, Tahoma,]信號(hào)的更快傳輸速度和不斷縮小的幾何形狀要求有強(qiáng)大的數(shù)據(jù)鏈路應(yīng)用程序來(lái)支持在實(shí)時(shí)示波器上進(jìn)行實(shí)況波形建模、測(cè)量和仿真。在設(shè)計(jì)方面，發(fā)射器和接收器位置采用先進(jìn)均衡技術(shù)來(lái)應(yīng)對(duì)這些挑戰(zhàn)的趨勢(shì)。更小的形狀因子使信號(hào)存取更加困難，成為非理想的探測(cè)點(diǎn)。這會(huì)導(dǎo)致由于阻抗間...
2014-12-12

--BBS主題帖: FPGA并行計(jì)算抽象接口的設(shè)計(jì)與實(shí)現(xiàn)

[font=微軟雅黑, Tahoma,][b]1 設(shè)計(jì)摘要[/b][/font] [font=微軟雅黑, Tahoma,]FPGA芯片具有可編程、可重配置、可并行計(jì)算的特點(diǎn)。隨著摩爾定律的發(fā)展，計(jì)算科學(xué)已經(jīng)步入并行化的時(shí)代，具有并行處理能力的CPU/GPU隨即面世。而FPGA芯片憑借其并行計(jì)算的能力，已經(jīng)可以輕松將科學(xué)計(jì)算、邏輯運(yùn)算、ASIC設(shè)計(jì)...
2014-12-10

--BBS主題帖: 程序猿們遇福音，可輕松開發(fā)令硬件工程師望而生畏的FPGA

[font=微軟雅黑,][color=#FF8000]SDAccel開發(fā)環(huán)境系統(tǒng)程序員也可以開發(fā)令硬件工程師望而生畏的FPGA 作者張國(guó)斌[/color] 猜猜以下三個(gè)場(chǎng)景和什么器件有關(guān)？場(chǎng)景一、老王吃了一頓自認(rèn)為有史以來(lái)最好吃的涼皮，莫名亢奮的他用手機(jī)拍下涼皮的照片并分享到微信上。場(chǎng)景二、遠(yuǎn)隔千里的老張看到了老王的...
2014-12-10

--BBS主題帖: 使用毫米波蜂窩系統(tǒng)鋪就5G無(wú)線之路

[font=微軟雅黑,]無(wú)線消費(fèi)者對(duì)帶寬的巨大需求刺激了公共和私營(yíng)部門前所未有的投資，以探索新的方法來(lái)提高網(wǎng)絡(luò)容量以及滿足不斷增長(zhǎng)的需求。業(yè)內(nèi)分析師預(yù)測(cè)需求將會(huì)超過(guò)容量，這只是時(shí)間的問題。無(wú)線研究人員不斷提出各種觀點(diǎn)來(lái)解決容量挑戰(zhàn)，并尋求一種網(wǎng)絡(luò)拓?fù)浣Y(jié)構(gòu)，既可解決容量問題，也可提供以前認(rèn)...
2014-12-10

--BBS主題帖: FPGA開發(fā)全攻略連載之七：底層內(nèi)嵌功能單元與軟核、硬核以及固核

[font=微軟雅黑,]6、底層內(nèi)嵌功能單元內(nèi)嵌功能模塊主要指DLL(Delay Locked Loop)、PLL(Phase Locked Loop)、DSP 等軟處理核(Soft Core)。現(xiàn)在越來(lái)越豐富的內(nèi)嵌功能單元，使得單片F(xiàn)PGA 成為了系統(tǒng)級(jí)的設(shè)計(jì)工具，使其具備了軟硬件聯(lián)合設(shè)計(jì)的能力，逐步向SOC 平臺(tái)過(guò)渡。[/font] [font=微軟雅黑,]DLL 和...
2014-12-07

--BBS主題帖: FPGA開發(fā)全攻略連載之九：FPGA主要供應(yīng)商與產(chǎn)品(2)

[font=微軟雅黑,](4)Spartan-3A/3ADSP/3AN系列[/font] [font=微軟雅黑,]Spartan-3A在Spartan-3和Spartan-3E平臺(tái)的基礎(chǔ)上，整合了各種創(chuàng)新特性幫助客戶極大地削減了系統(tǒng)總成本。利用獨(dú)特的器件DNA ID技術(shù)，實(shí)現(xiàn)業(yè)內(nèi)首款FPGA電子序列號(hào)；提供了經(jīng)濟(jì)、功能強(qiáng)大的機(jī)制來(lái)防止發(fā)生竄改、克隆和過(guò)度設(shè)計(jì)的現(xiàn)象...
2014-12-07

--BBS主題帖: GPS技術(shù)基礎(chǔ)及GPS接收器測(cè)試(上)

[font=微軟雅黑, Tahoma,][b]概況[/b] 從波音747客機(jī)的導(dǎo)航操作、汽車駕駛每天都會(huì)使用的GPS導(dǎo)航系統(tǒng)，到尋寶者要找到深藏于森林某處的寶藏，GPS技術(shù)已經(jīng)迅速融入于多種應(yīng)用中。正當(dāng)創(chuàng)新技術(shù)不斷提升GPS接收器效能的同時(shí)，相關(guān)的技術(shù)特性亦越來(lái)越完整。時(shí)至今日，軟件甚至可建立GPS波形，以精確...
2014-12-06

--BBS主題帖: 業(yè)界最節(jié)能的64位基于ARM的處理器

[font=Arial, Helvetica, sans-serif, 宋體][b]關(guān)鍵字：四核處理器 ARM Cortex-A53 虛擬網(wǎng)絡(luò) 飛思卡爾 [/b][/font] [font=Arial, Helvetica, sans-serif, 宋體]2014年10月21日，加利福尼亞州圣克拉拉（Linley Tech處理器大會(huì)）訊－[b]飛思卡爾[/b]半導(dǎo)體日前宣布推出QorIQ LS1043A[url=http://...
2014-12-04

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