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↓在 論壇帖子 中搜索到 416 條關于“SDI”的信息，用時:0.002 sec.

--BBS回帖(查看原帖)

2407 DAC714 SPISIMO 串行數據 SDI SPISTE* SPI選通 A0 UP/ SPISOMI A1* SPICLK 串行時鐘 SPICLK ，SPI時鐘模式應為下降沿，無延時。即SPI在時鐘下降沿發送數據，在時鐘...
2009-07-10

--BBS主題帖: 一些FPGA ip資料

有興趣可找我。私下聯系。 MSN: microcrk{at}gmail.com誠心交流，想騙資料的就不要來了。基本列表如下（沒有的也可以問我）：mjpeg2D FIR Filter2D Median Filter8B10B Encoder/DecoderAlpha Blending MixerASICIC CompilerColor Space ConverterCRC CompilerChroma ResamplerDDR & DDR2 SDRAM Con...
2009-06-14

--BBS主題帖: 常用PIC系列8位單片機芯片引腳符號的功能

　　一、關于I/O口符號　PIC單片機系列封裝引腳最少的是8引腳(如PIC12C5XX和PIC12C6XX)，多的可達84引腳(如PIC17C76X)，其中I/O(輸入/輸出)口線按PIC單片機產品型號不同，其口線數量也不相同。8腳封裝的I/O口線是6根線，而84腳封裝的I/O線多達66根線。這些口線符號分別按英文字母順序排列編號，簡稱A口...
2009-02-09

--BBS主題帖: 這是一篇很好的文章，學verilog的可以好好看看

規范很重要工作過的朋友肯定知道，公司里是很強調規范的，特別是對于大的設計（無論軟件還是硬件），不按照規范走幾乎是不可實現的。邏輯設計也是這樣：如果不按規范做的話，過一個月后調試時發現有錯，回頭再看自己寫的代碼，估計很多信號功能都忘了，更不要說檢錯了；如果一個項目做了一半一個人走...
2009-02-01

--BBS回帖(查看原帖)

謝謝斑竹。控制模塊中的從SPI的接口Verilog代碼我看過了，就是在時鐘的上升沿從SDI（跟NiosII中的MOSI連接）讀入數據，在時鐘的下降沿從SDO（與MISO連接）輸出數據，而根據接收到的前2個字節判斷是寫還是讀。Nios中關于SPI核的講解也就是一些關于數據寄存器，status，control，slaveselect寄存器的說明...
2008-08-25

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