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↓在 論壇帖子 中搜索到 73 條關于“PCIExpress”的信息，用時:0.002 sec.

--BBS主題帖: 日益嚴重的信號完整性問題

[font=Arial, Helvetica, sans-serif, 宋體][size=14px][b]關鍵字：PCIExpress 串擾 EMI 信號完整性 [/b][/size][/font] [font=Arial, Helvetica, sans-serif, 宋體][size=14px]提示: . 向更高速和更高信號頻率的每次新進步，都使總線對信號失真和異常更加敏感，這些異常可能破壞吞吐量并造成...
2014-05-20

--BBS主題帖: Xilinx運用FPGA進行控制及數據平面視頻處理方案

[font=Tahoma, SimSun, Verdana, Arial][size=12px]嵌入式設計人員面臨的最大挑戰之一就是界定系統的性能需求。用以確定實際性能需求所需的信息要么無法獲取，要么難以獲得。最精確的估算有時也會因無法預料的計算負荷而失效。分析通常會指出，對于數據處理需求而言嵌入式處理系統的成本效益太低。因此...
2014-05-07

--BBS主題帖: i.mx6x高速傳輸通道的研發和運用

[font=宋體][size=10.5pt]目前，由于千兆網絡擁有最高的性價比優勢，千兆網絡以太網芯片技術的突飛猛進，設備提供商提供端到端的整體千兆網絡解決方案，以及在未來網絡應用中千兆網絡所無可比擬的優勢地位等，已在預示著當前千兆網絡應用的廣泛普及已成燎原之勢，并將為健全將來用戶的網絡奠定堅實的基...
2014-04-23

--BBS主題帖: FPGA技術在視頻處理領域的應用

[align=left][font=宋體, Arial, Helvetica, sans-serif][size=14px]視頻處理是目前多媒體[/size][/font][/align][color=#336699][align=left][font=宋體, Arial, Helvetica, sans-serif][size=14px]領域[/size][/font][/align][/color][color=#666666][align=left][font=宋體, Arial, Helvetica, sans...
2014-04-22

--BBS主題帖: 運用FPGA進行控制平面/數據平面視頻處理

[align=left][font=宋體, Arial, Helvetica, sans-serif][size=14px][color=#336699]嵌入式[/color][/size][/font][/align][align=left][font=宋體, Arial, Helvetica, sans-serif][size=14px]設計人員面臨的最大挑戰之一就是界定系統的性能需求。用以確定實際性能需求所需的信息要么無法獲取，要么難以...
2014-04-22

--BBS主題帖: 運用FPGA進行控制平面/數據平面視頻處理

[font=Arial][size=8.5pt]嵌入式設計人員面臨的最大挑戰之一就是界定系統的性能需求。用以確定實際性能需求所需的信息要么無法獲取，要么難以獲得。最精確的估算有時也會因無法預料的計算負荷而失效。分析通常會指出，對于數據處理需求而言嵌入式處理系統的成本效益太低。因此，系統設計人員高度渴望擁...
2014-04-20

--BBS主題帖: 基于賽靈思Virtex-5的PCI ExPress總線傳輸視頻采集系統方案實現

[b]摘要：本文[/b]提出了基于PCI Express總線傳輸的視頻采集系統設計方案。采用ADV7188進行視頻解碼，能夠采集多種格式模擬視頻信號，而且提高視頻信號的質量；采用Virtex-5系列的[b][url=http://xilinx.eetrend.com/][u][color=#0066cc]FPGA[/color][/u][/url][/b]使系統設計靈活、集成度高且易升級。...
2014-04-17

--BBS主題帖: 日益嚴重的信號完整性問題

[font=Arial, Helvetica, sans-serif, 宋體][b]關鍵字：PCIExpress 串擾 EMI 信號完整性 [/b][/font] [font=Arial, Helvetica, sans-serif, 宋體]提示: . 向更高速和更高信號頻率的每次新進步，都使總線對信號失真和異常更加敏感，這些異常可能破壞吞吐量并造成系統堵塞。“并行化的串行”標準...
2014-04-12

--BBS主題帖: 基于賽靈思（xilinx）Virtex-5的音視頻監視系統設計

本文探討在Virtex-5 FPGA中實現設計的一些難題，然后用一個項目作為示范來詳解充分利用其功能集的技法。設計過程包括幾個步驟，從針對應用選擇適合的Virtex-5開始。為便于本文敘述，我們假定IP模塊已經過匯編，并且已經就緒備用或已經用CORE Generator生成。 [b]　　針對應用選擇適合的器件[/b] 　　...
2014-04-09

--BBS主題帖: 基于賽靈思FPGA實現的高速串行交換模塊實現方法研究

[color=#0000c6]來源：電子技術應用作者：汪精華胡善清龍騰[/color] 隨著FPGA應用范圍的不斷擴大以及對速度需求的不斷提升，集成高速串行模塊的FPGA已經應用于市場。以Xilinx的Virtex5系列為代表的集成GTPRocketIO模塊的FPGA受到廣泛關注。以XC5LX50T為例，這款FPGA集成了一個PCIE的Endpoint以及1...
2014-03-27

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