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↓在 論壇帖子 中搜索到 461 條關于“SerDes”的信息，用時:0.002 sec.

--BBS主題帖: Altera Stratix II GX FPGA提供50-Gbps SFI-5接口

Altera宣布，帶有嵌入式收發器的Stratix II GX FPGA支持SERDES成幀器接口Level 5 (SFI-5)標準，為高性能光通信應用提供40至50-Gbps接口。SFI-5規范是芯片至芯片標準，保證了前向糾錯(FEC)技術、成幀器以及業界最佳光轉發器之間的通用性。硬件測試驗證了Stratix II GX FPGA符合SFI-5標準，其20個高速串行...
2008-01-30

--BBS主題帖: Altera Stratix II GX FPGA提供50-Gbps SFI-5接口

Altera公司今天宣布，帶有嵌入式收發器的Stratix?II GX FPGA支持SERDES成幀器接口Level 5 (SFI-5)標準，為高性能光通信應用提供40至50-Gbps接口。
2008-01-29

--BBS回帖(查看原帖)

SERDES測試與眼圖由于抖動是SERDES系統中的一個主要挑戰，因此它也是測試和測量的關鍵所在。通過把高性能的示波器連接到SERDES信號來測量抖動，并觀察“數據眼圖”(或眼圖)。對于一個給定的差分對，眼圖僅僅是由多個狀態轉換的波形圖疊加而成。采樣窗應足夠寬，能夠包含圖中的兩個交叉點。最終得到...
2008-01-22

--BBS主題帖: IDT 推出針對嵌入式市場的串行 RapidIO交換器

IDT推出新的可滿足采用 DSP、FPGA 或處理器等嵌入式應用互連需求的器件系列——中央包交換器（central packet switches，CPS）。該 CPS 解決方案采用自主第三代 IDT SERDES 和串行 RapidIO核心交換技術，能夠以極具競爭力的價格為客戶提供更加卓越的靈活性、可擴展性、性能和功耗。這些最先進的交換...
2007-11-12

--BBS主題帖: 四大FPGA供應商專家談FPGA設計訣竅

四大FPGA供應商專家談FPGA設計訣竅Actel、Altera、Lattice Semiconductor和Xilinx是目前業界最主要的四大FPGA供應商，為了幫助中國的應用開發工程師更深入地了解FPGA的具體設計訣竅，我們特別邀請到了Altera系統應用工程部總監Greg Steinke、Xilinx綜合方法經理Frederic Rivoallon、Xilinx高級技術市場...
2007-11-06

--BBS主題帖: 飛兆專為內置相機便攜式產品設計的串行/解串器

飛兆半導體推出首款專為便攜式產品(如內置相機的手機)中常見數百萬像素分辨率CMOS和CCD圖像傳感器的高速信號串行化而設的μSerDes器件FIN212AC。利用飛兆半導體專有的CTL I/O來串行速度高達40MHz的12位信號，FIN212AC可以配置成為串行器或解串器，并成對工作。飛兆半導體專利的CTL 技術無需同類高速信號...
2007-05-09

--BBS主題帖: Maxim推出21位DC平衡的LVDS解串器MAX9254

Maxim推出高速LVDS SERDES系列產品的最新成員 — MAX9254熱插拔，強輸出驅動，21位，直流平衡的LVDS解串器，具有可編程頻譜擴展功能。該器件將輸出時鐘和數據擴展到±2%或±4%，降低了EMI。MAX9254將連線數由22減少至8，簡化了設計，節省了空間，同時降低了系統內部互連(例如電纜和背板)的成本。MAX9...
2006-12-11

--BBS回帖(查看原帖)

中科虹霸急聘北京中科虹霸科技有限公司位于中關村高新技術園區，是中國科學院自動化研究所持股公司，于2006年成立，專業從事生物特征識別技術以及信息安全技術的研究、產品開發與成果轉化，是完全擁有自主知識產權的創新型企業。中科虹霸在生物認證技術方面，尤其是虹膜識別核心算法方面具有超過8年的技...
2006-11-09

--BBS主題帖: [推薦]PMC-Sierra推出高容量單芯片光纖接入匯聚方案

PMC-Sierra推出PM5336 ARROW 2488，這是一款具有多種功能的高容量單芯片方案，該方案集成了多速率SONET/SDH成幀器、非阻斷STS/AU與VT/TU互聯，以及一流的背板SERDES，可用于下一代結構緊湊且可擴展升級的基于機架的SONET/SDH平臺。運營商目前正積極推動匯聚網絡應用，以便更有效管理新型以太網服務和現...
2006-11-08

--BBS回帖(查看原帖)

ChipSync is a technology in every I/O of Virtex-4 and Virtex-5 devices. It helps designers to effectively implement source synchronous interface (e.g DDR2, SPI4) easily. In short, ChipSync includes: 1) Input delay chain in every I/O, so that designers can adjust the delay elemen...
2006-07-11

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