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應(yīng)用開發(fā)

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↓在 論壇帖子 中搜索到 8054 條關(guān)于“Xilinx”的信息，用時(shí):0.006 sec.

--BBS主題帖: Xilinx Vivado 2014.1版推出，器件運(yùn)行時(shí)間平均縮短達(dá)25%

[font=Arial, tahoma, Verdana][size=12px][size=14px][i]新增自動(dòng)化UltraFast設(shè)計(jì)方法和OpenCL硬件加速功能，可有效加速7系列和UltraScale All Programmable器件的運(yùn)行時(shí)間，提供更佳的結(jié)果質(zhì)量（QoR）和更強(qiáng)大的OpenCL內(nèi)核支持，并實(shí)現(xiàn)自動(dòng)化的UltraFast設(shè)計(jì)方法。[/i] 北京2014年4月17日-- All ...
2014-04-20

--BBS主題帖: Xilinx FPGA芯片設(shè)計(jì)細(xì)節(jié)首曝光

這篇文章是關(guān)于如何實(shí)現(xiàn)FPGA設(shè)計(jì)的低功率運(yùn)行。這是一個(gè)全球性的問題，因?yàn)?，這對(duì)無線、軍用移動(dòng)設(shè)備和航空應(yīng)用等依賴于電池電源的產(chǎn)品來說是非常重要的。這一類的應(yīng)用覆蓋了飛機(jī)、無人機(jī)和前線士兵等通信設(shè)備。這是一篇綱要，是關(guān)于最新的7系列FPGA在開發(fā)周期的每個(gè)階段中的低功率設(shè)計(jì)技術(shù)的。功率問...
2014-04-19

--BBS主題帖: 直接擴(kuò)頻通信同步系統(tǒng)的xilinx FPGA設(shè)計(jì)與實(shí)現(xiàn)

[b]來源：[url=http:///][u][color=#0066cc]電子設(shè)計(jì)工程[/color][/u][/url] 作者：王鵬宇，柳震，張野[/b] 摘要：對(duì)直接擴(kuò)頻通信同步系統(tǒng)進(jìn)行了研究，使用PN碼作為擴(kuò)頻序列，利用其良好的自相關(guān)性，提出一種新式的滑動(dòng)相關(guān)法使收發(fā)端同步，并給出該系統(tǒng)的FPGA實(shí)現(xiàn)方法。利用ISE 10．1開發(fā)軟件仿真驗(yàn)...
2014-04-18

--BBS主題帖: 堆疊與載入：Xilinx SSI、 28Gbps I/O 打造令人驚嘆的FPGA

[color=#0000c6]作者: Mike Santarini Xcell 雜志發(fā)行人賽靈思公司 [email=mike.santarini@xilinx.com][color=#086782]mike.santarini@xilinx.com[/color][/email] 超越摩爾定律的堆疊硅片互聯(lián)技術(shù)和28Gbps 收發(fā)器引領(lǐng) FPGA 創(chuàng)新的新時(shí)代[/color] 賽靈思最近推出了兩款最新創(chuàng)新技術(shù)，進(jìn)一步擴(kuò)展了 F...
2014-04-16

--BBS主題帖: Xilinx FPGA的快速啟動(dòng)

作者: Joachim Meyer 博士生卡爾斯魯厄技術(shù)研究所 [email=joachim.meyer@kit.edu][color=#086782]joachim.meyer@kit.edu[/color][/email] Juanjo Noguera 高級(jí)研究工程師 Xilinx公司 [email=juanjo.noguera@xilinx.com][color=#086782]juanjo.noguera@xilinx.com[/color][/email] Rodney Stewart 汽...
2014-04-16

--BBS主題帖: 評(píng)XILINX的28nm從三重氧化物到HIGH-K

本文用普通用戶看得懂的語言介紹前兩天XILINX發(fā)布的28nm的FPGA將采用TSMC的HIGH-K金屬柵工藝（HKMG)新聞的重大意義。近10年來，當(dāng)集成電路進(jìn)入亞微米階段，當(dāng)人們享受到摩爾定律帶來的好處時(shí)，一朵烏云，一直籠罩在集成電路業(yè)界的上空，就是越來越嚴(yán)重的跑冒滴漏現(xiàn)象。作為集成電路的最基本組成單元...
2014-04-14

--BBS主題帖: 基于賽靈思（xilinx）Virtex-5的音視頻監(jiān)視系統(tǒng)設(shè)計(jì)

本文探討在Virtex-5 FPGA中實(shí)現(xiàn)設(shè)計(jì)的一些難題，然后用一個(gè)項(xiàng)目作為示范來詳解充分利用其功能集的技法。設(shè)計(jì)過程包括幾個(gè)步驟，從針對(duì)應(yīng)用選擇適合的Virtex-5開始。為便于本文敘述，我們假定IP模塊已經(jīng)過匯編，并且已經(jīng)就緒備用或已經(jīng)用CORE Generator生成。 [b]　　針對(duì)應(yīng)用選擇適合的器件[/b] 　　...
2014-04-09

--BBS主題帖: 賽靈思（Xilinx ）FPGA設(shè)計(jì)約束的分類

本文主要通過一個(gè)實(shí)例具體介紹ISE中通過編輯UCF文件來對(duì)FPGA設(shè)計(jì)進(jìn)行約束，主要涉及到的約束包括時(shí)鐘約束、群組約束、邏輯管腳約束以及物理屬性約束。 Xilinx定義了如下幾種約束類型： • “Attributes and Constraints” • “CPLD Fitter” • “Grouping Constraints” •...
2014-04-09

--BBS主題帖: Xilinx IP Evaluation License申請(qǐng)指南

Evaluation License介紹摘自：[url]http://www.openhw.org/bbs/index.php?act=Article&[/url];page=&tid=26280 在這里先對(duì)大家問的IP做一個(gè)介紹：對(duì)于FPGA器件來說，IP(Intellectual Property)就是某些已經(jīng)設(shè)計(jì)好的模塊，ready for use的HDL代碼或者網(wǎng)表級(jí)文件。在Xilinx的官方網(wǎng)站上面的IP列表...
2014-04-08

--BBS主題帖: Xilinx FPGA設(shè)計(jì)約束的分類

摘要：本文主要通過一個(gè)實(shí)例具體介紹ISE中通過編輯UCF文件來對(duì)FPGA設(shè)計(jì)進(jìn)行約束，主要涉及到的約束包括時(shí)鐘約束、群組約束、邏輯管腳約束以及物理屬性約束。 Xilinx定義了如下幾種約束類型： • “Attributes and Constraints” • “CPLD Fitter” • “Grouping Constraints” &...
2014-04-08

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