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應(yīng)用開(kāi)發(fā)

VR/無(wú)人機(jī)| 智能照明| 智能家居| 工業(yè)自動(dòng)化| 測(cè)試測(cè)量| 人工智能| 碳化硅/氮化鎵| 智能電源及能源| 智能可穿戴| 智能手機(jī)| 智能醫(yī)療及看護(hù)| 通信及物聯(lián)網(wǎng)| 智能交通及汽車(chē)

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--BBS主題帖: 基于NI LabVIEW 2010和NI RIO構(gòu)建精確定時(shí)的嵌入式系統(tǒng)

[font=微軟雅黑, Tahoma,][b]1[/b][b]、介紹[/b][/font] [font=微軟雅黑, Tahoma,]在構(gòu)建嵌入式系統(tǒng)時(shí)，不論是為了確保控制循環(huán)能夠可靠的執(zhí)行，還是保證I/O信號(hào)能夠被及時(shí)響應(yīng)，或是讓處理速度達(dá)到系統(tǒng)應(yīng)用的要求，定時(shí)都是其中的關(guān)鍵。構(gòu)建一套可以滿足定時(shí)要求的系統(tǒng)，首先從硬件開(kāi)始進(jìn)行選擇，必...
2015-08-18

--BBS主題帖: 利用FPGA實(shí)現(xiàn)視頻監(jiān)控系統(tǒng)的視頻處理之二

PC擴(kuò)展卡形式的DVR系統(tǒng) PCI總線在PC機(jī)上已成功應(yīng)用了10余年。但今天的PC擴(kuò)展卡DVR系統(tǒng)所要求的帶寬已遠(yuǎn)遠(yuǎn)超出了PCI總線所能提供的極限。未壓縮的視頻(在除去空白幀之后)數(shù)據(jù)率約為165 Mbps。于是，當(dāng)PCI總帶寬為1 Gbps時(shí)，一條PCI總線上最多可同時(shí)連接6個(gè)發(fā)送未壓縮視頻的捕捉或...
2015-08-18

--BBS主題帖: 嵌入式字符設(shè)備驅(qū)動(dòng)程序

[color=#0990][size=12pt][b]驅(qū)動(dòng)程序module的工作流程主要分為四個(gè)部分： 1、用Linux提供的命令加載驅(qū)動(dòng)module 2、驅(qū)動(dòng)module的初始化（初始化結(jié)束后即進(jìn)入“潛伏”狀態(tài)，直到有系統(tǒng)調(diào)用） 3、當(dāng)操作設(shè)備時(shí)，即有系統(tǒng)調(diào)用時(shí)，調(diào)用驅(qū)動(dòng)module提供的各個(gè)服務(wù)函數(shù) 4、卸載驅(qū)動(dòng)module[/b][/size][...
2015-08-18

--BBS主題帖: 是時(shí)候重新考慮DisplayPort了嗎

高清多媒體接口([url=http://www.eechina.com/keyword/HDMI]HDMI[/url])和DisplayPort之爭(zhēng)很快就偃旗息鼓了，HDMI迅速且無(wú)可爭(zhēng)議地變成下一代音頻/視頻連接接口的首選協(xié)議，成為現(xiàn)代電視、媒體播放器、游戲控制臺(tái)和攝像機(jī)的標(biāo)配功能。 HDMI可以在一條電纜上支持多頻道數(shù)字音頻以及任何電視或個(gè)人電腦...
2015-08-18

--BBS主題帖: linux中的IO端口映射和IO內(nèi)存映射

[align=left]CPU地址空間 CPU地址空間 [b][size=3][color=#ff0000]（一）地址的概念[/color][/size][/b][/align] [align=left]1）[b][color=#0000ff]物理地址：[/color][/b]CPU地址總線傳來(lái)的地址，由硬件電路控制其具體含義。物理地址中很大一部分是留給內(nèi)存條中的內(nèi)存的，但也常被映射到其他存儲(chǔ)器...
2015-08-18

--BBS主題帖: ARM體系結(jié)構(gòu)的發(fā)展

處理器的體系結(jié)構(gòu)定義了指令集（ISA）和基于這一體系結(jié)構(gòu)下處理器的程序員模型。盡管每個(gè)處理器性能不同，所面向的應(yīng)用不同，每個(gè)處理器的實(shí)現(xiàn)都要遵循這一體系結(jié)構(gòu)。　　[url=http://www.eechina.com/keyword/ARM]ARM[/url]體系結(jié)構(gòu)為嵌入系統(tǒng)發(fā)展商提供很高的系統(tǒng)性能，同時(shí)保持優(yōu)異的功耗和面積...
2015-08-18

--BBS主題帖: fpga 輸入緩沖（4）

[size=5][color=#674EA7]1.IBUFG即輸入全局緩沖，是與專(zhuān)用全局時(shí)鐘輸入管腳相連接的首級(jí)全局緩沖。所有從全局時(shí)鐘管腳輸入的信號(hào)必須經(jīng)過(guò)IBUF元，否則在布局布線時(shí)會(huì)報(bào)錯(cuò)。IBUFG支持AGP、CTT、GTL、GTLP、HSTL、LVCMOS、LVDCI、LVDS、LVPECL、LVTTL、PCI、PCIX和SSTL等多種格式的IO標(biāo)準(zhǔn)。 G 單 2...
2015-08-14

--BBS主題帖: fpga 輸入緩沖（2）

[b][size=5][color=#674EA7]IBUFDS、IBUFGDS和OBUFDS都是差分信號(hào)緩沖器，用于不同電平接口之間的緩沖和轉(zhuǎn)換。IBUFDS是差分輸入的時(shí)候用，OBUFDS是差分輸出的時(shí)候用，而IBUFGDS則是時(shí)鐘信號(hào)專(zhuān)用的輸入緩沖器。[/color][/size][/b][align=left][b][size=5][color=#674EA7]下面詳細(xì)說(shuō)明：[/color][/size]...
2015-08-14

--BBS主題帖: fpga 輸入緩沖

[size=5][color=#674EA7]目前，大型設(shè)計(jì)一般推薦使用同步時(shí)序電路。同步時(shí)序電路基于時(shí)鐘觸發(fā)沿設(shè)計(jì)，對(duì)時(shí)鐘的周期、占空比、延時(shí)和抖動(dòng)提出了更高的要求。為了滿足同步時(shí)序設(shè)計(jì)的要求，一般在FPGA設(shè)計(jì)中采用全局時(shí)鐘資源驅(qū)動(dòng)設(shè)計(jì)的主時(shí)鐘，以達(dá)到最低的時(shí)鐘抖動(dòng)和延遲。[/color][/size][size=5][color...
2015-08-14

--BBS主題帖: Xilinx FPGA全局時(shí)鐘和第二全局時(shí)鐘資源的使用方法

“全局時(shí)鐘和第二全局時(shí)鐘資源”是FPGA同步設(shè)計(jì)的一個(gè)重要概念。合理利用該資源可以改善設(shè)計(jì)的綜合和實(shí)現(xiàn)效果；如果使用不當(dāng)，不但會(huì)影響設(shè)計(jì)的工作頻率和穩(wěn)定性等，甚至?xí)?dǎo)致設(shè)計(jì)的綜合、實(shí)現(xiàn)過(guò)程出錯(cuò)。本文總結(jié)了Xilinx FPGA全局時(shí)鐘和第二全局時(shí)鐘資源的使用方法，并強(qiáng)調(diào)了應(yīng)用中的注意事項(xiàng)。...
2015-08-14

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