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應(yīng)用開(kāi)發(fā)

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--BBS主題帖: 基于FPGA和DVI視頻接收器設(shè)計(jì)

[color=#2e2e2e][font=微軟雅黑,]DVI(Digital Video Interface)接口[1-3]是由數(shù)字顯示工作組在1999年制定的，利用最小變換差分信號(hào)TMDS作為基本電氣鏈接信號(hào)。圖像源生成的3路紅、綠、藍(lán)信號(hào)和控制信號(hào)在時(shí)鐘的作用下由DVI發(fā)送器進(jìn)行編碼并串行化后，通過(guò)TMDS通道發(fā)送給DVI接收器;DVI接收器對(duì)其進(jìn)行串/...
2014-06-29

--BBS主題帖: FPGA開(kāi)發(fā)流程

[font=微軟雅黑,]1. FPGA開(kāi)發(fā)流程：[/font] [font=微軟雅黑,]電路設(shè)計(jì)與設(shè)計(jì)輸入[/font] [font=微軟雅黑,]仿真驗(yàn)證：利用Xilinx集成的仿真工具足矣[/font] [font=微軟雅黑,]邏輯綜合：利用XST(Xilinx Synthesis Tool)工具[/font] [font=微軟雅黑,]布局布線：利用Xilinx的Implementation Tool工具[/...
2014-06-29

--BBS主題帖: 基于DSP和FPGA的紅外信息數(shù)據(jù)處理系統(tǒng)

[font=微軟雅黑,]現(xiàn)代空戰(zhàn)中，光電對(duì)抗裝備在戰(zhàn)爭(zhēng)中扮演著重要的角色，而紅外偵測(cè)與跟蹤系統(tǒng)由于采用的無(wú)源探測(cè)技術(shù)，因此與雷達(dá)等主動(dòng)探測(cè)系統(tǒng)相比具有隱身性強(qiáng)、抗干擾能力好和小型化程度高等優(yōu)點(diǎn)，受到業(yè)內(nèi)的關(guān)注。新一代紅外成像導(dǎo)引系統(tǒng)須具備高精度、處理速度快、實(shí)時(shí)性強(qiáng)且反應(yīng)時(shí)間短等特點(diǎn)，這...
2014-06-29

--BBS主題帖: 基于Xilinx FPGA 的SPI Flash 控制器設(shè)計(jì)與驗(yàn)證

[font=微軟雅黑,]現(xiàn)場(chǎng)可編程門(mén)陣列FPGA 常常進(jìn)行大數(shù)據(jù)量的處理,數(shù)據(jù)的存儲(chǔ)便成了問(wèn)題,利用SPI Flash 大容量、讀寫(xiě)速度快、成本低廉以及數(shù)據(jù)在斷電后不丟失的特點(diǎn),可以將配置數(shù)據(jù)存儲(chǔ)于SPI Flash 中[1] 。它比起傳統(tǒng)的并行總線接口Flash 來(lái)說(shuō)節(jié)省了很多的I/ O 口資源,從而為系統(tǒng)功能的擴(kuò)展提供了更多的...
2014-06-29

--BBS主題帖: 專家秘笈連載五：如何將MicroBlaze輸入時(shí)鐘從差分時(shí)鐘改為單輸入

[font=微軟雅黑,]第一步，創(chuàng)建一個(gè)工程 [img]http://xilinx.eetrend.com/files-eetrend-xilinx/article/201308/4517-9283-buhuo1.jpg[/img][/font] [font=微軟雅黑,]第二步，刪除 clock_generator[/font] [font=微軟雅黑,]刪除前： [img]http://xilinx.eetrend.com/files-eetrend-xilinx/article/2...
2014-06-29

--BBS主題帖: UWB定位系統(tǒng)FPGA基帶處理設(shè)計(jì)

[font=微軟雅黑,]無(wú)線定位系統(tǒng)從信號(hào)測(cè)量技術(shù)上分為2大類：信號(hào)強(qiáng)度測(cè)量和到達(dá)時(shí)間測(cè)量。RFID各種技術(shù)（WiFi、ZigBee、Bluetooth）均采用測(cè)量射頻信號(hào)強(qiáng)度的方法，而無(wú)線信號(hào)強(qiáng)度容易受到障礙物等因素的嚴(yán)重影響，因此RFID定位精度較低。而UWB采用測(cè)量窄脈沖（1 ns）到達(dá)時(shí)間的方法，定位精度提高了一個(gè)...
2014-06-29

--BBS主題帖: 采用Spartan-6 FPGA加速紋理映射

[font=微軟雅黑,][color=#FF8000]這種要求嚴(yán)苛的圖形流程曾經(jīng)是定制 ASIC 內(nèi)核的應(yīng)用，而如今卻成為低成本 FPGA 的天下。[/color][/font] [font=微軟雅黑,]作者：Sebastien Bourdeauducq 創(chuàng)始人 Milkymist [email=Sebastien@milkymist.org]Sebastien@milkymist.org[/email][/font] [font=微軟雅黑...
2014-06-29

--BBS主題帖: TD-LTE系統(tǒng)中基于FPGA的解調(diào)與解擾的仿真和實(shí)現(xiàn)

[font=微軟雅黑,]LTE系統(tǒng)將最大系統(tǒng)帶寬從5 MHz擴(kuò)展到20 MHz，能夠在20 MHz帶寬內(nèi)實(shí)現(xiàn)50 Mb/s上行瞬間峰值速率和100 Mb/s下行瞬間峰值速率[1]。[/font] [font=微軟雅黑,]為了提高數(shù)據(jù)的傳輸速率和系統(tǒng)的吞吐量，采用正交振幅調(diào)制技術(shù)[2]，在LTE系統(tǒng)中主要有QPSK、16QAM、64QAM三種調(diào)制方案。在解調(diào)與解...
2014-06-29

--BBS主題帖: 基于Xilinx System Generator的PID算法快速硬件實(shí)現(xiàn)

[font=微軟雅黑,]1 Xilinx System Generator簡(jiǎn)介[/font][color=#2e2e2e][font=微軟雅黑,] Xilinx System Generator 是專門(mén)為數(shù)字信號(hào)算法處理而推出的模型化設(shè)計(jì)平臺(tái)，可以快速、簡(jiǎn)單地將DSP系統(tǒng)的抽象算法轉(zhuǎn)換成可綜合的、可靠的硬件系統(tǒng)，彌補(bǔ)了大部分對(duì)C語(yǔ)言以及Matlab工具很熟悉的DSP工程師對(duì)于...
2014-06-29

--BBS主題帖: 把握賽靈思FPGA中的主要時(shí)鐘資源

[font=微軟雅黑,][color=#FF8000]作者：Sharad Sinha 博士生高性能嵌入式系統(tǒng)中心新加坡南洋理工大學(xué) 電子郵箱： [email=Sharad_sinha@pmail.ntu.edu.sg]Sharad_sinha@pmail.ntu.edu.sg[/email][/color][/font] [font=微軟雅黑,]把握DCM、PLL、PMCD 和MMCM 知識(shí)是穩(wěn)健可靠的時(shí)鐘設(shè)計(jì)策略的基礎(chǔ)。...
2014-06-18

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