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↓在 論壇帖子 中搜索到 5865 條關于“MSO”的信息，用時:0.006 sec.

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Freescale網站有兩篇文章可以參考：HCS12_Resets and Interrupt SourcesAN2201 Low Battery Cranking Pulse in Automotive Applications [align=right][color=#000066][此貼子已經被作者于2009-2-23 11:03:10編輯過][/color][/align]
2009-02-23

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3 板卡邏輯設計 3.1 控制邏輯實現 SOPC(System on Programmable Chip)技術是Altera公司于2000年最早提出的，提供了使用大規?？删幊唐骷﨔PGA實現SOC功能。SOPC的引進對僅為小批量應用或處于開發階段SOC帶來有效解決方法。配合Altera公司提供的NIOS II軟核處理器生成高效的SOPC系...
2009-02-06

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2009-02-06

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2.3 高速邏輯分析儀及存儲示波器設計高速邏輯分析儀的采樣率為150 MHz，對于16路采樣來說，數據量達到150 M?6 bit。采用兩片10 ns級的256 K?6 bit RAM擴展數據位，實現降速存儲。位數擴展1倍，存儲速率降低1倍，對于75 MHz的存儲速度，選用Cypress公司的CY7C-1041-8ns。RAM數據地址線和邏輯分...
2009-02-06

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2.2 雙路信號源設計利用FPGA內部M4K存儲模塊、邏輯資源和高頻時鐘，以DDS／控制模塊+高速D／A實現雙路信號源，避免采用專用DDS器件，從而節省成本，提高功能的多樣性。雙路信號源電路設計的前端模塊包括DDS方式實現的可變幅度、相位的正弦波以及硬件語言表述的占空比可調的方波、三角波、調制...
2009-02-06

--BBS主題帖: [轉帖]基于FPGA的低成本虛擬測試系統實現

作者：吳浩，胡方明，任愛鋒西安電子科技大學1 引言傳統測試測量儀存在價格昂貴、體積龐大、數據傳輸速率低、存儲顯示困難等問題，本文選用FPGA實現數據處理、邏輯控制，充分利用PC機，結合Labwindows圖形化上層應用軟件界面生成的虛擬測試系統具有較強的競爭力。本系統在FPGA單板單片主控...
2009-02-06

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若想掌握時鐘設計方法首先需要了解建立時間和保持時間的概念。建立時間（setup time）：是指在觸發器的時鐘信號上升沿到來以前，數據穩定不變的時間，如果建立時間不夠，數據將不能在這個時鐘上升沿被打入觸發器；保持時間（hold time）：是指在觸發器的時鐘信號上升沿到來以后，數據穩定不變的時...
2009-02-06

--BBS主題帖: [轉帖]FPGA/CPLD重要設計思想及工程應用

概述數字電路中,時鐘是整個電路最重要、最特殊的信號。第一, 系統內大部分器件的動作都是在時鐘的跳變沿上進行, 這就要求時鐘信號時延差要非常小, 否則就可能造成時序邏輯狀態出錯. 第二, 時鐘信號通常是系統中頻率最高的信號. 第三, 時鐘信號通常是負載最重的信號, 所以要合理分配負載。出于...
2009-02-06

--BBS回帖(查看原帖)

我將程序編好后（ISE4.2版本），想將文件編譯好了直接燒，可是不會，希望能幫幫我，謝謝！！[attach]6370[/attach]之后直接進入PROGRAMMING界面[attach]6371[/attach]雙擊芯片出來的那個燒錄文件請高手幫幫忙，如何直接變為JED文件直接燒錄，而不需要進入下面這個界面 [attach]6372[/attach] [align...
2009-02-05

--BBS主題帖: [原創]Arm開發板的開發步驟及arm開發板的調試方法

1．做個最小系統板：如果你從沒有做過ARM的開發，建議你一開始不要貪大求全，把所有的應用都做好，因為ARM的啟動方式和dsp或單片機有所不同，往往會遇到各種問題，所以建議先布一個僅有Flash,SRAM或SDRAM、CPU、JTAG、和復位信號的小系統板，留出擴展接口。使最小系統能夠正常運行，你的任務就完...
2009-02-05

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