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應(yīng)用開發(fā)

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--BBS主題帖: 一種數(shù)字示波器的微處理器硬件設(shè)計(jì)

[font=Arial, Helvetica, sans-serif, 宋體][b]引言[/b][/font] [font=Arial, Helvetica, sans-serif, 宋體]　　隨著通信技術(shù)的迅猛發(fā)展，電信號(hào)越來越復(fù)雜化和瞬態(tài)化，開發(fā)人員對(duì)測(cè)量領(lǐng)域必不可少的工具——數(shù)字示波器的性能提出了越來越高的要求。最大限度提高實(shí)時(shí)采樣率和波形捕獲能力成為了國內(nèi)...
2014-04-19

--BBS主題帖: FPGA平臺(tái)架構(gòu)用于復(fù)雜嵌入式系統(tǒng)

設(shè)計(jì)嵌入系統(tǒng)的主要挑戰(zhàn)來自于需要同時(shí)優(yōu)化眾多設(shè)計(jì)因素。這些需要優(yōu)化的設(shè)計(jì)因素包括單位成本、NRE（不可回收工程）成本、功率、尺寸、性能、靈活性、原型制造時(shí)間、產(chǎn)品上市時(shí)間、產(chǎn)品在市場(chǎng)生存時(shí)間、可維護(hù)性、可重配置能力、工程資源、開發(fā)和設(shè)計(jì)周期、工具、硬件/軟件劃分，以及其他許多因素。 ...
2014-04-19

--BBS主題帖: FPGA電源需求中三種供電要求解析方案

目前越來越多的家用電器從低速的撥號(hào)上網(wǎng)向?qū)拵Щヂ?lián)網(wǎng)接入或互聯(lián)網(wǎng)協(xié)議電視(IPTV)轉(zhuǎn)移，尤其是IPTV有望在中國獲得快速的發(fā)展。比較而言，IPTV的基礎(chǔ)設(shè)施成本相當(dāng)?shù)停驗(yàn)檫@種方法不需要銅軸電纜，而是采用DSL或?qū)拵ф溄雍蜋C(jī)頂盒將節(jié)目流傳送到家用電器。現(xiàn)在的可編程門陣列(FPGA)已經(jīng)被證明是這種平...
2014-04-19

--BBS主題帖: 基于FPGA的高速數(shù)據(jù)采集控制模塊設(shè)計(jì)

在雷達(dá)、通信、氣象、軍事監(jiān)控及環(huán)境監(jiān)測(cè)等領(lǐng)域，現(xiàn)場(chǎng)信號(hào)具有重要的作用。這些信號(hào)的主要特點(diǎn)是：實(shí)時(shí)性強(qiáng)、數(shù)據(jù)速率高、數(shù)據(jù)量大、處理復(fù)雜。為能夠完整、準(zhǔn)確地捕獲到各種信號(hào)并及時(shí)進(jìn)行處理，需要臨測(cè)系統(tǒng)能夠具備任意長(zhǎng)度連續(xù)采集和存儲(chǔ)的功能，且具有較高的數(shù)據(jù)傳輸率。考慮到FPGA擁有豐富的可編...
2014-04-19

--BBS主題帖: 基于賽靈思FPGA的嵌入式Linux軟硬件設(shè)計(jì)

[align=left][url=http://www.c114.net/keyword/FPGA][u][color=#0066cc]FPGA[/color][/u][/url]是通過邏輯組合電路來實(shí)現(xiàn)各種功能的器件。由于FPGA內(nèi)部集成了大量的邏輯資源和可配置的I/O引腳，加上獨(dú)特的并行處理架構(gòu)，可以輕松實(shí)現(xiàn)同時(shí)對(duì)多個(gè)外部設(shè)備的配置和管理，以及內(nèi)外各種接口數(shù)據(jù)的傳輸。現(xiàn)在...
2014-04-18

--BBS主題帖: IPTV系統(tǒng)中FPGA供電要求的復(fù)雜性及其解決方案分析

目前越來越多的家用電器從低速的撥號(hào)上網(wǎng)向[url=http://www.c114.net/keyword/%BF%ED%B4%F8][u][color=#0066cc]寬帶[/color][/u][/url][url=http://www.c114.net/keyword/%BB%A5%C1%AA%CD%F8][u][color=#0066cc]互聯(lián)網(wǎng)[/color][/u][/url]接入或互聯(lián)網(wǎng)協(xié)議電視([url=http://www.c114.net/keyword/IPTV][...
2014-04-18

--BBS主題帖: 利用賽靈思FPGA快速創(chuàng)建存儲(chǔ)器接口的設(shè)計(jì)

Xilinx FPGA 提供可簡(jiǎn)化接口設(shè)計(jì)的 I/O 模塊和邏輯資源。盡管如此，這些 I/O 模塊以及額外的邏輯仍需設(shè)計(jì)人員在源 RTL 代碼中配置、驗(yàn)證、執(zhí)行，并正確連接到系統(tǒng)的其余部分，然后仔細(xì)仿真并在硬件中進(jìn)行驗(yàn)證。　　本文介紹了[url=http://search.china.alibaba.com/news/k-%B4%E6%B4%A2%C6%F7_n-y.ht...
2014-04-18

--BBS主題帖: 基于賽靈思Virtex-5的PCI ExPress總線傳輸視頻采集系統(tǒng)方案實(shí)現(xiàn)

[b]摘要：本文[/b]提出了基于PCI Express總線傳輸?shù)囊曨l采集系統(tǒng)設(shè)計(jì)方案。采用ADV7188進(jìn)行視頻解碼，能夠采集多種格式模擬視頻信號(hào)，而且提高視頻信號(hào)的質(zhì)量；采用Virtex-5系列的[b][url=http://xilinx.eetrend.com/][u][color=#0066cc]FPGA[/color][/u][/url][/b]使系統(tǒng)設(shè)計(jì)靈活、集成度高且易升級(jí)。...
2014-04-17

--BBS主題帖: 如何在賽靈思FPGA設(shè)計(jì)中保留可重復(fù)結(jié)果？

作者：Kate Kelley 賽靈思公司產(chǎn)品營銷助理工程師 [email=kate.kelley@xilinx.com][color=#086782]kate.kelley@xilinx.com[/color][/email] 滿足設(shè)計(jì)的時(shí)序要求本身已非易事，而要實(shí)現(xiàn)某項(xiàng)設(shè)計(jì)的整體時(shí)序具有完全可重復(fù)性有時(shí)候卻是不可能的任務(wù)。幸運(yùn)的是，設(shè)計(jì)人員可以借助有助于實(shí)現(xiàn)可重復(fù)時(shí)序...
2014-04-17

--BBS主題帖: QDR SRAM與賽靈思Spartan3 FPGA的接口設(shè)計(jì)

為了滿足當(dāng)前系統(tǒng)和處理器的生產(chǎn)量需求，更新的靜態(tài)存儲(chǔ)器應(yīng)運(yùn)而生。QDR SRAM就是由Cypress、Renesas、IDT、[url=http://www.c114.net/keyword/NEC][u][color=#0066cc]NEC[/color][/u][/url]和Samsung為高性能的[url=http://www.c114.net/keyword/%CD%F8%C2%E7][u][color=#0066cc]網(wǎng)絡(luò)[/color][/u][/ur...
2014-04-17

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