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↓在 論壇帖子 中搜索到 652 條關于“Simulink”的信息，用時:0.003 sec.

--BBS主題帖: 求助關于system generator轉化vhdl語言

我用sysgen做了一個乘加單元在simulink里面仿真通過了，就是轉化的vhdl時候老出錯請前輩們指點迷津 [align=right][color=#000066][此貼子已經被作者于2007-10-29 16:40:10編輯過][/color][/align]
2007-10-25

--BBS回帖(查看原帖)

呵呵，我和你做的是一樣的東西，一樣的工具和流程，但俺也是新手啊，開始兩周了，Simulink加SysGen做了一個簡單的加法，現在不知道怎么在ＭＬ４０２板子上實現以及測試呢。。。。。俺的MSN sun_yhl@hotmail.com 不過我們估計有6個小時時差，有電話的話，俺可以打過去聊聊的。。。。
2007-10-20

--BBS主題帖: 有人用 Virtex ML402 的板子嗎？配置和下載的問題。。。來自德國菜鳥求救啊！

現在畢設，學的是自動化，接觸FPGA一共才兩周。。。用的是SysGen， ISE9.2 ，在SysGen里用FFT模塊建立DSP的模型，然后直接生成VHDL，及ISE的Project，Netlist文檔，然后導入ISE里，進行約束，Route，Map，and so on.... 最后結果要求FPGA的Board能和dSPACE建立兩個8Bit的 Databus，進行無錯誤的傳輸，...
2007-10-20

--BBS主題帖: 有人用 Virtex ML402 的板子嗎？配置和下載的問題。。。來自德國菜鳥求救啊！

有人用 Virtex ML402 的板子嗎？現在畢設，學的是自動化，接觸FPGA一共才兩周。。。用的是SysGen， ISE9.2 ，在SysGen里用FFT模塊建立DSP的模型，然后直接生成VHDL，及ISE的Project，Netlist文檔，然后導入ISE里，進行約束，Route，Map，and so on.... 最后結果要求FPGA的Board能和dSPACE建立兩個8Bi...
2007-10-20

--BBS主題帖: [求助]新手提問：關于正余弦模塊的問題

最近用Matlab的Simulink做模擬。其中用到Xilinx 中的正/余弦模塊（sine/cosine Module）來計算角度的正余弦值。可是輸入了角度(theta) 卻得不到正確的正余弦值。請教各位大俠，如何才能得到正確的三角函數值呢？是否有可能是我設定的輸入輸出信號位數不匹配？如果是，怎么才能匹配呢？
2007-09-21

--BBS主題帖: Xilinx新版 DSP開發(fā)工具

Xilinx的新版DSP開發(fā)工具可將多速率DSP設計的Fmax性能提升高達38%，同時還大大提高了易用性。AccelDSP™綜合工具和System Generator for DSP工具9.2版使Xilinx® XtremeDSP™ 解決方案的開發(fā)工具組件提供了更高的性能水平，同時兩種工具間的集成也更為緊密，為同時使用MATLAB® 和 Sim...
2007-09-07

--BBS主題帖: [求助]如何在sysgen 使用modelsim仿真...

這問題困擾我很久了...請問誰可以教教我..我正在學習如何使用black box 來co-simulation卻一直出現兩個問題...1. An internal error occurred in the Xilinx Blockset Library.Error occurred during "Simulation Initialization".This block is currently unlinked in the Simulink model. ...
2007-08-17

--BBS回帖(查看原帖)

可以在SIMULINK下安裝XILINX 的SYSTEM GENERATOR 的模塊，然后用ISE直接生成VHDL語言。
2007-04-27

--BBS主題帖: 續(xù)3

那么國內現在一般采用怎樣的開發(fā)流程呢？使用什么軟件呢？我的流程simulink->system generator->xilinx ise->xilinx platform studio->fpga,沒有人和我做相似的東西嗎？
2007-04-13

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