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↓在 論壇帖子 中搜索到 939 條關于“DCM”的信息，用時:0.003 sec.

--BBS主題帖: 關于Xilinx時鐘資源利用方法

[b]FPGA設計中全局時鐘與第二全局時鐘資源的應用[/b]FPGA 設計中全局時鐘與第二全局時鐘資源的應用 “全局時鐘和第二全局時鐘資源”是FPGA同步設計的一個重要概念。合理利用該資源可以改善設計的綜合和實現效果；如果使用不當，不但會影響設計的工作頻率和穩定性等，甚至會導致設計的綜合、實現過程出錯...
2012-03-02

--BBS主題帖: xilinx FPGA 片內時鐘的設計（轉）

FPGA內部的時鐘分為多個區域(某些高端的FPGA)或分為4個象限(某些低端的FPGA)，在這個區域或象限內有特定多的時鐘能夠驅動寄存器和RAM的時鐘端。另外，在樹干上有專用的時鐘線將進入這些區域和象限的時鐘連接起來。 [font=Verdana]　　1．全局時鐘樹和全局時鐘緩沖器[/font] [font=Verdana]　　全局時鐘...
2012-03-02

--BBS主題帖: 克服FPGA I/O引腳分配挑戰

對于需要在PCB板上使用大規模[url=http://article.****.com/word/201674.aspx]FPGA[/url]器件的設計人員來說，[url=http://article.****.com/word/201675.aspx]I/O[/url][url=http://article.****.com/word/201676.aspx]引腳分配[/url]是必須面對的眾多挑戰之一。由于眾多原因，許多設計人員發表為大型...
2012-03-02

--BBS主題帖: xilinx FPGA 片內時鐘的設計

FPGA內部的時鐘分為多個區域(某些高端的FPGA)或分為4個象限(某些低端的FPGA)，在這個區域或象限內有特定多的時鐘能夠驅動寄存器和RAM的時鐘端。另外，在樹干上有專用的時鐘線將進入這些區域和象限的時鐘連接起來。 [font=Verdana]　　1．全局時鐘樹和全局時鐘緩沖器[/font] [font=Verdana]　　全局時鐘...
2012-03-02

--BBS主題帖: FPGAのIBUFDS、IBUFGDS&OBUFDS

[table=98%][tr][td][color=#674ea7][font=宋體][size=3]目前，大型設計一般推薦使用同步時序電路。同步時序電路基于時鐘觸發沿設計，對時鐘的周期、占空比、延時和抖動提出了更高的要求。為了滿足同步時序設計的要求，一般在FPGA設計中采用全局時鐘資源驅動設計的主時鐘，以達到最低的時鐘抖動和延遲。...
2012-02-23

--BBS主題帖: LED驅動電源設計的5個要點

LED驅動電源設計須做到調試前計算,調試時測量,調試后老化以下整理了5個要點供參考　　1、LED電流大小　　大家都知道LEDripple過大的話,LED壽命會受到影響,影響有多大,也沒見過哪個專家說過。以前問過LED廠這個數據,他們說30%以內都可以接受,不過后來沒有經過驗證。建議還是盡量控制小點。如果散熱解...
2012-02-21

--BBS主題帖: 一種改進型的時分多址的實現方法

隨著現代通信技術的發展，各種多址技術在日常生活中的應用正變得越來越廣泛。所謂多址技術，是指許多用戶同時使用同一頻譜，采用不同的處理技術，使不同用戶信號之間互不干擾地被分別接收和解調。多址技術分為頻分多址（FDMA）、碼分多址（CDMA）、時分多址（TDM-A）。頻分多址是以不同的頻率信道實現通...
2011-12-19

--BBS主題帖: Xilinx各種資料

[color=#464646][font=simsun]本文轉自：[url=http://microfisher.blog.163.com/blog/static/5137922200932795758466/]http://microfisher.blog.163.com/blog/static/5137922200932795758466/[/url] 這篇文章主要想介紹Xilinx各種資料的找法、分類方法和什么問題該看哪些資料。限于經驗，難免有錯漏...
2011-12-02

--BBS主題帖: DC-DC變換器的基本技術要求

　　DC-DC變換器是開關電源的核心組成部份，常用的正激式和反激式電路拓樸。常規正激式變換器的功率處理電路只有一級，存在MOSFET功率開關電壓應力大，特別是當二次側采用自偏置同步整流方式，輸入電壓變化范圍較寬，如輸入電壓為75V時，存在柵極偏置電壓過高，甚至有可能因柵壓太高而損壞同步整流MOSF...
2011-09-30

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