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↓在 論壇帖子 中搜索到 1617 條關于“Nand”的信息，用時:0.004 sec.

--BBS主題帖: OMAP-L138_FlashAndBootUtils使用及編譯指導(1)

[color=#000][font=Arial,]作者：吳紅軍，[/font][/color][url=http://www.eechina.com/keyword/TI]TI[/url][color=#000][font=Arial,]通用數字信號處理系統技術支持[/font][/color] [b]摘要[/b] [color=#000][font=Arial,]本文介紹OMAP-L138_FlashAndBootUtils工具包基本框架和串口燒寫工具sfh_...
2014-02-28

--BBS主題帖: Linux中加入led驅動及測試程序詳解

[align=left][color=#000][font=Arial,]51[font=宋體][url=http://www.eechina.com/keyword/%E5%8D%95%E7%89%87%E6%9C%BA]單片機[/url]我們在大學都學過，[/font][font=Times New Roman]51[/font][font=宋體]也是我們一個[url=http://www.eechina.com/keyword/%E5%B5%8C%E5%85%A5%E5%BC%8F]嵌入式[/url...
2014-02-28

--BBS主題帖: 推薦一本好書

[font=微軟雅黑,]春節假期在家比較清閑，于是有時間閱讀了一本好書《Verilog HDL高級數字設計》。雖然是英文版的，看起來比較慢，但是它依據數字集成電路系統工程開發的要求與特點，利用Verilog HDL對數字系統進行建模、設計與驗證，對ASIC/FPGA系統芯片工程設計開發的關鍵技術與流程進行了深入講解，內...
2014-02-27

--BBS主題帖: 基于嵌入式圖像信息采集與傳送系統的設計

[font=Arial, Helvetica, sans-serif, 宋體][b]關鍵字：嵌入式圖像信息采集 [/b][/font] [font=Arial, Helvetica, sans-serif, 宋體][b]1.引言[/b] 家庭安防是困擾人們很久的問題，目前“智能家居”的崛起可以說不光解決了這一問題，而且提高了人們的生活質量。但是它的高額費用是大多數人所負擔...
2014-02-27

--BBS主題帖: 基于ARM和FPGA的電力光纖信號分析儀的設計

[b]0 引言 [/b] 隨著電力網絡的擴大復雜化和區域互聯趨勢的到來，電力系統的行為也將越來越復雜。一些原有的假設條件和簡化模型的適用性都將接受進一步的挑戰與檢驗。在此情況下豐富詳盡的現場實測數據，尤其是故障或非正常狀態下的數據。無疑將具有越來越重要的價值。它們不僅是分析故障原因檢驗繼...
2014-02-27

--BBS主題帖: 從磁性隨機存取存儲器到磁性邏輯單元

[color=#000][font=Arial,]作者：Bruno Mussard[/font][/color] [color=#000][font=Arial,]磁性隨機存取存儲器(MRAM)是一種非易失性存儲器技術，正在作為一種主流的數據存儲技術被業界所廣泛接受。它集成了一個磁阻器件和一個硅基選擇矩陣。MRAM的關鍵屬性有非易失性、低[/font][/color][url=http:/...
2014-02-27

--BBS主題帖: 基于FPGA+MCU的大型LED顯示屏系統設計

傳統的大型LED顯示屏系統以單片機MCU、ARM 或PLD為核心控制芯片，以FPGA為核心的led顯示屏控制系統設計實現起來比較復雜，并且需要以高性能的FPGA芯片作為基礎，而以微處理器為核心的LED顯示屏控制系統不夠靈活，在改變LED屏幕顯示尺寸時，需要大幅修改系統設計，PLD雖在處理速度上有較大提高且能很好地...
2014-02-26

--BBS主題帖: 基于FPGA+MCU的大型LED顯示屏系統設計

傳統的大型LED顯示屏系統以單片機MCU、ARM 或PLD為核心控制芯片，以FPGA為核心的led顯示屏控制系統設計實現起來比較復雜，并且需要以高性能的FPGA芯片作為基礎，而以微處理器為核心的LED顯示屏控制系統不夠靈活，在改變LED屏幕顯示尺寸時，需要大幅修改系統設計，PLD雖在處理速度上有較大提高且能很好地...
2014-02-26

--BBS主題帖: 一起學習FPGA開發之二－－Verilog HDL簡明教程(2)

[font=微軟雅黑,]第二章 HDL指南模塊　　模塊是Verilog 的基本描述單位，用于描述某個設計的功能或結構及其與其他模塊通信的外部端口。一個設計的結構可使用開關級原語、門級原語和用戶定義的原語方式描述; 設計的數據流行為使用連續賦值語句進行描述; 時序行為使用過程結構描述。一個模塊可以在另...
2014-02-25

--BBS主題帖: 一起學習FPGA開發連載之一：Verilog HDL簡明教程(part1)

[font=微軟雅黑,]第一章簡介 Verilog HDL是一種硬件描述語言，用于從算法級、門級到開關級的多種抽象設計層次的數字系統建模。被建模的數字系統對象的復雜性可以介于簡單的門和完整的電子數字系統之間。數字系統能夠按層次描述，并可在相同描述中顯式地進行時序建模。[/font] [font=微軟雅黑,]　　...
2014-02-25

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