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↓在 論壇帖子 中搜索到 18133 條關于“FPGA”的信息，用時:0.010 sec.

--BBS主題帖: 基于FPGA的多通道串行A/D轉換器的控制器設計

[b]1 引言[/b] [color=#333333][font=微軟雅黑, Tahoma,]隨著現代電子技術的應用和發展，越來越多的電子應用由模擬系統向數字系統轉變，而A／D轉換器為模擬系統和數字系統的界面，承擔著模擬信號轉變為數字信號的任務，在一些多路信號采集系統和實時數字信號處理系統中，A／D轉換的多路擴展、高精...
2015-09-24

--BBS主題帖: H.264中二進制化編碼器的FPGA實現2

[b]4 二進制化編碼的FPGA實現[/b] [color=#333333][font=微軟雅黑, Tahoma,]改進后的二進制化編碼主要包括：控制單元、二進制化編碼單元及選擇輸出單元，如圖3所示。 [/font][/color] [align=center][font=微軟雅黑, Tahoma,][img]http://upload.semidata.info/new.eefocus.com/article/image/20...
2015-09-24

--BBS主題帖: H.264中二進制化編碼器的FPGA實現

[b]1 引言[/b] [color=#333333][font=微軟雅黑, Tahoma,]隨著數字電視及視頻會議的發展以及應用，H．264由于其更高的壓縮比、更好的圖像質量和良好的網絡適應性而備受關注。 [/font][/color] [color=#333333][font=微軟雅黑, Tahoma,]基于上下文的自適應二進制算術編碼(CABAC)則作為H．264編碼...
2015-09-24

--BBS主題帖: 基于FPGA的FIFO設計和應用2

[color=#333333][font=微軟雅黑, Tahoma,]SDRAM要求在64 ms之內對4 096行進行刷新，也就是每15．625μs刷新一行。由于系統時鐘周期為9．26 ns，所以刷新模塊計數達到1 685時，就需要對SDRAM發出刷新命令，保證SDRAM中的數據不丟失。將自動刷新請求設為優先請求，狀態機內部有請求仲裁邏輯，當自動刷新請...
2015-09-24

--BBS主題帖: 基于FPGA的FIFO設計和應用

[b]引言[/b] [color=#333333][font=微軟雅黑, Tahoma,]在利用DSP實現視頻實時跟蹤時，需要進行大量高速的圖像采集。而DSP本身自帶的FIFO并不足以支持系統中大量數據的暫時存儲，這就要求大的中間緩存，而專用的高速FIFO芯片價格昂貴且容量受限，大大增加了商業成本，因此在實際應用中尋找FIFO代替...
2015-09-24

--BBS主題帖: 基于FPGA的人工神經網絡實現方法的研究2

[b](5)資源和計算速度的平衡(Trade-off)[/b] [color=#333333][font=微軟雅黑, Tahoma,]　　對于FPGA，科學的設計目標應該是在滿足設計時序要求(包括對設計最高頻率的要求)的前提下，占用最少的芯片資源，或者在所規定的占用資源下，使設計的時序余量更大，頻率更高。這兩種目標充分體現了資源和速...
2015-09-24

--BBS主題帖: 基于FPGA的人工神經網絡實現方法的研究

[b]引言 [/b] [color=#333333][font=微軟雅黑, Tahoma,]　　人工神經網絡(Artificial Neural Network，ANN)是一種類似生物神經網絡的信息處理結構，它的提出是為了解決一些非線性，非平穩，復雜的實際問題。目前實現ANN還主要依靠軟件程序．但是依靠程序很難達到實時性的要求。 [/font][/color] ...
2015-09-24

--BBS主題帖: 基于CPLD/FPGA的多功能分頻器的設計與實現

[b]多功能分頻器的設計與實現[/b] [color=#333333][font=微軟雅黑, Tahoma,]　　本設計使用第三方EDA開發工具Protel DXP。該開發工具支持層次原理圖及VHDL語言混合設計并能進行編譯、時序和功能仿真,支持Xilinx、Altera、Lattice等公司的系列 CPLD/FPGA器件,并且具有設計直觀、層次性好等優點。在...
2015-09-24

--BBS主題帖: 基于CPLD/FPGA的多功能分頻器的設計與實現

[b]引言[/b] [color=#333333][font=微軟雅黑, Tahoma,]　　分頻器在CPLD/FPGA設計中使用頻率比較高,盡管目前大部分設計中采用芯片廠家集成的鎖相環資源 ,但是對于要求奇數倍分頻（如3、5等）、小數倍（如2.5、3.5等）分頻、占空比50%的應用場合卻往往不能滿足要求。硬件工程師希望有一種靈活的設計...
2015-09-24

--BBS主題帖: 基于CPCI總線的通用FPGA信號處理板的設計

[color=#333333][font=微軟雅黑, Tahoma,]　由于FPGA中乘法器資源非常寶貴，為了提高乘法器資源的利用率，采用時分復用的方法，考慮只用一個乘法器，對其進行時分復用。在不需要較高采樣速率的系統中，這種結構可以做到實用高的性價比。在設計濾波器時，根據實際情況靈活地選擇乘法器的復用次數Ⅳ和采樣...
2015-09-24

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