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應(yīng)用開發(fā)

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--BBS主題帖: 深入淺出FPGA-16-xilinx_zynq7000_EPP上一個(gè)簡(jiǎn)單實(shí)驗(yàn)(PS)

[font=微軟雅黑,]現(xiàn)在的FPGA都很強(qiáng)大了，不僅有豐富的LE（LC），高端的還集成了CPUcore。這樣，從硬件上就能做SOC，從軟件上可以做嵌入式。本節(jié)就做一個(gè)簡(jiǎn)單的實(shí)驗(yàn)，主要熟悉這個(gè)板子的PS資源。15.1 實(shí)驗(yàn)?zāi)康?》熟悉zynq7000 EPP資源和design suite2》 SDK編碼，實(shí)現(xiàn)一個(gè)簡(jiǎn)單邏輯。15.2 實(shí)驗(yàn)環(huán)境Boa...
2014-09-19

--BBS主題帖: ZedBoard學(xué)習(xí)手記（一） First Step——建立Xilinx交叉編譯環(huán)境

[color=#2e2e2e][font=微軟雅黑,]經(jīng)過這段時(shí)間借由美信DIY大賽對(duì)ZedBoard的學(xué)習(xí)，略有所得，對(duì)這個(gè)新平臺(tái)也有了一定的理解。在此稱之為手記，算是邊學(xué)邊記了。既然還在學(xué)習(xí)，就自然會(huì)有一些謬誤或不足，還望童鞋們指正啊。要開發(fā)ZedBoard最重要的是Xilinx ISE工具集，在這個(gè)IDE里能夠完成大部分的邏輯及...
2014-09-19

--BBS主題帖: ZedBoard學(xué)習(xí)手記（二）開發(fā)自定義AXI總線外設(shè)IP核——以LED和開關(guān)為例

[color=#2e2e2e][font=微軟雅黑,]想要發(fā)揮ZYNQ芯片的特長(zhǎng)，讓整個(gè)系統(tǒng)協(xié)同工作起來(lái)，就需要將PS與PL兩部分結(jié)合在一起，在Cortex-A9核和FPGA邏輯資源之間建立通信的通道，這條通道就是AXI總線。ZedBoard推出的官方例子中已經(jīng)介紹了如何將Xilinx做好的AXI總線IP（如AXI_Timer、AXI_GPIO等）添加到工程中，...
2014-09-19

--BBS主題帖: PVDF傳感器和WSN的振動(dòng)信號(hào)測(cè)量系統(tǒng)

[color=#4d4d4d][font=Arial, tahoma, Verdana]為了滿足振動(dòng)傳感器陣列對(duì)多點(diǎn)信號(hào)實(shí)時(shí)傳輸?shù)囊?，研制了一種基于壓電薄膜（PVDF）傳感器以及無(wú)線傳輸?shù)恼駝?dòng)信號(hào)測(cè)量系統(tǒng)。該系統(tǒng)包含振動(dòng)信號(hào)采集模塊及主控單元，前者集成了振動(dòng)信號(hào)調(diào)理電路、ATmega8A微處理器以及nRF24L01無(wú)線傳輸模塊，用于采集來(lái)自...
2014-09-17

--BBS主題帖: 利用數(shù)字隔離器解決汽車xEV應(yīng)用中的設(shè)計(jì)難題

作者：[url=http://www.eechina.com/keyword/ADI][color=#0066cc]ADI[/color][/url]公司汽車部傳動(dòng)系統(tǒng)工程師James Stegen 在為汽車xEV應(yīng)用開發(fā)解決方案時(shí)，設(shè)計(jì)師會(huì)遇到的一個(gè)難題是如何在高壓電池域與低壓電池域[url=http://www.eechina.com/keyword/電子][color=#0066cc]電子[/color][/url]元件之...
2014-09-16

--BBS主題帖: 一步一步學(xué)ZedBoard & Zynq(三)：使用自帶外設(shè)IP讓ARM PS訪問FPGA

[font=微軟雅黑,]這一節(jié)的目的是使用XPS為ARM PS 處理系統(tǒng) 添加額外的IP。從IP Catalog 標(biāo)簽添加GPIO，并與ZedBoard板子上的8個(gè)LED燈相連。當(dāng)系統(tǒng)建立完后，產(chǎn)生bitstream，并對(duì)外設(shè)進(jìn)行測(cè)試。[/font] [font=微軟雅黑,]硬件平臺(tái)：Digilent ZedBoard[/font] [font=微軟雅黑,]開發(fā)環(huán)境：Windows XP 32 ...
2014-09-15

--BBS主題帖: 選擇你的PLL鎖定時(shí)間測(cè)量

[color=#4d4d4d][font=Arial, tahoma, Verdana]時(shí)鐘速度的提高和更嚴(yán)格的信號(hào)時(shí)序增加了對(duì)精準(zhǔn)的高頻模塊的需求。PLL（鎖相環(huán)）基于輸入信號(hào)生成高頻輸出信號(hào)，是一種備受歡迎的用于產(chǎn)生高頻信號(hào)的電路。當(dāng)PLL參考時(shí)鐘和PLL反饋時(shí)鐘的頻率和相位相匹配時(shí)，PLL則被稱為是鎖定狀態(tài)。達(dá)到鎖定狀態(tài)所需的時(shí)...
2014-09-12

--BBS主題帖: PSoC Creator簡(jiǎn)化可編程器件上的軟硬件協(xié)同設(shè)計(jì)

[color=#000][font=Arial,]作者: Mark Saunders[/font][/color] [color=#000][font=Arial,]采用[/font][/color][url=http://www.eechina.com/keyword/%E5%B5%8C%E5%85%A5%E5%BC%8F]嵌入式[/url][color=#000][font=Arial,]CPU內(nèi)核的可編程器件為應(yīng)對(duì)各種設(shè)計(jì)挑戰(zhàn)提供了有效途徑，而這些挑戰(zhàn)僅僅通過軟...
2014-09-11

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