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應(yīng)用開(kāi)發(fā)

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EDA技術(shù)與FPGA設(shè)計(jì)應(yīng)用

21世紀(jì)是電子信息產(chǎn)業(yè)主導(dǎo)的知識(shí)經(jīng)濟(jì)時(shí)代，信息領(lǐng)域正在發(fā)生一場(chǎng)巨大變革，其先導(dǎo)力量和決定性因素正是微電子集成電路。硅片技術(shù)的日益成熟，特別是深亞微米（DSM，Deep Sub-Micron）和超深亞微米（VDSM，Very Deep Sub-Micron）技術(shù)，極大促進(jìn)了集成電路產(chǎn)業(yè)的快速發(fā)展。　　集成電路發(fā)展經(jīng)歷了電路集...
2012-04-07

基于邏輯分析內(nèi)核的FPGA電路內(nèi)調(diào)試技術(shù)

隨著FPGA融入越來(lái)越多的能力，對(duì)有效調(diào)試工具的需求將變得至關(guān)重要。對(duì)內(nèi)部可視能力的事前周密計(jì)劃將能使研制組采用正確的調(diào)試戰(zhàn)略，以更快完成他們的設(shè)計(jì)任務(wù)。　　“我知道我的設(shè)計(jì)中存在一個(gè)問(wèn)題，但我沒(méi)有很快找到問(wèn)題所需要的內(nèi)部可視能力。”由于缺乏足夠的內(nèi)部可視能力，調(diào)試FPGA基系統(tǒng)可能會(huì)受...
2012-04-07

PWM控制電路基本原理與FPGA

在直流伺服控制系統(tǒng)中,通過(guò)專用集成芯片或中小規(guī)模的數(shù)字集成電路構(gòu)成的傳統(tǒng)PWM控制電路往往存在電路設(shè)計(jì)復(fù)雜,體積大,抗干擾能力差以及設(shè)計(jì)困難、設(shè)計(jì)周期長(zhǎng)等缺點(diǎn)?因此PWM控制電路的模塊化、集成化已成為發(fā)展趨勢(shì).它不僅可以使系統(tǒng)體積減小、重量減輕且功耗降低,同時(shí)可使系統(tǒng)的可靠性大大提高.隨著電子...
2012-04-07

FPGA經(jīng)驗(yàn)總結(jié)

覺(jué)得寫得比不錯(cuò)，就轉(zhuǎn)載過(guò)來(lái)了。　　時(shí)序是設(shè)計(jì)出來(lái)的　　我的boss有在華為及峻龍工作的背景，自然就給我們講了一些華為及altera做邏輯的一些東西，而我們的項(xiàng)目規(guī)范，也基本上是按華為的那一套去做。在工作這幾個(gè)月中，給我感觸最深的是華為的那句話：時(shí)序是設(shè)計(jì)出來(lái)的，不是仿出來(lái)的，更不是湊出來(lái)...
2012-04-07

基于NiosII的SOPC中EEPROM Controller Core的設(shè)計(jì)

1 引言　　由于FPGA的出現(xiàn)，使得我們不需要承擔(dān)較大風(fēng)險(xiǎn)和較高的流片費(fèi)用將小規(guī)模的或處于研發(fā)階段的芯片制成ASIC芯片了。而基于FPGA的SOC——SOPC（可編程片上系統(tǒng)），由于其可編程性，按照用戶特定需要構(gòu)建的SOPC是一個(gè)在某種程度上替代SOC的較好方案。Altera公司為其FPGA開(kāi)發(fā)了第二代軟核嵌入...
2012-04-06

電路板級(jí)仿真的必要性

電路板級(jí)仿真的必要性本文告訴工程師，電路板級(jí)仿真對(duì)于今天大多數(shù)的設(shè)計(jì)而言已不再是一種選擇而是必然之路。電路板級(jí)仿真對(duì)于今天大多數(shù)的設(shè)計(jì)而言已不再是一種選擇而是必然之路。EDA工業(yè)是全球電子工業(yè)快速發(fā)展的關(guān)鍵促進(jìn)因素，其市場(chǎng)規(guī)模高達(dá)1萬(wàn)億美元，大部分銷售額由幾個(gè)大公司壟斷(用EDA市場(chǎng)...
2012-04-06

基于Nios嵌入式軟核處理器的液晶顯示屏控制

摘要：Altera公司的 Nios嵌入式軟核處理器以其成本低廉，設(shè)計(jì)靈活等特點(diǎn)，在嵌入式應(yīng)用領(lǐng)域得到了廣泛的應(yīng)用，同時(shí) LCD也越來(lái)越多地在各種儀器儀表和測(cè)控系統(tǒng)中作為人機(jī)界面和顯示模塊。本文提出一種基于Nios嵌入式軟核處理器的液晶顯示屏的軟、硬件設(shè)計(jì)方案，介紹了對(duì)該液晶屏進(jìn)行控制的硬件接...
2012-04-05

基于C語(yǔ)言的設(shè)計(jì)方式:簡(jiǎn)化FPGA/協(xié)處理器混合平臺(tái)軟硬件協(xié)同設(shè)計(jì)

在最近幾年中日益流行在高性能嵌入式應(yīng)用中使用現(xiàn)場(chǎng)可編程門陣列（FPGA）。FPGA已經(jīng)被證明有能力處理各種不同的任務(wù)，從相對(duì)簡(jiǎn)單的控制功能到更加復(fù)雜的算法操作。雖然FPGA在某些功能上比ASIC硬件具有時(shí)間和成本上的優(yōu)勢(shì)，但在面向軟件應(yīng)用中的FPGA比傳統(tǒng)處理器和DSP的優(yōu)勢(shì)并沒(méi)有體現(xiàn)出來(lái)。這很大程度上...
2012-04-05

片上系統(tǒng)（SOC）設(shè)計(jì)與EDA

摘要：利用EDA工具和硬件描述語(yǔ)言（HDL），根據(jù)產(chǎn)品的特定要求設(shè)計(jì)性能價(jià)格比高的片上系統(tǒng)，是目前國(guó)際上廣泛使用的方法。與傳統(tǒng)的設(shè)計(jì)方法不同，在設(shè)計(jì)開(kāi)始階段并不一定需要具體的單片微控制器（MCU）和開(kāi)發(fā)系統(tǒng)(仿真器)以及帶有外圍電路的線路板來(lái)進(jìn)行調(diào)試，所需要的只是由集成電路制造廠家提供的用H...
2012-04-05

用SignalTap嵌入邏輯分析儀驗(yàn)證PLD設(shè)計(jì)

要說(shuō)ASIC設(shè)計(jì)者的經(jīng)驗(yàn)有所提示的話，那么將來(lái)的百萬(wàn)門級(jí)可編程邏輯設(shè)計(jì)中驗(yàn)證會(huì)耗費(fèi)大半的設(shè)計(jì)周期。隨著設(shè)計(jì)復(fù)雜度的增加，傳統(tǒng)的設(shè)計(jì)驗(yàn)證方法如仿真需要其它技術(shù)和工具的補(bǔ)充，因?yàn)檫@些可編程芯片系統(tǒng)（SOPC）進(jìn)行完全的真實(shí)模擬是不可在適當(dāng)?shù)臅r(shí)間內(nèi)完成。而且，設(shè)計(jì)規(guī)模的陡增必然需要新的工具來(lái)觀...
2012-04-05

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